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新思科技推出適用於感測器之超低功耗IP次 系統 可配置之軟硬體IP解決方案促使感測功能快速整合至系統單晶片(SoC) 4 S/ \) X( K* m% v6 [
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新聞重點: 4 c2 h, R% L: N+ |) Y0 L0 b
- @4 W5 f2 H; ^+ Q$ _& O· 經整合且預先驗證之軟硬體IP次系統包括:兼具功耗及面積效率的ARC 32位元處理器、數位類比介面、硬體加速器、DSP功能軟體庫和I/O軟體驅動程式。- z T. e" `3 i# w7 C. m! e: I% x
· 高度配置密切整合之周邊設備和專用硬體,讓感測器處理效率達到最佳化。
* S$ a$ b& m9 w) Y S; g8 B7 m" r· 與等效的離散元件實作相較,DesignWare®感測器IP次 系統具備超過10個可配置之硬體加速器,可減少記憶體的使用並減少10倍功耗。! h: \, X, j0 h7 k' c
· 廣泛的現成軟體DSP功能庫,內容包括:數學、濾波、矩陣/向量和提取/插值,可加速應用軟體開發。
5 @, B9 }$ _7 G" n4 T· 在28奈米製程中,可讓實作面積小至0.01 mm2,並讓功耗低於4uW/MHZ * `7 H0 m3 Q5 r
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(台北訊) 全球晶片設計及電子系統軟體暨IP領導廠商新思科技(Synopsys)今日宣布推出DesignWare®感測器IP次 系統(DesignWare® Sensor IP Subsystem),此乃針對感測器控制應用所推出之完整軟硬體整合解決方案。新的IP次 系統讓來自數位及類比感測器的數據處理達到最佳化,如此可減輕主處理器的負擔,同時能以超低功耗更具效率地處理感測器數據。可完全配置之次 系統包括DesignWare ARC® EM4 32位元處理器、數位介面、類比至數位之數據轉換器(ADC)、硬體加速器、綜合DSP功能軟體庫以及軟體I/O驅動程式。DesignWare感測器IP提供設計人員完整且預先驗證之解決方案,能滿足智慧感測器、感測器融合(sensor fusion)和感測器中樞(sensor hub)等各式應用的需求。 |
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