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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 用Verilog撰寫(浮點運算)開根號的電路
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[問題求助] 用Verilog撰寫(浮點運算)開根號的電路

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1#
發表於 2012-12-12 21:23:35 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
本帖最後由 key456456 於 2012-12-12 09:31 PM 編輯 & [3 l7 o& n6 d' ?* z- D& m2 e
' k. D9 J; W# O+ b2 @* [. ~8 W* D
請問大大們有沒有sqrt的code7 w% d9 N+ l; b) @* I( p

0 m/ s8 e. j: Z0 \想看看研究一下
+ C+ ^- c  N* _& u9 n, y. G1 L$ g, B
自己實力不夠寫不出來
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