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[問題求助] lvs 問題 急!! 救助

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1#
發表於 2012-3-13 16:43:32 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
請問大大: 在lvs 中的 incorrect instances顯示 layout  name  m42 (-149.250.109.420) mp(pd)  bad component subtype  . O4 i) N" B0 K7 O& }; u: T- }. N. {% ^
) t& v5 i1 K3 [* ^
                 且source name  顯示 m8 mp (pch5)   的錯誤訊息。
( k" J% j4 w) D% M: X9 |2 y+ a# e# S, r! E! C! m
             這問題是什麼原因該怎麼解決?/ n' P& B" H6 v: u2 j3 h
) Z3 x/ W. d& V0 {9 K4 m
                另一個問題是,在lvs 的incorrect instances 顯示 layout name  miss  port   而source name  項有vdd  on net :VDD
# r: K  d$ W  H; j1 r1 x- y6 A6 V' @9 M              * w1 r. O. H: h  a' I
                   這問題我想應該是PORT沒對應的問題,但我有檢查過TEXT 打的地方,並沒錯阿,為何還是會有這樣問題3 B( X9 n( u+ |7 J2 U  w
: z0 T; s0 i) n' J4 P/ i+ J

- F9 h9 o( ~# u            第三個問題, 在LVS有個ERC項 內有SOFTCHK DATABASE     內有一個錯誤訊息,它顯示 Check softchk NBL  contact    這是什麼意思,我該怎麼解決?
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7#
發表於 2012-4-9 16:47:10 | 只看該作者
感謝分享!!~加油~加油!感謝分享!!~加油~加油!
6#
發表於 2012-3-26 14:35:04 | 只看該作者
感謝分享!!~加油~加油!感謝分享!!~加油~加油!
5#
發表於 2012-3-16 23:51:25 | 只看該作者
感謝你分享的問題,,,,,,,,,,,,,.
4#
發表於 2012-3-15 17:13:01 | 只看該作者
EX:
) n4 A! [3 K# t' u*.EQUIV P=pmos_33% m9 E) v2 ^9 k; K$ Y" A
*.EQUIV N=nmos_33
# T/ J, P4 r3 [& `- s. B' B8 z  J5 y6 P" o( w9 B" D" p9 ~% \
上述的P 是LVS COMMAND FILE 上定義的PMOS TYPE ,而PMOS_33 則是電路上PMOS的MODEL NAME6 M. T$ c% A9 t0 h& O+ g4 _
# e" ]5 x# N! h, \+ r1 c- Z. P) c
用*.EQUIV 來宣告此二者的TYPE是相同的,在LVS CHECK之後就不會有BAD TYPE的問題,但必須注意一點3 T, `$ O8 n$ @3 a" P) b  l

, e  a3 q4 T; t因為宣告屬於強制更正TYPE,所以最好在確定LAYOUT及電路是否真的只是TYPE不同,否則會出問題。
3#
 樓主| 發表於 2012-3-13 20:18:28 | 只看該作者
感謝您:但請問大大您說在spice 中打. EQOIV 這指令打了之後是不是就就可以不用在意SPICE TYPE 跟LVS
+ A4 P+ K$ O, R2 ]) J              TYPE呢?
2#
發表於 2012-3-13 17:16:31 | 只看該作者
提供check的方向給你參考:
& g$ \! r2 M& z0 J
2 D8 O4 O$ @: i3 p0 V1.會發生 incorrect instances (bad component subtype)其實就是layout 與spice 的定義不同. I- `1 C3 L& x6 {# i% Z1 A) Y
    所知的可能有二個:1.layout畫錯導致認錯mos type。2.spice type與 lvs mos type取名不同$ F$ v9 L4 f& l3 N! O7 y7 U/ a
    可在spice上用*.EQUIV 宣告。8 P8 ]5 |; E9 Y  ~

- L; T5 t+ v$ M' ?* ^5 ?$ h  D2.incorrect instances 顯示 layout name  miss  port   而source name  項有vdd  on net :VDD
2 I+ h* a' n1 j, D) h- r6 `   極可能是因為第一點的錯誤所造成,LVS 無法CHECK該MOS時引發的錯誤,請先解決第一點錯時再來
, k; d9 O1 M( ~0 J* P    查證。
: v7 s7 Y1 K  I) `
! t) f8 n8 F) |4 a) N3.在LVS有個ERC項 內有SOFTCHK DATABASE :這表示有WELL 是沒接到電位的,可能是P-WELL也可
1 `5 {/ P! B" a- q% R    能是N-WLL,它顯示 Check softchk NBL  contact ,表示NBL 是空接的,與電路不符。
3 z6 q; s: v8 u; ~7 w# }' b  U  p
1 c9 E' T2 F) x8 |" b& o, L8 c8 n以上三點提供給你參考,謝謝。
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