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最近在涉略SDM,也看了許多版上的討論! H; k a8 Z% J' ]- W( G* Y
發現這還真是熱門的話題
" ~8 m% A8 _* _: ?3 g; Z在這有個問題 d. O0 \. ?. f. p3 E
希望各位不吝賜教
6 H: u- Z7 I/ L6 H/ p+ i; k( g1.就是假設我電路操作電壓是正電源vdd , 我1-bit dac出來的vref電壓我覺得應該是0 跟vdd , 但我看過一些資料,他們的vref會是大約2/3*vdd跟1/3*vdd , 為什麼? , 這樣有什麼好處嗎 7 f! t# v4 l: [. ], e2 z
2.我在估算SNR時 , 都是把DFT後的值 , [ 輸入信號的積分 / NOISE信號的積分 ] 再取db , 再根據理論公式來換算大約是幾bit , 最後再跑tran , 將輸入換成dc值來驗證有沒有到達想要的bit數 , 想請問這樣的方式有沒有瑕疵 , 有沒有少考慮到什麼
& T9 k5 E* { ~' k# O" a3. 因為我是跑spectre , 裡面有ㄧ階SDM 的behavior modle , 我跑的條件是fin=1k , fsample=4096k, OSR是2048 , 我tran跑了4m sec , 之後做dft ,頻譜圖很正常 , noise shaping也有出來 , 但是我把behaior modle換成自己兜的電路, 上述模擬條件ㄧ模ㄧ樣, 我只改變了開關跟比較器(用real電路) , op還是用ideal的 , 跑出來的頻譜圖 ,在低頻小於500hz會往上翹 , 請問是什麼原因 , 想說是不是op的offset造成低頻的noise , 不過我op是用ideal的 ,應該不會有offset這個問題 ,
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s$ s/ m! d- ^0 E; @* S$ y# ?以上幾個問題,想請教大家,感謝各位的指導 |
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