# }0 E$ ^, O/ Y9 i5 C u7 m是否兩輸入端皆可為非固定的電壓 . e( `1 ?- A7 [. a9 R 8 \2 n$ }/ q5 k2 r) H( d- P4 a看很多設計都是一端接dc的vref做判斷: i) Q0 H% D) U; A3 B7 G& S
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但現在我的輸入端為兩個都會改變的電壓~ " E* u0 k- {% { 7 \* \: P6 D+ F/ F% }2 O, m那請問這樣要怎麼設計?~謝謝~% f! W/ |1 G8 E+ `
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我要拿這兩個電壓做比較~& v1 h \: m4 O1 L" d! b
一個電壓是由輸入端輸入,另一個是由輸出端拉回來和輸入端做比較 4 K) h/ R' f& U( c4 U+ C. c所以我的兩輸入判斷電壓是不固定的,2 @ o5 N( P, E+ @- a( o$ r6 @4 d# f
只要輸出>輸入結果會為high2 Z2 ~2 T4 W) H% J; n' S
然而輸出<輸入結果為會low " X/ u$ T" O. G不知道這樣行不行設計? f' a7 j; a# _1 y C
& P6 w" D. C% d) X7 L) z- E t但考慮到另一個問題,那兩個相等的時後是否也可為low ) J; E2 I. D0 z4 D7 Z( v, @6 N5 v# r但是兩個要相等好像也很困難吼!作者: jackrabbit 時間: 2011-1-6 05:02 PM
您的作法很矛盾....5 a4 _# n6 P. J- X3 y0 C
比較器是把OP用在開迴路狀態# d0 x7 Y$ Q7 X- r
你直接把兩個想比較的電壓輸入OP的兩個input, output端自然會有H/L; G+ |6 k' f- Z* C8 g" \
至於誰比誰大是發High, 取決於你選的input 極性 6 ^! `8 c: o/ ]- y* Z4 g而且通常會有一個遲滯範圍, 來避免false trigger~$ X9 y# v# q# O2 U
: R6 @. d4 g- Z把輸出端拉回到input是迴授系統(feedback)8 i& T( w& e6 g
負迴授是一般所謂的OP, 最常用在voltage regulation1 L z5 d! v* p
你看到的input 一端給vref 另一端拉output回來就是!!/ e: a$ j3 U0 }
正迴授要不是output拉到always high or always low, 不然就有可能起振~& m0 l D" r. Q8 s
8 R0 e4 y: S% a0 r' U如果看不懂我在說什麼, 可能要先翻翻教科書~~2 v& c3 N5 p* R5 `. \4 r8 k! Q, w& r
Baker那本有一張專門在講comparator design, 可以參考一下!!作者: bernie820 時間: 2011-1-13 12:36 AM