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1#
發表於 2007-5-3 23:15:56 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問一下,我在做logic-tile裡面附的範例中* K. N1 e/ N* w  _' Q
1 y9 R/ S: z6 O- [7 o8 p
step1,成功燒錄到FPGA中5 m; e1 w" L# \# V1 q0 E
: V6 G" ]5 M2 ], ^! u4 E4 @
可是step2卻無法燒錄到flash,不知道哪邊出錯了,請各位大大指教

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2#
發表於 2007-5-4 10:52:19 | 只看該作者
Xilinx 型號選對了應該就可以燒錄囉?, k# n# ^6 S- O

/ B% X* \' v  r$ T4 c" N- u2 b可不可以請你把問題陳述清楚一點
' p& a% P/ p' P" \+ }. Jlogic-tile裡面附的範例 並不是每個人都有阿~
- c7 _( h) [7 r: F8 l7 e! \% J  U6 ?3 E  n1 h1 G% S% J
[ 本帖最後由 masonchung 於 2007-5-4 10:53 AM 編輯 ]
3#
 樓主| 發表於 2007-5-4 14:47:48 | 只看該作者
附件中有範例的bit檔,還有我更改過的brd檔1 y% M. c6 A7 z( F8 o
; \% s( v4 j" {  G
感覺上,似乎是載brd檔上面寫錯了,因為我看user guide中,一共有兩種燒錄FPGA的方法
# z0 ~2 J( N6 l9 p- l: O( |
) @- E$ {3 w" P8 x4 g  [第一種直接燒錄,我已經會了,而第二種是透過flash燒到FPGA,而我的問題就是發生再第二種燒法
. c! ?7 N$ {9 X# o; _* }- b5 H  D7 A- m' t. T
既然第二種燒法式透過flash,那brd的程序應該至少要是二以上,或三....
/ n8 Z9 Q: ~+ P, N$ _- A: Q9 o" q: H) L9 ?$ ^8 m
可是如果按照最初範例的brd檔來執行,仍舊是錯誤,會產生上衣篇的錯誤...而且program那邊我實在也不知道那邊的意義0 g  k2 u6 v5 ], p2 V+ i5 n
4 L1 E9 j( N  K+ O
不懂怎麼去改寫,希望大大能賜教

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參與人數 1Chipcoin +3 收起 理由
masonchung + 3 勇於求知!多問多看囉

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4#
發表於 2007-5-4 15:52:35 | 只看該作者
看起來你改的方法是用在FPGA直接燒錄的方式才是一種程序$ I5 g3 E: G$ B; R3 {
若是要透過Flash燒錄至少要原始brd設定檔的前兩種程序才行喔
# v" q) r& H* m$ ?1 q" s7 a& `6 A8 r! Y6 y% r! R8 ~& ~5 c0 K. l
[ 本帖最後由 masonchung 於 2007-5-4 03:54 PM 編輯 ]
5#
發表於 2007-5-4 16:56:55 | 只看該作者
會不會是這個ltxc2v4000_102cd_xc2v6000_via_build1.bit有問題?# ?& M% S: Y/ h
這個應該是flash control , 所以要先燒到fpga
) b/ Y. P1 b/ x3 m; Y3 b% k! h你要不要看一下版子上用的 Flash的型號對不對5 P6 t) o$ e' \8 ^- W) _
# b" d  v, S7 o) M. u, g. C
[ 本帖最後由 masonchung 於 2007-5-4 04:58 PM 編輯 ]
6#
發表於 2007-5-5 19:59:16 | 只看該作者
一般使用progcards.exe來燒錄會有3個setp. [, e% f4 w$ c+ c
Step1為via的*.bit燒錄
# Z9 d, |, d2 ^6 E9 b  t; M  H8 fStep2才是你的design*..bit的燒錄
; O9 S; V% R6 a8 G8 \6 ~( JStep3則是verification(這步可有可無,看個人)
" W  a5 f$ j; x+ j# \而你的附檔(*.brd)怎麼只有一個呢?還有,你附檔
& o- i+ M9 f  J3 Y2 }7 {/ N5 Zprogram裡的Step1Method = Virtex2應該是要對應via的4 j1 M$ L# _% p3 s. }; I
*.bit 燒錄檔,而不是design的*.bit# G- Y6 ^* y( a- b
所以你還要增加step2 跟 step3

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7#
發表於 2007-5-5 20:56:24 | 只看該作者
我記得 有個Flash Address 要指定6 G) }: n2 L  R( a2 p
不知是否這個位址已經設定好了嗎?
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