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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › verilog的基本介紹
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verilog的基本介紹

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hiyato
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1#
發表於 2008-4-11 21:12:30 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式

. s3 s; c, H7 X5 x( D, I: j% ^3 F
) U9 i( U7 E& C* v1 [" S9 N檔案名稱：verilog- R* }) Z% ]1 D0 I3 `3 l
檔案大小：658K3 ^- ^( M6 u: ^" _9 U
檔案內容：中文
, H& k& v. v; v3 q檔案簡介：verilog的基本介紹，對於新上手的學習者，建立基本觀念

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2#
發表於 2008-4-13 00:35:12 | 只看該作者
小弟我想看看Verilog HDL和VHDL有何差別，還是一樣的東西??; o' l- u  Y. e! W7 o; t

% z- C) d1 W1 |% [2 V謝謝hiyato熱心的分享!!
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rsun49
3#
發表於 2008-4-15 23:51:56 | 只看該作者
thank for ur doc..........................................................
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ricky000
4#
發表於 2008-4-27 03:44:15 | 只看該作者
謝謝熱心的分享!!1 k3 X& W- e) _
謝謝熱心的分享!!6 i% b- U5 [) X- H$ D& w
謝謝熱心的分享!!
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u9011311
5#
發表於 2008-4-28 21:03:30 | 只看該作者
英雄惜英雄謝謝熱心的分享!!謝謝熱心的分享!!希望對我們這些初學者有幫助！
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tear086
6#
發表於 2008-5-11 16:45:35 | 只看該作者
谢谢楼主分享。…………………………………………………………

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sjhor -3 敷衍回覆！

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kevin
7#
發表於 2008-5-12 13:44:10 | 只看該作者
thank you for sharing this material

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參與人數 1Chipcoin -3 收起 理由
sjhor -3 敷衍回覆！

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usefun
8#
發表於 2008-5-13 14:55:17 | 只看該作者
好想看看 這個跟verilog的書有何差別 = =! @8 q( x) \+ c- }5 w
可是要用買的，
" s( d7 G7 d( [$ d9 R2 Q% _ 不知用怎麼用
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9#
發表於 2008-5-14 17:46:10 | 只看該作者
好東西 感謝大大的分享
4 p% O" g- F  @5 o+ K3 `, z  h靠人不如靠自己
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10#
發表於 2008-5-29 20:14:04 | 只看該作者
感謝你的分享# I& [" b. C  D! R+ E1 X! I8 H
感謝你的分享
$ E: S1 ?. A* y/ o/ q) Z0 ?6 M5 g/ eThank you for your share
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40506666
11#
發表於 2008-7-15 09:58:38 | 只看該作者
謝謝您的分享                                                    % V) j' Y0 }8 S9 u6 n- B
我正好在學習nios
  `. O% b, G8 s) q謝謝您了
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eliotj
12#
發表於 2008-8-18 09:05:05 | 只看該作者
Verilog新手7 w2 \) ?1 V/ ?  e
正\想學習verilog
9 l, d  ?; M  D6 W% h/ {感謝大大提供
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uncommon
13#
發表於 2008-10-10 18:15:02 | 只看該作者
基本的語法是我所需要的...$ l9 l: `1 g4 R# N  F$ N( \

4 j" h' P+ X& P0 k6 F' T, |看書看半天都沒有頭緒...
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qazjken
14#
發表於 2009-7-23 12:02:47 | 只看該作者
感謝大哥的分享 小弟我正在學習verlog 遮將對我有很大的幫助
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15#
發表於 2009-11-1 17:09:54 | 只看該作者
真是太感謝了~~這東西對我這個初學者~一定有莫大的幫助~
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16#
發表於 2010-1-6 09:59:06 | 只看該作者
非常不錯的資料！對於剛踏入這塊領域的新手，剛接觸 Verilog的人是一個很好的教材! 感謝分享！！！
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cch39
17#
發表於 2010-2-24 17:28:33 | 只看該作者
這種對Verilog的初學者來說真的是很棒的教材, 感謝分享
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k369
18#
發表於 2010-3-3 10:22:35 | 只看該作者
That is very good verilog data. thanks.
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19#
發表於 2010-4-28 16:30:48 | 只看該作者
我也是verilog新手, 有這麼方便的東西. Z8 R" e( _6 Q, F) F0 o
想當年數位邏輯設計的課都用麵包板都線路
+ ^4 l- p9 H+ W! B8 N$ B3 Y# A現在有這麼方便的東西真好
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20#
發表於 2010-9-29 01:32:23 | 只看該作者
哇哇～～正需要這個，新手中
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