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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › LVS BOX問題
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[問題求助] LVS BOX問題

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1#
發表於 2014-8-22 14:33:39 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問一下calibre 跑 lVS時，使用 LVS BOX LAYOUT "cell name1 cell name2" ，跑出來還是會有cell裡的錯誤。不知有何問題
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2#
 樓主| 發表於 2014-8-25 13:23:14 | 只看該作者
請問run LVS 跑Flat 時，可以使用LVS BOX嗎?

評分

參與人數 1Chipcoin +3 收起 理由
atitizz + 3 難得還有人願意來這提問?!

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3#
 樓主| 發表於 2014-8-27 17:59:41 | 只看該作者
我在書上有一說明"Statement applies only to source or layout SPICE databases"我不太瞭解這是什麼意思?"source or layout SPICE databases"不知是指什麼?
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4#
發表於 2014-9-2 10:09:36 | 只看該作者
期待有人可以解答！/ N( P2 ?+ I. O# v2 @
! v4 D7 F" B3 d, f- y8 w
期待了一段時間,繼續期待！
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5#
發表於 2014-9-3 21:33:05 | 只看該作者
回復 3# dan_chung_89
9 Y: Q( c% v) v' r& [$ p* T+ a% X% x' P; x9 ~" F* S) d
您好:
4 l2 D; ^0 y! O- i- G- R
/ N* a2 w0 Q4 I' N; X     Statement applies only to source or layout SPICE databases，  y. {; o8 |& D9 x7 K

, B& W" R$ Z) E* t0 B' {6 c   1.SOURCE 可能是指電路轉出來的NETLIST。
! d' M5 i: R3 y
7 e& {8 m6 z* i8 k6 ]0 T7 \    2.LAYOUT SPICE 可能是指RUL LVS 時會產生一個LAYOUT 的NET SPICE。( k! ?% n" {+ _% H/ C
+ D; L& Z# B( f, n/ z
    兩者都可以直接做LVS 參考用，只不過後者是很單純的NET SPICE 一般看不出來有電路的架構。
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6#
發表於 2014-9-3 21:36:43 | 只看該作者
您好:
, t3 P* j; v. @4 i6 m( T! T
, D; g1 l3 v3 t7 P! E     LVS BOX 我很少使用，所以沒有相關的經驗可以分享給你，/ {- j  F# {% N) v9 W+ k

, h, |1 x9 T+ d( {5 M: K至於LVS BOX能否RUN FLAT? 你自己試試不就知道了XD......
5 e! m4 [2 i3 I8 ~  Y5 N) u4 j8 J7 ]% ]
此外你的第一個問題有些有頭無尾，有些LAYOUT的問題其實不容易描述
& l+ D: |$ ^7 B6 y5 u: ~3 [/ K( {2 N& r$ d8 O
最簡單的方式就是當場去請教別人或討論，這樣比較容易得到解答。5 r# y6 K) Y; j. A0 |2 x
7 C8 j9 e' x) g2 S- e4 Q
以上是個人建議，希望對你有些幫助，謝謝。
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7#
 樓主| 發表於 2014-9-4 10:34:27 | 只看該作者
感謝你的回應!!
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8#
發表於 2014-9-4 17:36:04 | 只看該作者
您好:
0 x0 L* [1 Q) O% [- k- }& u6 h
+ E8 s$ X! t6 U: |1 n      我剛有試用了一下LVS BOX 情況如下:
+ R. `& g% v  l- \. T, t
. _! k/ k. |6 E- A& N1.當LVS BOX中的CELL ，若是出錯在與外部連接的PIN上，則即使是使用LVS BOX 避開該CELL，7 }, d" l* B& k/ W! W$ D& |! ^. g: w
   依舊會出現LVS 的錯誤，原因因該是連線出問題。/ N9 G- W$ V5 F' d7 A. `. Q3 b
' o: s* Q- z3 ^9 U' q  s& L1 |
2.當LVS BOX中的CELL ，若是出錯在與內部的連線上，使用LVS BOX 避開該CELL時，RUN LVS % [6 l1 r# ]6 w4 t
   時則不會出現LVS的錯誤。
7 @% z8 T5 {9 |" b6 m
: I/ w- o. n, B: M# t以上提供你參考。
  m6 R! W+ K2 B. b. t+ N
- u/ T4 {7 a4 ^! F2 D4 {明天再試試能否做FLAT XD...
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9#
發表於 2014-9-5 08:19:15 | 只看該作者
您好:! e% F4 n+ P5 ^: f7 `
% `! ~! U" g9 h! ^# t0 ~: W1 n
    經測試 LVS BOX RUN FLAT 情況如下:
1 K- b5 @: U7 ]9 x6 X" M% c- M- r0 W# O
1.若是BOX中的CELL外部出pin short 的情況下，則run flat lvs會產生錯誤。/ p: X6 R+ ], B

3 U- |! y4 x4 ]7 G" {8 a# j2.若是BOX中的CELL內部接線 short的情況下，run flat lvs亦會產生錯誤，在report中會
+ s9 `/ j" d" ?6 `' D3 @1 o: O   標示出該cell中有多少個錯誤。4 P3 c7 @. d6 J3 v# e. R
- w/ [1 d. s9 v6 ]

) ^: |: C5 `# V" c, N以上，希望對你有幫助，謝謝。
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10#
發表於 2014-9-5 08:44:36 | 只看該作者
我突然發現我觀念似呼有很大的錯誤！/ w/ G  C9 l" r0 Y& u* {9 T

8 ~: U" O# P& L7 h$ M我以為
9 @* m: r+ Q9 U; w8 z' I& RLVS BOX 的作用是假設CELL＿A已經完成！而其實不存在！
* t7 }$ o% r* D  b6 M只是想驗證CELL＿A以外的所有CELL是否連線正確無誤！
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11#
發表於 2014-9-5 09:12:27 | 只看該作者
to bowbow99:& r3 W, N" q. E* {: T' S0 E# l

; X5 x# B! V3 \9 B' c0 z; \       我猜netlist的編寫也有關係!因為我的netlist中並沒有將cell_a的netlist exclude，
) P  T& Q; D9 q4 a5 B, [3 w0 B+ Q1 g/ L( p) }8 }
有空時我再來試試若exclude cell_a 的netlist，再來run lvs box 會不會有其它結果。
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12#
發表於 2014-9-5 09:36:33 | 只看該作者
您好:
" G9 K) R" g9 Y2 h1 |' U  ]
0 |1 d' y* y9 ~' o% {/ r6 n    剛將cell_a的netlist刪除後，run lvs 中途即發生錯誤，這點就等有經驗的
. }5 a8 Y; P" H' k! k. R) R8 h* f0 B  s9 e2 Q: T6 U$ {# N
人來分享吧，謝謝。
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