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! R" \8 X* z% c# w│  └─docs
  A9 M( T/ J' r' W│          DDI0337G_cortex_m3_r2p0_trm.pdf
: I# X7 T# l% u  F' D$ B# I│         
; w, [" f# ~& Q, B5 ?* m├─AT420-DC-02008-r2p0-00rel0
│  └─docs
" _( D) q9 Z9 K* C1 A│          DII0194A_cortex_m3_r2p0_csg.pdf
│         
├─AT420-DC-13001-r2p0-00rel0
) x0 ~7 q7 j( G3 h1 O2 K│  └─docs
) x9 j; R5 N, [2 z3 P) e0 I
│  │  │          CM3CodeMux.v
) I- u9 P$ y# `4 w0 X9 n- e│  │  │          CM3flashmux.v
│  │  │          CM3ROMTable.v
3 M! m0 M* k0 Q- Z. q3 j" |│  │  │          CortexM3Integration.v
$ u7 X. m) }4 {" i│  │  │         
1 s! J# h8 i6 [5 \/ x│  │  ├─dapswjdp
│  │  │  │  README_DAPSWJDP
! z% W4 f4 Q3 _  I: x& H: I4 B: ]3 e│  │  │  │  
│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
7 N3 F5 |! E* c& a6 f│  │  │          DAPDpApbIfClamp.v
6 {3 u: k8 t4 f# W) u3 S1 q9 Z  ~8 O( |│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
" k  B. H9 Q* E, M, o$ i│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
/ e8 V/ c/ _  f9 O. j) p* D9 T9 P│  │  │          DAPJtagDpDefs.v
│  │  │          DAPJtagDpProtocol.v
│  │  │          DAPSwDpApbIf.v
" k- ~' p9 `8 J! z: X. ]: Z7 V│  │  │          DAPSwDpDefs.v
, l. E: e+ q/ D# e  v, ~│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
7 M" d0 w- h* r+ d) w; q5 s* V+ [6 C│  │  │          DAPSWJDP.v
│  │  │          DAPSwjDpDefs.v
│  │  │          DAPSwjWatcher.v
3 @, d8 Y) H) _5 }0 L7 N  Z  F; x' k# M' @│  │  │         
│  │  ├─models
' O) P: |+ s/ f8 @* r│  │  │  └─cells
│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
: G+ a- O3 P6 W1 A/ Y) `4 x9 C$ ]+ Z+ ]3 \│  │  │          CM3Sync.v
│  │  │         
│  │  └─tbench
2 D* Q7 E+ t) L. \$ J│  │      └─verilog
+ k7 w* y* W7 i0 R- {│  │              AhbToApb.v
│  │              AtbLogger.v
2 _; d" C' Z* `$ U  z1 H& Y& ]- a# ?│  │              BusMatrix.v
5 D  I2 M" X+ o( h; g6 l│  │              ClkReset.v
0 ~* W1 i; Q' @  \6 \│  │              CM3BusComparator.v
! w+ \; \& Y6 b

5 ~8 b; [6 B+ |% u' e│      │  │  exclude_list.sc_waitstate

             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
% W! z. j: m# G: S             │      │  
             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
: T+ w& L4 f7 ~. M8 {4 d# r             │              cells_1.geo
             │              cells_1.pwr
4 S: H0 x- v2 ?$ P* @+ `             │              index.cli
) I' s, S7 n. N1 }" @             │              README.TXT
             │              rulesets
7 F6 r0 O/ d$ w+ A: G& |8 r             │              VERSION.TXT
             │              vias_1.geo
' R/ v' R! v8 U9 q" w             │              
$ Y/ r% W# }! B# E1 l% {             └─tsmc
                 └─t-n90-lo-sp-002-f1_1_6a_20060914
: P" [- M6 U0 L6 L; k' r                     └─6X2Z
- ?5 L0 T9 g: R/ [  X7 Z                             corner.defs

├─integration_kit
  |! D4 U1 p  w- y; ^│  ├─logical
7 L6 z' d8 D5 a( b& f+ m│  │  ├─cm0ikmcu
│  │  │  └─verilog
) s3 q3 {6 ?4 r: ?. S│  │  └─tbench
, ~( ~# f  x+ s. s- J│  │      └─verilog
│  └─validation
( {1 K* |; [2 R$ G% ^│      ├─glogs
│      ├─logs
' h* h8 q4 y- y! m│      ├─mdk
0 P! Y9 ~! C0 H, X│      ├─srpg
! O  F: b4 v& |) s. Z5 E│      ├─tests
│      │  └─CMSIS
│      │      └─Core
7 G" y. p, A% r& f' N( v3 n- D│      │          ├─CM0
- ?/ i5 I) Q: T* Y/ w5 x! e│      │          └─Documentation
│      └─vectors
2 e' `% L3 l! z/ t% F( w├─ipxact
: K+ b: h/ e5 S4 ?│  ├─busdefs
│  │  ├─amba.com
│  │  │  └─AMBA3
│  │  └─arm.com
│  │      ├─CoreSight
│  │      ├─Cortex-M0
│  │      └─CortexMCores
% R* z8 h  K6 m7 z- {│  ├─channels
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; \7 R/ V: O" r3 H/ j│  └─components
7 }0 x3 s% r6 ~* n/ T/ B  w: M& l* f│      └─arm.com
│          └─Cortex-M0

yukitsu

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