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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Analog/RFIC討論區 › 電路沒用到的輸出端問題
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[問題求助] 電路沒用到的輸出端問題

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e2000
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1#
發表於 2010-1-24 02:12:18 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
小弟目前在畫LAOUT時有個問題想請教一下各位前輩  \/ ?7 Z5 p! Q' W
假設說比較器有兩個輸出端，Vout+與Vout-兩端
7 O8 J% I7 @9 \3 l! B- \但我只需要用到Vout-而不需要用到Vout+, a$ `/ O7 O' {# o7 v- m
那我畫layout的Schematic偵錯時那些沒有用到的Vout+的腳全都會成為Waring$ [- }2 |" q4 L& [
這些接腳我該怎麼去處理呢?有前輩願意告訴我嗎?感激不盡
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z753951
2#
發表於 2010-6-11 21:15:10 | 只看該作者
你從Schematic把他砍掉就可以了~只留你想要的接腳~
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3#
發表於 2010-6-20 13:17:47 | 只看該作者
很好奇!!  R) w3 C% F: X( s% r& j
  G1 S- \* b0 k- t; r& M" S
layout是根據你的電路圖而畫的~
- E4 }3 v' }5 f; Q& D5 w
6 X6 w3 p, x3 s那既然電路上有~而你layout卻不要有...9 C( E4 S. Q1 r1 w( X- J. G- F
) J8 S- O  V  X2 W. h( S
那當初幹麻要勒?!
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suewe
4#
發表於 2010-6-29 17:08:55 | 只看該作者
在cadence environment 系統，在library basic/有一種noConn元件，把它接到schematic 上空接的pin，就不會有warning出現了。
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e2000
5#
 樓主| 發表於 2010-7-4 03:39:48 | 只看該作者
其實是因為電路是全差動的，所以輸出有兩個端點
' W9 M5 \* F0 X1 p$ ]1 f不過我只需要用到其中一個點就可以了，所以另一個點我在想電路要怎麼去處理他  [5 v! g, C& u
結果我沒去理他，只打個輸出也沒管他了，錯誤也解決了XD9 W$ ^0 N6 i; s' g2 P
我傻了...
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