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[問題求助] 請問有誰知道什麼叫做ADC driver

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1#
發表於 2007-6-14 18:53:59 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
Dear all:
1 R1 S8 O1 n4 j# L: _# J% h            請問有誰知道什麼叫做ADC driver 應用在哪裡?+ l  k5 C/ C3 P6 b
7 s$ f' x( c( p( O
  thanks.

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2#
發表於 2007-6-14 21:46:01 | 只看該作者
是不是只  ADC 前面的 pre-driver?( e$ @) w  N$ R! d
若是! 這個 op buffer 的設計是有一點的困難度唷!!
3#
 樓主| 發表於 2007-6-15 12:47:43 | 只看該作者
嗯  就是那ㄧ個....  C2 d/ z6 M+ d+ i3 j
我是想問這一個 driver 是做什麼用的  ?: P- P1 ~5 W6 H' b, \
為什麼需要這一個driver ?
6 e* B: F+ v7 H3 _+ X: q/ f
4 g; ?& b# J+ P1 r/ dthanks .
4#
發表於 2007-6-15 14:14:35 | 只看該作者

回復 #1 super 的帖子

ADC前面加一個負回授的OP 其中一個功能是可以拿來調gain的大小 把輸入信號的電壓放大到與ADC的 ! ]4 L9 }3 j/ i4 f1 ]) h. Y
輸入電壓範圍一樣
3 k3 O, |9 [+ E! Y# QADC通常是電壓輸入 有的driver可以把電流信號轉成電壓信號   看你OP怎麼接
3 K! c" u' s/ ~. {另外有的driver也可以把單端輸入轉成差動輸入

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5#
發表於 2007-6-15 17:39:26 | 只看該作者

回復 #3 super 的帖子

大部分的理由同 "Monkeybad" 大大的說明!& j7 ^7 ~+ I6 Z9 N6 X# w2 l+ a/ z
還有其他的理由如下:
2 |+ f- o7 Z  S8 |, ?. W. S* W9 T# J. r前一級的 driver 能力無法推動這個ADC! 像似 FLASH type ADC 他的內部電阻非常的小!  所以前一級的信號一定推不動! 這時候就需要需要 driver!!

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6#
 樓主| 發表於 2007-6-20 17:19:04 | 只看該作者
所以 只是單純的將前一級放大的ADC input輸入電壓範圍一樣2 B3 ]! j$ f; W: c  b: i+ y3 w
     這也是因為 full-scale的問題嗎 ?9 K2 K' ?  P- o& d% Q) x3 Y* r
2 S' r' A) C8 _
thanks.
7#
發表於 2007-6-20 19:05:01 | 只看該作者

回復 #6 super 的帖子

恩恩 這只是其中一個原因
* B7 F2 b# F- a因為信號在傳遞過程中 還要考慮如何推動下一級負載的問題 所以會加一個buffer來增加推動能力
/ F9 s& z: F# z) ^另外有的還會在前面加個電阻電容的低通濾波器 來過濾掉高頻雜訊
5 Q5 {4 s0 C* y! \- N7 P如果想要了解更詳細的話 建議上網去找有關ADC的Datasheet 裡面通常都會有說明
# ^1 [" O/ L: Z" f: J' @+ J5 F還有附OP電路圖

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super + 3 感謝啦!

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8#
發表於 2007-7-17 11:56:48 | 只看該作者
請問buffer需要多大的driver能力才算足夠呢?設計時要注意OP的PSRR嗎?

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9#
發表於 2007-7-17 12:21:08 | 只看該作者

回復 #8 neterlin 的帖子

所謂的 Buffer 就是其 Driver 能力較強!  較不會失真!!  哈哈  這是個廢話!!2 `6 A7 [7 y3 @" n# v) R  Z9 L' @
那到底需要多少的 Driver 能力才夠唷!!
7 L  D2 {0 x, E; P- x3 W" @7 C這個嘛!!  沒有人會知道!! 除非設計者自己!!   因為這個要看你使用的 device 其 R load & C load 或者是其他的 Loading 而決定!!
! [2 o9 w7 y) @$ C3 [( c2 u- |" P所以  沒人知道你的 driver 能力夠不夠?  所以要看你挑的 device 情況唷!!7 G7 U' Y8 v/ g3 O4 _: Z0 j

* n" s, U8 X! j# y. r$ S至於 PSRR 也要看你的 power 規格  才知道是否需要特別注意唷!!

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10#
發表於 2007-7-25 22:16:27 | 只看該作者

回復 #3 super 的帖子

也有阻抗轉換的功能,或是位準轉換及Gain設定的功能
# ~) ?0 f4 v+ C, X; }5 N* Z還有single-end, differential轉換等
% M/ P, B. v1 ]4 i( O" D( z或是Bipoar,Unipolar轉換
* @9 Q8 i8 T2 E7 P: K都有可能

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11#
發表於 2007-7-29 23:39:03 | 只看該作者
感謝該文的發文者及回答的大大,
% Q+ X& z! }# M' I) B剛好最近的工作有一些地方與此有些關連,
- \2 V% U+ A5 V5 o5 i" M# z也是我搞混的地方,
" `1 W' A( V  Y* h2 i. G( [謝謝各位!
12#
發表於 2007-7-30 11:30:09 | 只看該作者

類比數位轉換器中的輸入採樣結構[轉載自EETimes]

原文出處:
9 V" f# i& O" Z- O5 y2 x7 Uhttp://www.eettaiwan.com/ART_8800473676_617739_TA_aad2b2a3.HTM$ X8 x6 C+ O" o, [

2 M5 U/ E; [- q  }5 o% u類比系統設計人員正面臨許多設計挑戰。他們不僅要選擇合適的元件,還必須準確地預測這些元件在系統內的相互影響。其中,類比數位(A/D)轉換器的設計相當困難,因為必須在系統級考慮各種不同的輸入採樣結構,並做出正確選擇。本文將探討幾種通用的輸入採樣結構,並討論每種結構對系統其他部份的影響。  
* v3 R, Y- n* b+ n+ p+ [8 W# ~
5 E7 F* `  I- s在目前使用的眾多CMOS A/D轉換器中,一種常用解決方案是使用開關電容結構實現輸入採樣。在這種最基本的結構中,輸入部份由體積相對較小的電容和類比開關組成,如圖1所示。  2 \5 s4 p) {9 U* I" }+ S

( b) E/ [* q# G4 q當開關設在位置1時,採樣電容被充電至採樣節點的電壓(在此例中為VS)。然後,開關切換至位置2,此時採樣電容上累積的電荷被轉移至採樣電路的其他部份。這一過程不斷反覆。  
7 C- n2 X7 d8 \# p4 P
( s& i. G- |1 e- ~上述這種不帶緩衝器的開關電容輸入會引起嚴重的系統級問題。例如,將採樣電容充電到適當電壓所需的電流,必須由連接到A/D轉換器輸入端的外部電路提供。當電容切換到採樣節點(圖1中的開關位置1)時,需要大電流對電容進行充電。這一瞬態電流的大小是採樣電容值、電容開關頻率和採樣節點電壓的函數。  
) J6 v& L/ I% |1 p- F' `2 `0 {
8 ]) t, C1 z% u這個開關電流由下式表示:
* m* Q. F; @5 V4 {, s4 r2 X
2 g  K9 _% l+ M& r9 RIin=CVf , Y4 \: N$ a+ Y" d, D  W

2 X9 i( _  v$ l% z( G7 P8 P: z其中,C為採樣電容的電容值,V為採樣節點上的電壓(此例中為VS),而f為採樣開關的開關作業頻率。這個開關電流會在採樣節點產生較高的電流峰值(如圖1所示)。 $ r8 R, Y# }* @+ N  R( g/ [
3 ^) y! \5 D8 P$ o; B8 W6 F
圖1:簡單的開關電容輸入結構。   u( ]$ Z$ Y( {" H& N

' |5 Z$ r1 O4 J. T設計A/D轉換器的前端類比電路時,必須考慮這一開關電流的影響。當該電流流經任何電阻時,都會產生壓降,在A/D轉換器的採樣節點處產生電壓誤差。如果轉換器的輸入端連接高阻抗感測器或高阻抗濾波器,那麼誤差將變得很大。例如,假設A/D轉換器的前端採用電阻來隔離感測器並改善靜電放電(ESD)保護功能,如圖2所示。 7 c5 ?7 r# A7 A0 n  B. ?$ S

$ x6 o, K2 N& g; ?圖2:帶串聯電阻的無緩衝開關電容輸入。

# Q' Z" f1 Q/ n0 z: d; x2 S2 Z9 ?此例中採樣電容為10pF,開關頻率為1MHz。根據上式,瞬態電流約為25?A。當這個瞬態電流通過10kΩ電阻時,採樣節點上將會產生250mV的電壓誤差。由於採樣點可能在下一個採樣週期之前達到穩定,因此這是最差情況下的估算值。設立時間取決於10kΩ電阻器和採樣電容以及A/D轉換器輸入端的寄生電容所構成的RC時間常數。寄生電容源於A/D轉換器導線、電路板走線長度以及內部MOS開關電容。此外,可能需要外部緩衝器電路提供必須的電流,並確保採樣點得到正確設置以保持線性。然而,在更高開關頻率下,放大器輸出阻抗會增大。因此必須仔細選擇放大器和相關電路才能解決瞬態開關電流問題。  + P& t3 s& O2 p4 \4 [2 |5 K5 I
' q7 X7 z) x5 v8 K& C" w
為盡可能減少外部電路的瞬態電流要求,可以採用如圖3所示的內部緩衝器。 , r& Z& f+ r, |  E/ N

4 ?' j3 z0 D) u圖3:帶緩衝的開關電容輸入。
$ S) e1 x+ l8 @; S( I2 M
在此例中,類比開關可組合成三種不同的狀態。在位置1處,採樣電容被快速充電至採樣節點電壓(VS)加上(或減去)緩衝器電壓偏差(VOS)。在此階段,電容充電所需的瞬態電流由內部緩衝器電路提供。最佳化內部緩衝器設計可在所要求的開關頻率下提供低輸出阻抗,以便在指定時間內為電容正確地充電。然後,重新配置開關,使其連接圖3的位置2處。此階段採樣電容直接連接到A/D轉換器的採樣節點。接著,採樣電容被充電或放電,以便使電容電壓與採樣節點電壓相等。這時可能仍然存在少量開關電流,但所需的外部電路電流較小,因為電容電壓已經被充電至內部緩衝器的偏置電壓範圍內。  1 b: g7 b+ x; R8 n( y4 T2 U4 n
, W/ [) g& {7 T% K6 C& n: I# [
最後,類比開關切換至位置3,將採樣後的電壓傳送至採樣電路的其餘部份。帶緩衝的開關電容輸入結構優點,是能夠大幅減少對A/D轉換器外部電路所需提供的瞬態電流。上述例子中採樣電容為10pF,開關頻率為1MHz。假設內部緩衝器電壓偏置為10mV,產生的瞬態電流僅100nA,比不帶緩衝的採樣輸入瞬態電流小250倍。  
5 z- w- \6 z, t8 v& X* K! p- K/ S5 h3 P8 J
有些情況下,可將一個固定或可編程增益放大器整合在A/D轉換器前端的元件中。整合的放大器不僅有助於減少必須由外部電路提供的開關電流,而且還能對類比訊號進行放大。. ^- t0 R8 Y5 m

6 v' |" n- d( A) b+ y+ d此外,還可採用一個斬波穩定放大器(Chopper Op Amp)來減少1/f噪音,即所謂的‘閃爍噪音 flicker noise’。這種低頻噪音是生產製程固有的MOS電晶體通道表面狀態引起的。斬波可以消除1/f噪音,並減少外部電流要求。然而,由於MOS開關的不匹配,電路中仍將存在少量輸入瞬態電流。  無論是何種採樣結構,A/D轉換器都必須採取ESD保護。對於CMOS方案來說,通常採用鉗位二極體提供ESD保護,如圖4所示。 ' [) c* _% b5 L. Q5 y
7 ]9 M+ ]- j( V) }  h$ ?+ d
0 @2 I( @: E0 z; X9 F* ^$ g7 c. L, a
圖4:CMOS ESD保護。

: t) s* |+ T. k5 ?1 l3 d( G. Y$ ~2 x鉗位二極體可有效限制加在轉換器內部電晶體上的電壓。如果輸入電壓與電源軌的差值超過二極體壓降(通常為0.7V),則二極體將導通,以限制電壓。但鉗位二極體同樣會出現電流泄漏,在設計類比輸入電路時必須考慮這個問題。儘管這一泄漏電流通常較小,也許只有幾皮安,但該電流會隨著溫度升高而大幅增加。
! V$ I5 Q# y$ r
3 H! V4 e" Q* z9 N8 b6 t本文小結 . i$ M% d& k& T" C
- m; b5 }5 s" Q- v1 M% O( I2 K
隨著A/D轉換器的不斷發展,系統設計人員充分瞭解所採用的輸入結構及這種結構對外部電路的影響將變得越來越重要。本文討論了一種簡單的開關電容輸入結構。開關電流要求會對系統的整體性能產生巨大影響,因此必須合理設計外部電路。整合的緩衝器或放大器可大幅減少開關電流,簡化A/D轉換器外部電路設計。ESD保護電路也會影響外部電流要求,且其影響隨溫度會有很大的變化。  
0 V  f; @9 _, f; N5 [# e* n' V+ Y$ z. a6 M8 d# g( J6 _. f$ f
作者:Kevin Tretter % J0 E/ L/ M. K4 c2 w, l( {! `% Y
資深產品市場行銷工程師
% P, O) _9 V6 ]6 H類比和介面產品事業部 7 m2 Q$ L4 t# i( H9 H  n
Microchip Technology- O/ J: T/ U- W) Z
( Q- f2 ?8 \! p5 ?' x
[ 本帖最後由 DennyT 於 2007-7-30 11:42 AM 編輯 ]

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13#
發表於 2007-11-28 00:56:14 | 只看該作者
真是感謝大大的分享~現在正專研類比領域,不解ADC的詳細原理,正好看到這些資料,受益無窮啊~~~
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