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[問題求助] 請問要使用何種EDA Tool (Verilog新手)

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1#
發表於 2007-7-26 18:48:58 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
用Verilog描述出的DSP processor,有tool可以把code轉換成Datapath或元件結構圖嗎?
% s( j) T4 E- C8 D3 v' K2 Y很抱歉!剛自學Verilog,所以對tool和功能不是很了解。
: r- w5 X2 U  T) R7 _ModelSim or A-HDL此類的軟體可以做到嗎?: [1 l4 B2 n) H5 d
另外,有沒有可以觀摩DSP Processor的資源呢?
9 L7 K9 G2 s0 }3 i) O- t9 Y例如www.opencores.org
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2#
發表於 2007-7-29 19:36:53 | 只看該作者
dubussy* s6 H1 ?% c& f' {( @
ISE
4 U; |$ v8 o! q- @0 U9 i0 F8 sDC) [3 K* l1 F0 d: j) p( ^
這三套你試試

評分

參與人數 1 +5 收起 理由
day766 + 5 非常感謝

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3#
發表於 2007-8-3 16:54:01 | 只看該作者
只用过debussy/ `0 q! ?* M( C+ \+ F% V+ a6 }
另外两个没有用过,我也是个新手
7 [+ I$ P; D$ l  \  U刚刚入门,希望前辈们多多教导
4#
發表於 2007-8-6 13:46:10 | 只看該作者
大家多多交流多分享吧
5#
 樓主| 發表於 2007-8-8 19:29:04 | 只看該作者
最近對學校的系統漸漸了解了,所以用Design Vision或是DVE (聽說是Design Vision的新版)這兩套軟體。只要在元件上點選Schematic View,就可以看到block diagram了。
6#
發表於 2007-8-22 11:41:41 | 只看該作者

回復 #1 day766 的帖子

你可以找一下 xilinx "System Generator for DSP"6 g) E  `0 x+ E: D* u7 [
這套軟體是架在mathlab 下面,可將你的dsp演算轉換成verilog or VHDL code 然後再將產生的code 加入當成ip ,連一連就可以用了,只試過demo板,還不錯用
7#
發表於 2007-8-22 11:47:30 | 只看該作者
沒錯 這套軟體蠻好用的
; r3 t! |  d4 t% Y, Q
" A2 p1 o  {8 O; b7 Y/ k號稱不用做 HDL coding7 l8 x( D* r( a1 L5 K

2 \* N. v0 v% S6 T但是只能用在 Xilinx FPGA 無法做成ASIC
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