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[問題求助] arm an119

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1#
發表於 2007-5-29 13:55:31 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問有人有做過這個lLab嗎?
1 ^7 A9 E: r) t) t8 n
4 r4 b/ b6 h8 R1 Z& R這個範例有附bit的燒錄檔,也有verilog code4 o$ m( P" `2 J0 b$ q6 F# C0 x
' x4 s* p" |9 u. B! Z' D
使用燒錄檔當然是可以正常的運作,可是從她給的code我自己重新合成卻錯誤百出,也沒辦法弄成燒錄檔6 o! d1 U' K: z8 Q0 {1 z5 e* f

- q0 F: m: y( s3 n- L不知道是否是自己哪邊出錯了,懇請大大幫我合看看,如果確定可以,煩請救ㄧ下. m' y+ O& i# q5 ]
* r" ]. {  V# `
family:vertex2 device:xc2v6000 package:1517
3 @( F* T3 r/ P7 j* o& O- ]: D. c9 X) b
code:common內的所有檔案+integrator-AHBArbiter.v-AHBExampleMaster.v-AHBMuxM2S.v
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2#
發表於 2007-5-31 14:54:45 | 只看該作者
application note 119 的用法, 請查閱目錄下doc的pdf檔AN119_Implementing_AHB_Peripherals_in_Logic_Tiles.pdf" r  h- k# Y* e. ?$ x, L) _
特別是page 34起這幾頁3 F- s+ F8 ~2 _' `0 e: U
2 h7 ^" l" {. x% ~
才46頁的文件不該沒自己去作工夫K一下的) p, f. v2 ]. y# ]6 E' {
4 C- R7 G+ S/ f% [$ a! s& q
這個範例提供了5個example, 分別是 logic目錄下的
: R: d3 m* t6 [. s(1) coremodule_fpga
9 Q' Q/ `3 [5 p6 g# n+ r! k(2) integrator_fpga# M, \* v2 H: C
(3) master_coremodule_fpga! l7 \- y+ U  [5 _
(4) master_integrator_fpga/ [: ~; s0 C+ k$ z/ A: c! x% `" x" [
(5) master_pb926ejs_fpga
& G; Y) r1 L3 D4 O" R其中1跟2是在CM或Integrator上作AHB slave設計的範例 (在這裡 common裡部份跟master有關的HDL code會用不上,像AHBArbiter.v)2 T8 D6 k9 Z) W/ ]# m
3,4,5是在CM, integrator或PB上作AHB slave + master設計的範例
0 A7 G6 {- l+ j- C! L; v8 `/ x- p7 m$ B6 I1 U- ^/ V% N' a
使用時, 要把這些目錄下的檔案, 聯同 common目錄下的HDL code一起建成project去implement0 x5 i* |9 x! v; b
這樣去compile出bit檔來下載
8 ~; V) A2 F4 w/ p
, P! v  c- x( H5 M' L, |& vpin assign檔在physical/下面的script目錄下, 每個範例都有提供對應的ucf檔, P6 A" m) s; V" _6 }& ^/ n

& t2 w7 n+ O- B% \這一關參考設計能run過後才來談修改成自己的設計  y, _# G! w" ]
; s; |& [, M. Y" K1 r( V1 b( z
建議你自己養成k文件的習慣, 還有加強ISE的使用能力

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