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[問題求助] cmos製程layout BJT的問題

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1#
發表於 2008-6-5 09:51:10 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問一下8 J: I+ H* f7 V7 b( ?# V$ ]
我是用台積.35cmos製程要畫vertical bjt (pnp5)# w; t  {& _% `* |. v5 g
現在DRC已經過了,但lvs卻有點小問題: U. `8 ~, y$ J- f+ ~0 ~
因為我在hspice跑的時候是設m=20,所以是用5*4的array
8 P, k9 @* ~0 A2 z2 |+ x但是我在netlist檔裡不管m=10或15或20都會過
" Q! z# c  g  T; T請問有關係嗎?: E6 c6 z2 |$ U+ e/ V8 C1 j) a
還有在netlist檔裡是不是要把pnp5改成pv% E+ N* \' M" T7 p/ L
lvs才會認出那是bjt
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2#
發表於 2008-6-6 12:12:17 | 只看該作者
你的問題推測有下面幾點可能' n( G  ^9 N# z
/ [1 @) Q, r! U, Y+ X* R1 h
1.lvs command file 沒有定義check BJT的area
2 s6 q! O( x) R1 J- V2.你的subtype(pnp5)跟lvs command file定義的BJT subtype不一樣,1 `" A+ D$ X3 ^0 Z' A
   sebtype unmatch所以area還沒有check,不過你又說都會過?7 ^/ o- K, r+ x% b0 g
   那應該就不是這個問題。
- b, D8 f$ \7 p3 \* `3.pv 是lvs command 定義BJT的名字嗎?如果是,那你pnp5的確必須改成pv
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