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[問題求助] 請問一下,layout的方式

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1#
發表於 2008-12-26 12:07:01 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
小弟前陣子換了家公司,發覺所有的layout觀念都變得不同了
1 o3 k8 L- s7 Q' O; T4 B8 D) U像現在的要求就是你面積要夠小,然後拉線的感覺就是只要拉對 lvs 過就好
# L: _! C- {6 T' K3 U( [5 Zmos上面,可以直接飛越過去,不管是類比及數位的,像這樣子的layout方式
4 x/ ~3 n$ K% L. i! p對於電路的特性那些會受到影響嗎???.5 .18的製程
3 d/ ^) R) }3 J& q
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2#
發表於 2008-12-26 12:49:40 | 只看該作者
你那是针对Memory的Layout吧,Analog的话性能还是比较注重的!
3#
 樓主| 發表於 2008-12-26 13:46:13 | 只看該作者
沒有呢,我畫過的adc及osc也是這樣子
4#
發表於 2008-12-29 09:24:08 | 只看該作者
不管是黑貓白貓
1 ^6 v( [4 u' k- n 會抓老鼠就是好貓
' h% @) ^$ q1 e3 k8 [4 A; w4 K不管值拉橫拉3 n! N- R. O* Q
能 work 就是好layout
5#
發表於 2008-12-29 17:32:41 | 只看該作者
要留意一些比較noisy 的signal / power是不是走過一些較脆弱的analog block上; J7 |, }* w5 O% p$ `
隨便畫的話,analog有問題的話便很難debug和驗證了
: v  N3 ?9 ~/ G9 E$ s畫layout前最好問清楚designer那一些signal是雖要特別的shielding功夫
6#
 樓主| 發表於 2008-12-30 11:27:45 | 只看該作者
我的上司,只要求最小,不要浪費空間,只要小不浪費空間% k* y. y, V; q1 w0 i9 T" N4 P- p' K
mos上面,我看過滿多前輩畫的,都是跑滿線的!!!
; E" K2 ?* D7 U* s& b所以現在我越做越迷思了,像這樣子的話,是不是就不用考慮到電路的效果了??( B' B% k4 J8 ^$ X4 f7 ]
只要mos該match的有到,其他拉線跑線的話,拉對就好???& d% ~& X5 ?8 ?7 ^9 p' B2 S
如果是這樣子的話,那年資就有用嗎??
0 y0 i' b# a/ P
0 f( _8 h' o- i) P! Q( L[ 本帖最後由 ynru12 於 2008-12-30 11:30 AM 編輯 ]
7#
發表於 2008-12-30 16:04:24 | 只看該作者
我想是不同公司有不同的要求,可能它們的設計要求不太嚴謹9 ]" f1 t+ D" d( `$ x
如果他們只要LVS match,那麼年資和學歷也不重要了...
4 m5 r: r8 Y( Z2 m( p請問貴公司是做什麼產品呢?
8#
發表於 2008-12-30 16:16:32 | 只看該作者
原帖由 motofatfat 於 2008-12-29 09:24 AM 發表
, d% b  S  y: w: @不管是黑貓白貓$ n$ x6 F& r, q) ^) w- S% g
會抓老鼠就是好貓5 Q; _. {9 w; N$ x: Q; U1 x; ?9 e% M
不管值拉橫拉1 a: W% A; W' Z' D% H/ \
能 work 就是好layout
. l  b2 w7 ?- ?& B' @9 n) P

7 Q1 c/ }- r# i4 T/ A! A; c$ J我上個主管也這麼說過呢 ; D: E* @8 x9 R% I9 E6 r( d% z" q
所以儘管當初我畫的不夠好
9 k* m5 u0 j7 _& f2 Q5 u: f8 f* ^他說能賺錢就是good job
9#
 樓主| 發表於 2008-12-30 16:57:37 | 只看該作者
如果只要可以工作的話1 ?" B$ x$ J# d0 j7 W/ Z
但是效果很差,這樣子也算是好嗎??
. V% d, L0 n9 {公司做的東西滿多的,有一些產品的控制* z4 }% O3 C2 w4 [# P" z
製程大約在.5~.18之間
10#
發表於 2008-12-30 18:40:45 | 只看該作者

回復 8# 的帖子

這樣我相信'賺錢'只可以維持短時間... 長遠來說, 對公司一點的益處都沒有
11#
 樓主| 發表於 2008-12-31 00:28:30 | 只看該作者

回復 7# 的帖子

是滿廣大的,有影響、音效、鍵盤、會跳舞的狗、微波爐內部的某塊
12#
發表於 2009-1-3 12:51:09 | 只看該作者
MOS上能不能跨線
( Z* d- T, ~% S! ?1 @4 G
' _  [# m' @8 Q2 ?目前以我目前所知的~~是依製程跟產品上來
2 n6 n. m" |) ^) _5 r9 ?% ^
% U; H% |1 o% Q& X' p) y  @# G- ?做區別~~一般高頻系列的產品對於MOS的特# L1 @; d4 [. |3 W: E- r$ t

- j2 l+ u4 t+ i性比較要求~所以除了MOS MATCH之外也會
% _* q! H. _# |! E4 Y; Z8 W6 h0 i5 m" H7 Y
對連線上做出一定的規範,低頻的產品就沒那% K$ |- C, M* t; d& h
+ m# v' P* m6 |6 L
麼考究了
13#
發表於 2009-6-19 16:12:46 | 只看該作者
這問題我也碰過) V' v5 |$ x, b8 e) r! T
看主管想法
; v/ j* d- U$ |3 e7 D也些會考慮很多製程特性一堆問題
1 ]) ?' {0 q9 n3 a有些就你只要在時間內畫好管你畫的怎樣% q. _9 d7 [8 _( H. ]
只要LVS過就OK
% |' _7 ~1 a( e" v( N" h$ ~所以我也看過很多離譜畫法
14#
發表於 2009-6-20 00:59:05 | 只看該作者
我看前輩lay的很多也都蠻神奇的
7 K, n8 s4 v# B8 c. P  Y. n/ @MOS方向不同、沒guardring、或者guardring沒接power
0 p/ K0 {9 p2 Z' a% ?, v3 p  u...via越多越好,結果也都只打一顆,整個block就是亂...
6 @* [: L! v0 C但是...能work
15#
發表於 2010-5-21 11:59:41 | 只看該作者
能work就是好芯片,哈哈
16#
發表於 2010-5-21 18:58:50 | 只看該作者
話說....3 A) d4 o1 v# C& o$ n+ ]$ d
曾經有人看過某家公司的layout
- Q8 v" I3 }( D0 N# t  K就決定不會買使用那家晶片的產品了
17#
發表於 2010-5-24 11:16:50 | 只看該作者
能賣就是對的~~~~~~~~~~~~~~~~~~€
18#
發表於 2010-5-28 16:50:59 | 只看該作者
真假??
& W- O& M* x+ `' t3 {5 i; ]) d/ l) E* r/ `) j, _8 [
光聽到飛過mos我就嚇到說!!呵
19#
發表於 2010-6-2 11:19:34 | 只看該作者
有些上司根本就沒觀念及概念
4 j" I# `4 Y' l6 p6 n& q7 k只要求面積小時間內做完+ j- \# t* E. f  U1 _
LVS及DRC   OK!就好2 E: k( `; }/ a$ x( N
所以一開始不能適應
2 X$ e+ @. A0 ?能WORK就沒事. a9 s# W; Z* a, }; r0 `
但如果不能WORK說不定就推到LAYOUT身上
/ W" |# Q1 N' k$ t就會說怎畫成這樣等等~~~~
20#
發表於 2010-6-8 20:06:42 | 只看該作者
多一分常識囉!!
3 J. Y8 y0 h- O+ D# \9 J& o4 e4 P1 Q" }
感謝各位的討論阿!!!
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