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( K* J+ D0 A7 F; D│  └─docs
│          DDI0337G_cortex_m3_r2p0_trm.pdf
! J" ?* \9 L3 a' I7 _5 S  A0 V│         
├─AT420-DC-02008-r2p0-00rel0
│  └─docs
& \7 f' u! b% G6 ~' O1 }" v% X  _│          DII0194A_cortex_m3_r2p0_csg.pdf
│         
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│  └─docs
! O( A" z9 _. ?: b
│  │  │          CM3CodeMux.v
│  │  │          CM3flashmux.v
: N# I& |% O0 y2 Y│  │  │          CM3ROMTable.v
│  │  │          CortexM3Integration.v
│  │  │         
│  │  ├─dapswjdp
│  │  │  │  README_DAPSWJDP
( b' n1 d0 j3 s; P0 G: D8 y9 z' R│  │  │  │  
  X' M- S: N, J7 M│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
, ^3 z. Y4 }6 x* n3 w) @. X( }│  │  │          DAPDpApbIfClamp.v
/ [  }) g0 p$ G, W/ c0 \: f│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
│  │  │          DAPDpEnSync.v
: Q  O4 @+ m* o( ]8 f│  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
3 Z9 [. F( |* S│  │  │          DAPJtagDpDefs.v
! Y& t) w( P3 h8 ~/ u* V* i% @& ?/ D│  │  │          DAPJtagDpProtocol.v
  C- [' z! w/ {: j* k& O/ A│  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
: I, R4 {' x5 X2 m7 D│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
│  │  │          DAPSwjDpDefs.v
" _; V  C1 ^% B' t2 p- |│  │  │          DAPSwjWatcher.v
│  │  │         
│  │  ├─models
# i& x& [3 s5 u│  │  │  └─cells
│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
4 R! q+ v' h) O& \) e│  │  │         
; v: k& {3 {4 H! O│  │  └─tbench
# h4 n6 r) o5 {( }│  │      └─verilog
# m$ a' c* d' V9 T9 J  v9 A│  │              AhbToApb.v
6 s# e# Y# O3 X: S4 `7 Y│  │              AtbLogger.v
7 k5 x# ?& I& X│  │              BusMatrix.v
# N. a: T+ I: L; R3 b│  │              ClkReset.v
! d' N: Z; d- v! t  N7 x0 ^│  │              CM3BusComparator.v
1 m! w$ c. i3 J% n4 E2 S* L8 r6 t

│      │  │  exclude_list.sc_waitstate

: H7 u! `% {' H* r  S             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
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7 A0 f" w8 N2 J4 E$ ]9 e! @" G0 _             │      │  
             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
9 H( x& U4 i5 i' x/ C" E             │              cells_1.geo
             │              cells_1.pwr
             │              index.cli
; }) t! `7 ?2 s# `6 N5 P4 A             │              README.TXT
2 Y/ i2 p- g- G             │              rulesets
             │              VERSION.TXT
             │              vias_1.geo
3 r/ i. C  h8 E8 f9 d. h             │              
) h) G& X6 C/ k& N0 _8 p" Y, T$ p5 t             └─tsmc
                 └─t-n90-lo-sp-002-f1_1_6a_20060914
$ W: m, ]$ y* H2 R" g6 b  ]                     └─6X2Z
                             corner.defs

& Z5 g. c) j" O" X├─integration_kit
# X3 J- h. x7 q4 l7 Y( S+ O│  ├─logical
│  │  ├─cm0ikmcu
│  │  │  └─verilog
- M" ~6 i  @- R5 q- h9 e! c' q│  │  └─tbench
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│      ├─glogs
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6 _, m! h0 B6 |! C8 E3 T% |│      ├─mdk
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- S1 z" s6 C& n$ ^│      ├─tests
% f- I) v1 ]% h, K# p! O│      │  └─CMSIS
$ O' t& w5 R1 P7 e# Q7 K│      │      └─Core
│      │          ├─CM0
│      │          └─Documentation
% v. Y" {, L4 V/ n; n/ j│      └─vectors
1 y. c4 k# `3 _& f6 Q+ F2 x├─ipxact
& J, h8 |- c  a+ p4 u5 g; E) a│  ├─busdefs
9 K. D# a9 l# h8 E( N│  │  ├─amba.com
/ v. ]) v+ P% T+ B% [* m│  │  │  └─AMBA3
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│  │      ├─CoreSight
( ~; D4 C* U3 p│  │      ├─Cortex-M0
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" S. ^9 D8 j7 _7 t2 `│  ├─channels
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