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[教育訓練] 10/03 IC Design Service 人才培訓計畫

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發表於 2007-9-13 10:32:02 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
課程類別  人才培訓(課程)
舉辦日期  2007/10/03~2007/11/07
舉辦地點  (新竹) 專研中心(光復路2段3號,701教室)
報名  報名截止日:  2007/09/28 * 線上報名 *
聯絡人 產業學院 / 陳曉嚴/ 03-591-2548
課程特色
    這是所有求職者的夢想……
� 可以學以致用
� 可以從事自己真正有興趣的工作
� 可以具備職場上的獨特競爭力
� 可以在知名企業工作並且與之共同成長、致富


工研院與智原科技一起為求職者完成心願……
工研院產業學院與智原科技共同開辦IC Design Service人才培訓班,為有志進入IC Design Service產業的人才打造專業技能。在這個培訓計畫裡,學員不僅可以獲取IC Design Service產業的入門基礎技能,更可以與企業面對面的接觸,瞭解企業特性,確認自己的興趣與性向,是一個『訓』、『用』高度結合的培訓計畫。
IC Design Service產業蓬勃發展,人才急缺!
把握機會就能開創未來,IC Design Service產業邀你一起共創未來!

計畫緣起: 因應IC Design Service產業的人才需求,工研院產業學院整合工研院、產業、學界之經驗,與智原科技共同推出IC Design Service人才培訓的基礎課程,密切結合企業的人才技能之需求與教育訓練的目的,落實訓、用合一之效。這不僅是產業學院的主要目標,更可以協助企業找到合適的人才,也讓求職者可以依照自己的性向,補足必要的就業技能,在就業市場中獲得新的競爭力。

課程目標:
1、培訓IC Design Service產業需要的人才。
2、幫助企業尋找合適的人才。
3、協助學員培養工作技能,增加就業競爭力。
4、增加學員與企業接觸機會,創造工作媒合機會。

適合對象: 大專院校以上,理工背景畢業。(報名者請檢附畢業證書影本)
課程綱要:
� 始業+企業參訪
� Introduction to Nanometer SoC Synthesis & Implementation
� HDL Coding for Synthesis
� Design & Timing Constraint
� Chip Synthesis and Design Optimization
� Static Timing Analysis & Report
� 期中考
� Design For Test and ATPG
� Physical Design by using Cadence Encounter
� Timing Closure & Signal Integrity
� Design For Manufacturing and Reliability
� Low Power
� 考試、結業、企業座談

課程特色:
1.課程授課老師中,30%以上為工研院技術團隊,60%以上為產業實務老師,課程講師結合產、研強大實力,課程內容完全實務導向。
2.本課程是依照產業所需專業人才技能規劃之課程,為進入IC Design Service產業之重要入門課程。
3.本課程與智原科技合作辦理,學員在完成本課程後,如受邀進入智原科技服務,將可獲取智原科技頒發一萬元獎學金。(相關規定請依照智原科技內部規定需求)
4.課程當中規劃增加學員與企業的高度互動,學員可以瞭解產業特性、企業文化,達成學有所用、與興趣結合之效。

開課日期: 10/3∼11/7(星期三晚上、星期六整天),共計45小時
開課地點:
1.經濟部專業人員研究中心701教室(新竹市光復路二段3號行政中心7樓)
2.智原科技訓練教室(新竹科學園區力行三路5號)

報名時間:即日起受理報名,9/28截止。
課程人數:為確保上課品質及效果,每梯次最多僅招收35人。
證書:本課程結訓後將授與工研院產業學院核發之結業證書。 (出席需達80%以上,學業成績平均80分以上)
課程費用: 每位學員NT$20,000元整(含稅、講義、餐點、學雜費)。
課程通知:
1.課前9/30將以e-mail通知錄取及通知繳費。
2.經錄取而未克出席者恕不退費。
參加辦法  請直接網路報名或傳真報名。網址如下:http:/college.itri.org.tw
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