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[問題求助] 一些Layout的問題

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21#
發表於 2008-4-3 20:19:53 | 只看該作者
关于 double guardring,我们的画法是 ntype ring 靠近噪声源  N" J5 a( j+ i/ [  Z) {
就是说 如果包的是噪声源的话,ntype ring 在里面,如果是为了防止别的噪声干扰的话,ntype ring包在外面
22#
發表於 2008-4-7 23:24:51 | 只看該作者
非常感謝大大的分享
; f0 p5 o0 {) a" `& ^非常感謝大大的分享5 Q( N4 w$ S- V2 o/ ?) {
非常感謝大大的分享
23#
發表於 2008-10-23 14:21:55 | 只看該作者
原帖由 finster 於 2007-9-6 10:31 PM 發表
# f; _) @% S4 G# ~我是在一篇paper中看到的,不過這篇paper不知被我放在那裡了
0 m0 ]2 Z# V% `2 a- ~6 l另外,你所引用的教課書的公式應是Razavi那本"Design of Analog CMOS Integrated Circuits"中第13章的吧2 b( T' u6 w, K- {* k- Y, K
書上是先決定BJT的顆數比,然後再求出相對應的電阻 ...

" J7 t+ y3 r% h2 N% G- ?" O
6 I1 E* O- m1 B9 x好像实际确实如此!谢谢! ……………………………………
24#
發表於 2008-12-2 12:56:22 | 只看該作者

非常感謝大大的分享

非常感謝大大的分享
$ j# N2 [% Z5 T( \非常感謝大大的分享. J- R! N5 q$ a0 a" I
非常感謝大大的分享
6 o  g! {5 {3 j3 A. W常感謝大大的分享
5 L/ p+ ]0 \& H2 [2 V% x非常感謝大大的分享
& A' b% f, c3 o* W非常感謝大大的分享
25#
發表於 2009-8-9 10:47:41 | 只看該作者
1    普通的logic电路影响不大,  不过一些高频信号, 一些delay电路等的还是尽量避免# W3 M, c/ |8 U& p

, ^$ G$ i7 g2 X0 U% Q3 ~0 O2    guard ring 最有效果的是p + guard ring,  但是一定一定一定要接到干净的gnd!!!, 这样才能吸收掉noise。  2种都画的话,比只要p+ 好一点点。
  i- X& P' G( m  [* [( \2 k
7 F" H* }$ W8 U4 r3  这个是为了匹配这样设计的,一般都是设计成1:8    ,1:24 。
26#
發表於 2009-8-9 17:24:40 | 只看該作者
最近在做pll的電路。類比數位都會用到。
: F* Q+ f( R' L各位都好利害啊,每個回文都有參考價值呢∼∼
27#
發表於 2009-8-9 21:57:17 | 只看該作者
剛好要瞭解這方面的資訊,正好做來參考...6 r7 b- Q# S+ [$ {
2 Y$ f3 @" `( x- M: L8 E
謝謝分享...
28#
發表於 2014-3-28 09:19:44 | 只看該作者
非常感謝大大分享~+ b$ ?! v4 n- H/ t* w( ^# J! G2 J: s
非常感謝大大分享~! O4 m6 O4 k# j/ U) z0 C
非常感謝大大分享~
29#
發表於 2014-4-23 16:42:21 | 只看該作者
2:pring 接地收集空穴,nring接高电位收集电子,二者纵向结深越深越好;多子ring是为了让sub电位不被拉高或拉低,少子ring收集电子或空穴
30#
發表於 2015-1-2 14:47:45 | 只看該作者
謝謝各位前輩的經驗分享
31#
發表於 2015-5-19 14:25:40 | 只看該作者
1! s( C* X3 r4 ~3 U+ O
怕千擾% @+ D: k% P/ b1 D4 I0 g. C
可以事先詢問rd care的地方,避免跨過即可) s2 I9 i) l% l
2+ _( I5 ~: ?4 ]% ~3 j4 f
依pnmos來決定第一圈及第二圈ring3 g0 N: F* d3 y+ t" G* @( y9 j# [
3* e0 \+ F5 ^, U) Y  Q. X! A+ |
我也是畫9官格
32#
發表於 2020-8-11 22:39:34 | 只看該作者
非常感謝大大的分享
1 }- G6 a4 e# A6 A* y非常感謝大大的分享
( w4 q2 k1 O- ?' C; H/ Z非常感謝大大的分享
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