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為什麼MOS上的SOURCE要接到BULK

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1#
發表於 2008-3-30 18:28:39 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
BULK與SOURCE端相接的原因除了避免LATCH-UP,另一個就是
- x4 s: i, T+ a1 Q) H+ K7 [2 @  t) |避免BODY EFFECT 也就是基底效應,如果你有讀過VLSI的書不難0 U9 d2 [4 b# T+ L2 O8 U
了解SOURCE跟DRAIN的導通必須透過"空乏區",空乏區的產生必
0 i1 A8 n3 |  F3 m3 }2 |5 z須透過從GATE端輸入的電壓,當輸入的電壓大於臨界電壓時空乏區& e/ M2 W, j# ?' q% E: F" F2 S, L
才會產生,臨界電壓與SOURCE端的電壓有密切的關係,如果沒記
0 F& d: `8 }6 z8 x  K; a; W8 K/ X錯GATE電壓+SOURCE電壓等於臨界電壓,如果SOURCE端電壓. X5 O; O6 R( h+ l3 y9 o
不等於0,將會造成打開空乏區的電壓必定需要增大,相對這種情況
4 S# [+ b, b2 T, N# ]0 w下的MOS就不易被導通,而且增加了電壓上的損耗。
. M; G- U3 v7 \! f, C& o
8 v" n2 B5 `- O) Q- u如果有寫錯還請各位指正,謝謝。
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2#
發表於 2008-3-30 19:15:40 | 只看該作者
以 PMOS 而言, Body 可接到 S 或 VDD.
. X% u4 e: {* W! h都是為了保持 Body 對 Channel 的逆偏。
3#
發表於 2008-3-30 19:31:01 | 只看該作者

回復 1# 的帖子

應該是Vgs>Vt也就是說Vg-Vs>Vt........................................
4#
發表於 2008-4-1 00:18:14 | 只看該作者
Seems it depends on application, Vt vary with Vsb. Mostly if we want to have min. Vt, source is connected to bulk.
5#
發表於 2008-4-1 07:29:14 | 只看該作者
讀了一遍  覺得文中所稱的  空乏區  應該是 反轉區吧  (Inversion Layer)
- ~1 V0 ?5 h6 T5 B我的認知是覺得  Body effect  就是 VBS=0   NMOS就是 source與bulk 要接到 GND
6 t! A4 \: O6 j6 O4 y7 tPMOS 就是 source與bulk要接到 VDD
8 s0 [! G- y: b0 ]5 R: N, q; ^但是電路上還是會有 VBS不等於0的情況( l% C% L% \. U& {
這通常發生在  MOS串接的情況   不管是 Cascode還是 CMOS邏輯 串聯的那一塊
( M1 m8 ?8 O: q$ ^; n+ Z7 Q' u都無可避免的有 基底效應出現,  所以一般來說 我們做 CMOS互補邏輯  最多就是用到 4-Input
# A. I7 B; n& F6 f; \因為太多輸入時   串聯的MOS間會有  Chrge sharing的問題, 其次就是疊越高的MOS Body effect會越嚴重
  H0 ^! V8 O2 M" P) A最後一個Issue是   該邏輯拉到 1或0 其中一邊的速度會變成非常慢.
' e5 Y% Z6 U- ]" |! `5 B; RCascode最多就是疊兩個   疊太多會傷到  OP ICMR 或 Output swing., K$ z7 R* [' X) U8 O0 m# \$ @
+ F5 s& r' f3 t$ m, K; L0 z
[ 本帖最後由 yhchang 於 2008-4-1 07:30 AM 編輯 ]
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