Chip123 科技應用創新平台

 找回密碼
 申請會員

QQ登錄

只需一步,快速開始

Login

用FB帳號登入

搜索
1 2 3 4
查看: 17483|回復: 4
打印 上一主題 下一主題

為什麼MOS上的SOURCE要接到BULK

  [複製鏈接]
跳轉到指定樓層
1#
發表於 2008-3-30 18:28:39 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
BULK與SOURCE端相接的原因除了避免LATCH-UP,另一個就是: z& c! u* j  N+ J0 K" x& M
避免BODY EFFECT 也就是基底效應,如果你有讀過VLSI的書不難+ `) d( L" j/ L( Y
了解SOURCE跟DRAIN的導通必須透過"空乏區",空乏區的產生必
4 z. S/ W% y: r6 r須透過從GATE端輸入的電壓,當輸入的電壓大於臨界電壓時空乏區
7 v( c8 @1 j+ }; U8 ^( R才會產生,臨界電壓與SOURCE端的電壓有密切的關係,如果沒記0 O2 A# u7 W5 u
錯GATE電壓+SOURCE電壓等於臨界電壓,如果SOURCE端電壓
( Z$ r' F, M7 L" Y不等於0,將會造成打開空乏區的電壓必定需要增大,相對這種情況
# d% L& W8 m3 z7 x7 l3 u# i下的MOS就不易被導通,而且增加了電壓上的損耗。& _3 @* ~4 R: }5 E: s
9 n) c1 M, a2 U1 u
如果有寫錯還請各位指正,謝謝。
分享到:  QQ好友和群QQ好友和群 QQ空間QQ空間 騰訊微博騰訊微博 騰訊朋友騰訊朋友
收藏收藏 分享分享 頂3 踩 分享分享
2#
發表於 2008-3-30 19:15:40 | 只看該作者
以 PMOS 而言, Body 可接到 S 或 VDD.
6 }0 J! f) O) z$ J5 V' }" C都是為了保持 Body 對 Channel 的逆偏。
3#
發表於 2008-3-30 19:31:01 | 只看該作者

回復 1# 的帖子

應該是Vgs>Vt也就是說Vg-Vs>Vt........................................
4#
發表於 2008-4-1 00:18:14 | 只看該作者
Seems it depends on application, Vt vary with Vsb. Mostly if we want to have min. Vt, source is connected to bulk.
5#
發表於 2008-4-1 07:29:14 | 只看該作者
讀了一遍  覺得文中所稱的  空乏區  應該是 反轉區吧  (Inversion Layer)
' ?& r2 T9 p' E我的認知是覺得  Body effect  就是 VBS=0   NMOS就是 source與bulk 要接到 GND
  j( @5 H7 Y; P# TPMOS 就是 source與bulk要接到 VDD
7 i' G1 [* z- p) S但是電路上還是會有 VBS不等於0的情況
1 I; M7 S0 N6 @3 u這通常發生在  MOS串接的情況   不管是 Cascode還是 CMOS邏輯 串聯的那一塊
% X; t' t  E- q都無可避免的有 基底效應出現,  所以一般來說 我們做 CMOS互補邏輯  最多就是用到 4-Input
) |& q7 \& U: R( W, ~7 o因為太多輸入時   串聯的MOS間會有  Chrge sharing的問題, 其次就是疊越高的MOS Body effect會越嚴重
  G7 E  ]9 F, y7 i4 B最後一個Issue是   該邏輯拉到 1或0 其中一邊的速度會變成非常慢.
$ b3 a, {- P3 D4 H* aCascode最多就是疊兩個   疊太多會傷到  OP ICMR 或 Output swing.
! h% E' `) H6 A4 o: r& ]- a; Y+ w" z# K" S9 a. v* W; }/ S
[ 本帖最後由 yhchang 於 2008-4-1 07:30 AM 編輯 ]
您需要登錄後才可以回帖 登錄 | 申請會員

本版積分規則

首頁|手機版|Chip123 科技應用創新平台 |新契機國際商機整合股份有限公司

GMT+8, 2024-12-5 09:34 PM , Processed in 0.155008 second(s), 18 queries .

Powered by Discuz! X3.2

© 2001-2013 Comsenz Inc.

快速回復 返回頂部 返回列表