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為什麼MOS上的SOURCE要接到BULK

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1#
發表於 2008-3-30 18:28:39 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
BULK與SOURCE端相接的原因除了避免LATCH-UP,另一個就是" e0 \6 @1 I7 B* e$ \; `% ]6 x- }
避免BODY EFFECT 也就是基底效應,如果你有讀過VLSI的書不難
$ F& r: O* {; d$ s% I, n( V# z了解SOURCE跟DRAIN的導通必須透過"空乏區",空乏區的產生必
) u$ K8 C, l8 w# ?4 s須透過從GATE端輸入的電壓,當輸入的電壓大於臨界電壓時空乏區2 N. ]7 V  {( u. r7 S
才會產生,臨界電壓與SOURCE端的電壓有密切的關係,如果沒記
5 V& s$ t; I* F% L* ^4 g' E" x  l錯GATE電壓+SOURCE電壓等於臨界電壓,如果SOURCE端電壓. Y- M# G- Z- O" i0 i0 [  v& @
不等於0,將會造成打開空乏區的電壓必定需要增大,相對這種情況5 T& P6 {2 I$ V+ g7 t
下的MOS就不易被導通,而且增加了電壓上的損耗。
7 r0 x8 \% E1 c4 g. V  _7 |: f; a" m0 y' U
如果有寫錯還請各位指正,謝謝。
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2#
發表於 2008-3-30 19:15:40 | 只看該作者
以 PMOS 而言, Body 可接到 S 或 VDD.
* f; d% D  ]7 a9 j$ J" x$ @7 o都是為了保持 Body 對 Channel 的逆偏。
3#
發表於 2008-3-30 19:31:01 | 只看該作者

回復 1# 的帖子

應該是Vgs>Vt也就是說Vg-Vs>Vt........................................
4#
發表於 2008-4-1 00:18:14 | 只看該作者
Seems it depends on application, Vt vary with Vsb. Mostly if we want to have min. Vt, source is connected to bulk.
5#
發表於 2008-4-1 07:29:14 | 只看該作者
讀了一遍  覺得文中所稱的  空乏區  應該是 反轉區吧  (Inversion Layer)
+ l8 O7 S5 O/ q& w; i8 b4 b2 u我的認知是覺得  Body effect  就是 VBS=0   NMOS就是 source與bulk 要接到 GND
% H2 i- M. u0 W" B/ ePMOS 就是 source與bulk要接到 VDD
5 x- i3 f8 n: Z# s# g% n9 R3 K但是電路上還是會有 VBS不等於0的情況
) L  i$ R% ]  l  V; a這通常發生在  MOS串接的情況   不管是 Cascode還是 CMOS邏輯 串聯的那一塊
# \9 ^7 i/ P& e都無可避免的有 基底效應出現,  所以一般來說 我們做 CMOS互補邏輯  最多就是用到 4-Input
9 D/ Y- t- K, ]& \) I# U9 n因為太多輸入時   串聯的MOS間會有  Chrge sharing的問題, 其次就是疊越高的MOS Body effect會越嚴重
; z. ?2 [, ~0 S- w8 v% n7 Q1 y最後一個Issue是   該邏輯拉到 1或0 其中一邊的速度會變成非常慢.1 _' |0 m+ J5 p& |4 ~
Cascode最多就是疊兩個   疊太多會傷到  OP ICMR 或 Output swing.
' W! S4 K. B- X+ S0 y, i4 z# B: E/ O, |: c" b( y- \. ?5 [$ h; `9 h: T
[ 本帖最後由 yhchang 於 2008-4-1 07:30 AM 編輯 ]
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