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$ V. C: G8 w. ]: x9 U├─AT420-DA-03001-r2p0-00rel0
│  └─docs
│          DDI0337G_cortex_m3_r2p0_trm.pdf
1 v3 ~3 @" d: q1 y  r+ A│         
3 W& T5 V& Y( [5 ^) g% v! p├─AT420-DC-02008-r2p0-00rel0
8 o5 z! P7 ]- g│  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
. o" H) N5 q* F0 T' v* R0 ]* O│         
├─AT420-DC-13001-r2p0-00rel0
' M- e1 F: B4 I' T* s: x/ ?+ g# X& d│  └─docs
1 _" g+ @$ ]5 O" c( r( I
8 ]3 M. U" H, m2 s│  │  │          CM3CodeMux.v
  ]  ?# K- N- T& y# A0 ^│  │  │          CM3flashmux.v
│  │  │          CM3ROMTable.v
: [8 O. D* @# d8 [, X2 x│  │  │          CortexM3Integration.v
│  │  │         
/ I# V' o8 g* ?& [$ p: r5 Y) x│  │  ├─dapswjdp
│  │  │  │  README_DAPSWJDP
6 M7 I+ g- W: p, B+ N│  │  │  │  
│  │  │  └─verilog
# w# Y, _( r1 g% S6 u9 t0 m- _│  │  │          DAPDpApbDefs.v
) t/ q3 l; ]% d9 U│  │  │          DAPDpApbIfClamp.v
, b$ O# j% z6 X1 |) |│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
! Z. W2 u1 U$ B7 }3 P9 Z1 C+ [5 v9 V$ @│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
- H( p- Z0 l, s& M│  │  │          DAPJtagDpProtocol.v
. {% O; {. G  Z8 g│  │  │          DAPSwDpApbIf.v
# }; d. N- \# R: @  i│  │  │          DAPSwDpDefs.v
│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
7 O3 e1 g0 I) G1 A% E4 r+ J│  │  │          DAPSwjDpDefs.v
│  │  │          DAPSwjWatcher.v
% R6 F$ l* [* \  o# y; X7 C% H│  │  │         
- L- P- e5 P0 R( J, @8 u( Z! D│  │  ├─models
│  │  │  └─cells
│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
) R9 l+ |! e$ J" M: Y& O! G& _0 N9 y' J│  │  │         
7 F: [2 j4 I! y% T) d│  │  └─tbench
, P  Y- w$ E& V; V│  │      └─verilog
, W8 T  m2 Q! l! g  Q│  │              AhbToApb.v
│  │              AtbLogger.v
│  │              BusMatrix.v
│  │              ClkReset.v
│  │              CM3BusComparator.v
$ ?. _9 j! C. K# q

│      │  │  exclude_list.sc_waitstate
8 R) A0 L" X$ J) J2 O1 ]1 @
             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
. w2 C1 M4 P6 c1 S5 \             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
2 I# }% i- h6 Z9 R  L             │      │  
" [; N& o4 R0 t) @* ^             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
1 g% g2 g& x* `8 l8 `5 v! x/ o             │              cells_1.geo
             │              cells_1.pwr
             │              index.cli
             │              README.TXT
7 o7 _- a0 b# t# @2 [9 G. ?- }3 n             │              rulesets
! _8 u+ a5 U2 q; x             │              VERSION.TXT
             │              vias_1.geo
             │              
             └─tsmc
                 └─t-n90-lo-sp-002-f1_1_6a_20060914
                     └─6X2Z
                             corner.defs
( S* W; o+ ], F/ K4 D# \
├─integration_kit
- F. n5 I$ q7 d6 C8 H- o│  ├─logical
2 G( C  g0 o% k' t- _1 S7 F! }+ \│  │  ├─cm0ikmcu
9 D9 J3 [" r2 U; ]( m* Q│  │  │  └─verilog
│  │  └─tbench
0 j  E& Y; m. T│  │      └─verilog
* H+ F( I# k9 J( W0 G3 k, T$ E│  └─validation
│      ├─glogs
1 I8 H7 c4 W2 a8 c- g$ s5 q│      ├─logs
9 S8 l1 U) h8 [2 I│      ├─mdk
1 W1 i5 s. S# K5 x% a% l( x3 I0 z│      ├─srpg
0 w; ^; i9 T$ o; \: f/ F) D) y│      ├─tests
│      │  └─CMSIS
│      │      └─Core
! a& ~+ o8 B  y│      │          ├─CM0
8 q( C! `/ N! p- N7 }│      │          └─Documentation
│      └─vectors
0 [4 S* _. u5 m$ w% r+ o5 p├─ipxact
6 _1 D- K; `' X- d2 T│  ├─busdefs
/ y" |4 }2 T3 R5 P$ x│  │  ├─amba.com
│  │  │  └─AMBA3
. E  J+ Q/ |) E5 F( a# P, R│  │  └─arm.com
│  │      ├─CoreSight
│  │      ├─Cortex-M0
│  │      └─CortexMCores
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