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[問題求助] DLL前模擬的jitter

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1#
發表於 2012-7-17 20:52:47 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位高手好~~
) Y; K$ V  e' k, U1 C9 A- u* K# N1 _9 G& G6 [
我用Hspice要在前模擬做一個jitter小於10p的DLL
+ y) Y% }& ?8 T3 H
2 Y! `+ Z% }2 \, I% p這是我用來測jitter的語法
( {; H6 n2 G( Y( S  L$ P% ^6 c6 W.PARAM per='週期'         
$ k% L' Y  c8 n1 Y  ~* j9 c. Y1 @.PARAM tim='開始時間'
; K1 ?0 V% d2 J2 w+ Q  [.probe tran eyetime=par('.5*(sgn(TIME-tim)+abs(sgn(TIME-tim)))*(TIME-tim-per*int((TIME-tim)/per))')
8 {5 v) K% E9 h9 C" o
% |- l9 u! H6 z整個DLL測出來的peak to peak jitter是25ps, S# J7 o* _$ Z  |/ R  U

! ]1 \' j8 J. V# a+ ~( I9 X我一直改Phase Detector、Charge Pump的特性但整個jitter都無法改善3 \- k  x, C; _: F

5 Z3 W. c6 s" D: A後來我用上面的語法去測VCDL這個區塊的jitter,出來的值居然也到2Xps
; U# ~. l6 ~9 U+ n( e  d8 ^! a, x% m, d; c
也就是說在VCDL的控制電壓是定值的情況下還是有很大的jitter
# K0 i8 [. a, t' M# S; B
* Z& u& f4 _3 m- d; T4 L# @5 T我想問這樣子VCDL可能是哪邊出問題呢?  還有我量jitter的方式有沒有錯?
( I. b2 i! b. \
8 N# V( V  ]7 T0 z+ R9 H6 o( W! [
# y# l6 H, z5 j$ i4 v. a" f% u$ _6 F$ Y3 o* i  [# w8 r0 Q* t
如果還需要什麼資訊的話我會盡快補上的,謝謝大家>"<

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2#
發表於 2012-7-23 06:54:15 | 只看該作者
你DLL的操作範圍為多少?( {3 e( u& T" B% k- W- t! C( c7 K
你每一級的delay cell的delay time又為多少?
) e" r3 o! V& j% y3 h$ q你的DLL的delay cell共用了幾級?( K9 E: b, y; f  Q: T. G2 G
有了這三個資訊之後,再去測試一下你的delay cell在可以工作的電壓範圍內相對應的delay time各為多少之後?1 U. `( q; e  v9 W
就可以稍微推斷出delay cell可以在多少的delay time下工作,亦即可以推算出jitter大概會落在那個區間
3#
發表於 2012-7-26 12:18:28 | 只看該作者
spice的语法不是很熟。不过如果按照你说的,给个固定控制电压vcdl也有很大的jitter,那就得考虑1.是不是测量语法有问题,这个可以通过手工在波形上测量对比一下。2.仿真精度有问题。这个可以考虑调整一下仿真精度。
4#
發表於 2021-12-21 16:41:57 | 只看該作者
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