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[問題求助] Layout 空位如何解決

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1#
發表於 2011-3-27 00:00:09 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
在畫Layout時,如有空位能用 Guard ring、做DUMMY、刻意跑線在上面來補空位嗎??
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2#
發表於 2011-3-29 14:25:05 | 只看該作者
一般來說盡量不要出現有空位是比較好,如果空位過大表示你的空間使用率
7 D3 r  ?( Z; ^( E  Z5 F# i
- r. ~6 M9 E% N! T5 n5 v' b$ f不盡完善,很可能會被要求RE-LAYOUT,也就是重畫,但是如果是跟design
" i. l' @9 l* X/ b/ l
9 A, ]% j0 }$ k: s1 S* g/ z討論後留下非不得以的空位,則可以補mos dummy or 電容,補ring 算是最
$ P$ ?  ]5 `# \: B5 r8 ]$ G9 {$ e5 l( d4 l+ |1 h- n- M
簡單也最粗糙的補空位的方式,除非不得以,我自己layout時是不會把空位全
$ W2 s" K$ K- @& p2 x2 v: P, f
% V9 l& ?& t$ _' n9 [4 E( m+ D/ }! K$ s部都拿來補ring的,以上僅供參考,希望對你有幫助。
3#
發表於 2011-3-30 11:40:30 | 只看該作者
这个要看空位是在什么地方了?有模拟电路里,个人觉得某些敏感线附近的空位是不能补的,但是大部分都可以用来补电源-地电容比较好,也可以做成dummy来提高制程的精度。
4#
發表於 2011-3-31 10:46:17 | 只看該作者
可以寫些 Product code, Company name 之類的
5#
發表於 2011-3-31 14:05:49 | 只看該作者
同意大家的說法
1 u. _% x, ?& e) [/ t) I盡量不要有空位
* g; Q' j' S+ ~3 O# t+ Q$ H. L有時候為了match 或是其他目的  Y# k3 X3 Q1 c% W$ _
會有空位
+ b# [4 Q- F1 ]7 v1 s" c+ P這時候就是藝術創作的時候了
6#
發表於 2011-4-1 15:06:36 | 只看該作者
1. 補 Decope 電容./ ?3 R% d7 K( y
2. 把 Power/ GND metal  加粗.
! C; o2 G$ Y% w- X+ d3. 加 redundant cell
7#
發表於 2011-4-19 10:07:46 | 只看該作者
1.填VCC對GND ESD CELL
. Q' H& E$ R  k' z6 `. I2.加dummy digital CELL
, G/ `7 ]) L+ l: r6 e# B3.add RES and CAP
8#
發表於 2011-4-25 18:37:14 | 只看該作者
補電容(針對Power對GND)或是補DUMMY MOS
9#
發表於 2011-5-11 17:46:07 | 只看該作者
补电源对地的电容2 l& J0 m8 y) f- `# V& w4 b
和RD讨论,画一些预留的器件
# ^, r0 Z6 e( `3 @5 e8 M) z打上Psub的接触
10#
發表於 2011-6-1 20:28:44 | 只看該作者
在相同面積下調整佈局方式,欺騙自已,但要調整需跟RD討論,
4 ~3 J* L3 I: w當RD看到LAYOUT還有空間的下場時,會再調尺寸或新增電路以及在重要且敏感的地方要求加入RING,,在相同的面積下做完
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