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[問題求助] Virtuoso CDL Import設定問題

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1#
發表於 2010-8-4 16:24:45 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
在CDL Import裡設定的reference library及device-mapping file
. L. B- l, B- U- t) Z+ B請問reference library指的是??6 Q( H. ?0 i/ w  d* A. ^' d
以及可以請教如何撰寫device mapping file嗎??
) c. Y% J* M0 {  w, I0 o% U* l6 C7 U( }; b$ V0 V. \+ ~0 @
謝謝各位大大囉
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2#
發表於 2011-4-29 14:42:45 | 只看該作者
reference library指的是你用的nmos/pmos/inv....etc. library
3#
發表於 2012-4-12 17:02:34 | 只看該作者
device mapping file; M1 z0 K7 @8 C+ X! Q
先vi model.map file
# y8 l0 e- y* X/ `1 QM PCH  .   .
' Z5 S$ Z5 U& E: e: o& ?, VM NCH  .   .2 p7 ~3 [% K, G7 o, Z% t2 S. n
第一個 .  是自建layout library, 第二個  . 是 TF file定義的MOS 名稱,, r1 r3 ?! ]2 g2 a2 S
也就是說沒有自建layout 如下:- K* Y9 ?: b8 h# T
M PCH  .   PMOS
9 F4 M* n; l! T( A  Q* l3 |: f# @% H. ]M NCH  .   NMOS, a# Z! n- A4 r
如有自建layout library# h) O# [. C2 z% I
M PCH  lib_name   PMOS
- |7 ^. u8 m/ K5 R) bM NCH  lib_name   NMOS
4#
發表於 2012-6-5 09:02:02 | 只看該作者
補充:
0 T  \1 z! p  |: E% G$ T. M1. Reference Library: the reference libraries or Process Design Kits (PDK) where the symbol views of master cells are present. 既你想要用的symbol是來至哪個 library./ ~+ h$ r1 c+ p, T( D. J
2.  Syntax for Specifying Device Maps in a Device-Map File:+ _/ i- O2 ?( c/ _" E" C' E+ @
     devMap := <primitive_device_name> <mapped_device_name>* a0 \0 O! Z) |0 L
     [ propMatch := list_of_prop_to_match ]
  Y  ^! k; X9 i# `     [ termMap := list_of_terminals_to_map ]& g" N1 R' H& n
     [ propMap := list_of_properties_to_map ]% ~" R+ D" {; k6 v! m3 S
     [ addProp := list_of_additional_properties_to_map ]
- z! s2 ?6 Z4 t6 S  N, t5 v# \      Example:3 Z1 G  W& x; z2 B$ G/ v' {
      devMap := resistor res
) s/ U2 J+ u9 S+ k( u+ ~      propMatch := r 20000. q6 s' W/ Q* Y, d: H# z
      termMap := PLUS PLUS MINUS MINUS9 S- l  l7 ]2 P+ h/ e& }
      propMap := subType type r resVal w width l length9 D7 Y4 y# ^0 w. B# ~. Y
      addProp := model res
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