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樓主: bbegg
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[問題求助] dummy 接點的問題

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21#
發表於 2011-9-26 09:43:18 | 只看該作者
本帖最後由 jacky80109 於 2011-9-26 09:47 AM 編輯
- C( t1 ?8 N% Q( n5 R* y( W
4 V) F' H0 ~7 p. v1 b, t5 Y/ C回復 10# 小包 ! T' z! m) ^) m8 x8 n
) y8 T% b( T! o* I. X
+ z: H9 ~' k- v
    n+跟nwell是不一樣的東西,n+濃度較濃且深度較淺,並且有od的地方才有n+,nw是只要你有lay nw的地方就會被做出nw,不管上面是否有od。nw接gnd會怕漏電是有原因的,以較有名的fab廠來說是不會有這種問題存在,但關乎rd所設計的電路。撇開電路架構不說,我們就曾經遇過製程技術比較差的fab廠,因為psub的濃度沒有調好,造成nw和nw之間漏電,你想想,假設你這個時後把dummy的nw接到gnd,附近又有pmos接vdd的nw,是不是就有漏電的疑慮....
1 u/ e) v$ h: k7 H
3 j' Y1 _: t( |1 V7 }* E& U2 n: `4 x為什麼這樣皆會有漏電的疑慮?你指的是說nw<dummy>和nw<不是dummy>會漏電?那漏電和p-sub的濃度為什麼有關?p-sub應該是gnd~nw應該部會接到比這個更低的電位吧?小弟有些不懂?. S4 e( \1 ^' V8 s* {3 m2 O1 y: p
請大哥解惑一下~感恩
22#
發表於 2011-9-26 14:01:37 | 只看該作者
我頂~ 感謝各位前輩的教導9 u: L1 J; c( n$ G9 `- V

0 h3 ?- ]' v& b8 I: ~6 y) O1 _8 z小弟又學了一招 謝謝
23#
發表於 2012-1-8 22:14:38 | 只看該作者
回復 11# 小包 / S) E0 v) A  W9 X; p6 }

/ i! a; m8 p4 G5 g
' _+ F3 X* @# Q# q    挖!!這篇對小弟現在受用無窮阿~~非常感謝大大的經驗分享
24#
發表於 2013-1-29 17:30:04 | 只看該作者
說得真詳細,學到不少
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