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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 跑LVS如何忽略dummy
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樓主: w765432001
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[問題求助] 跑LVS如何忽略dummy

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21#
發表於 2010-6-8 20:14:57 | 只看該作者
又增長一份知識了～
9 Z: m9 Z+ R7 j- B- B* W+ f8 M. M0 q5 C. v
謝謝大家的分享！！！
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22#
發表於 2010-6-12 15:37:54 | 只看該作者
增长知识了！！！谢谢分享经验
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592gigi
23#
發表於 2010-7-27 15:27:41 | 只看該作者
新人学习了，谢谢
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Liwayi
24#
發表於 2010-12-22 09:16:34 | 只看該作者
來聽大家的意見; R! Y' L6 k# [# n
吸收知識的~謝謝分享
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25#
發表於 2010-12-22 15:14:34 | 只看該作者
個人比較贊成 11樓的 說法  這樣做比較 嚴謹
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26#
發表於 2011-4-1 15:00:37 | 只看該作者
要了解 LVS Commanf file 的語法. 參考一下,可用 OD 與 POLY dummy layer 來畫.
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27#
發表於 2013-3-24 19:51:38 | 只看該作者
同意4樓大大的作法! 全部接到同一個節點 也可以避免電荷累積造成到substrate的順偏電壓過高
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28#
發表於 2013-3-26 07:49:58 | 只看該作者
学习了
9 g( Y1 X6 G& a9 q+ T学习了
4 e; O# Z; a1 x% O# j* d! z" n- R7 |& B学习了# N+ N7 @" z! R- u$ R
学习了, S8 ]' E. t/ ^
学习了
+ ]3 \9 P3 z" ^& ]学习了
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29#
發表於 2013-9-11 10:07:53 | 只看該作者
学习了，多谢各位大大。
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30#
發表於 2013-10-5 22:30:27 | 只看該作者
回復 1# w765432001
5 J- `. @2 i/ L; v! w/ ~7 w7 M4 W* a, l2 e4 ]. p
不知你是貼部份圖,還是全圖
: q/ v# V0 t, j. _POLY + OD = MOS (沒有CO)0 }  ^2 U, x: c; F
你的DUMMY,怪到不行! o% u' R; g2 p4 r5 X$ ?
所以在 SPICE 中,你要新增二個MOS
% D+ m0 T) m# N% O2 A; y( Q, [同意20樓說的四端接同一個點
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bbok7979
31#
發表於 2014-10-22 05:53:01 | 只看該作者
吸收到好多知識囉 XD             謝謝囉~~~
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32#
發表於 2015-5-19 14:46:40 | 只看該作者
不要有其它issue ; o% y; U  Q) W: Q5 m" f, t$ p7 ?1 z
同意4f大大的做法~~
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33#
發表於 2015-8-19 15:02:27 | 只看該作者
謝謝分享，特來學習。。
9 Y1 L! i+ w7 X. O7 Z& L5 P
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AIC6632
34#
發表於 2015-10-9 09:56:44 | 只看該作者
dummy最好也是畫完整的元件
% }  t! s) N9 i! J3 o- G' y這樣比較好
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35#
發表於 2016-9-14 13:42:51 | 只看該作者
w765432001 發表於 2009-7-9 01:14 PM* `9 D- [/ t  ^, Z8 W. {/ m
剛剛從lvs option中設定filter. q6 s' ^! ?! J$ l% \+ o$ [  r# w

4 V, @5 ^( \3 v) a% I% I後來跑lvs驗證無誤，

( m% }! X7 e6 h不過我的技術長跟我說, J7 }; y4 R, d- E
要是原本的CMD也定義的話，設定會跑掉
3 |) g) v: m: A8 f  @最好要非常了解自己在幹嘛再改這個喔~# H; A+ @  z6 C3 [2 m
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