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[問題求助] 請問layout電阻電容畫法

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1#
發表於 2009-5-9 03:01:25 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
因為太新手無法看置頂的電阻電容畫法所以來求助,最近畫layout電阻試過了CIC所寫的三種電阻畫法,但是LVS就是找不到. X+ ~" |* g5 ]: |" F2 a! \
他就是poly,DIFF,NWELL三種,但是我照著話就是LVS不出來,有沒有高手能把電阻的畫法一步一步的解開呢?書上講義都是把已經畫好的電阻放上去然後用箭頭指著說這是poly,這是Nwell,但是有些重疊的部份根本不知道那是什麼東西之間的重疊,不然就是外圍用虛線包住一個蛇形狀的東西並露出兩個頭,但是就是沒有寫那兩個頭裡面是什麼組成的,外表看起來就像是NWELL包住蛇形POLY,但是照著跑根本就跑不出來,因為根本不知道蛇形poly上面有加上什麼東西,要不然就是標示著電阻標示層畫法需和command file配合,淡是到底要怎樣才能弄出電阻標示層還有如何配合command file?請高手幫小弟解題,感激不盡。& T/ q8 k6 F; a8 x
至於電容更是看不清楚了,一塊正方形然後一堆箭頭指向裡面說這是什麼什麼,但是根本不知道那是怎麼組合成的,也不知道哪塊要大哪塊要小...
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2#
發表於 2009-5-12 09:16:24 | 只看該作者
你要看製程廠的 rule file 他有寫 每家不同
! B& [1 K# l* ?. m而畫的規格 W L 要看rd設計   - q+ Z8 I4 v+ y0 F+ \8 N
像大電阻就是由一堆小電阻串連而成  怕失真
3#
發表於 2009-5-12 09:31:10 | 只看該作者
像POLY 電阻 ( o5 E& D; v: M8 t3 v$ g" \; E0 b
最基本的就是 電流 從 CONTACT 進去 POLY  另一端CONTACT 出來 要包其他層 要看製程和RD
' I( d' I0 b! V# u/ v7 ~9 }" V9 t2 X
它跟電路學的 電阻公式一樣  越長L 電阻越大  越寬A電阻會被整除
' ^3 x: ?0 Y+ L0 b% P+ l9 P1 x& T3 d' [; N0 ?, z8 @
電阻率的科學符號為 ρ 。
9 l6 D5 ]9 f1 o: l6 _" A" x" n; V8 C" n: y5 E6 f  c! W
已知物體的電阻,可由電阻率ρ、長度 l 與截面面積 A 計算:
8 C9 J) c% E# N9 s0 A. `# ^) A7 R9 h2 j( b! k. R
R =  ρ  L/A1 e/ Y5 _% j: m0 h" E. l) t  D
6 [& q/ }8 y" {. u
電阻 R 單位為歐姆 ( A# }" I3 N2 r+ u$ z
長度 l 單位為米 # v2 G- @, w, t- c: ?" U
截面面積 A 單位為平方米 1 l3 w9 u. }; l& E+ t
電阻率 ρ 單位為歐姆·米
4#
發表於 2009-5-13 10:05:39 | 只看該作者
可以看command file裡面的敘述 會有跟你講要蓋那些layer(在最上面 or 用找低)
; }% H5 Z% a" s0 R或是看design rule 也有
  f4 n) Q; W* A2 y; V
4 G, j7 {# f. R我猜可能是少蓋了RPO  和 電阻的dummy層吧(RPDMY....等)
; z/ Y$ B7 t  ~要自己讀一下唷3 y' F! H5 b. E

0 k7 ^# L$ V2 k' e1 U" l; ~8 h0 @8 L希望能幫到你
5#
發表於 2009-5-19 17:37:20 | 只看該作者
LVS認不到,不一定是Layout錯誤
" n6 v. w& }8 |& {$ B也有可能是command file寫錯1 V1 i- |7 Q* X4 Z7 F
看看command file裡element res[?]是如何定義
/ [3 f- w5 i) J再回頭檢視Layout,這樣會比較快唷!
6#
發表於 2009-5-25 15:50:47 | 只看該作者
我猜也是少蓋dummy層
5 s& I( U( n0 h; I7 P* W查看一下command file
7#
發表於 2009-5-27 09:14:58 | 只看該作者
ex. n+ poly res W=1um  L=10um 1 \1 f$ F6 X8 ?9 f
1.首先 劃一個 w=1um L=12um poly 矩形 再加上 n+ imp 覆蓋 整各 poly
1 U8 Z8 ?1 F- d8 I) r   即 poly  在 整個  n+ imp9 c9 C# W  ?: g0 S
2.再2端多出來ㄉ地方 加上 cont 和 metal 1 keep cont 間隔 10um6 X" A% Q) _  s* X/ U  c
3.加上 RP_DMY 在cont 間 包附整個poly 即 RP_DMY w=1 um L=10um" z( ^1 V" @4 ~/ F( p$ P
4.跑DRC LVS --- >完成$ J: ?6 @: }% v- H4 U
通常會有 一個 layer 層用來 辨識 電阻 看你所用的 command file, u; N* f# J3 \
有加 RP_DMY 的 poly 才會被當成電阻2 l2 e$ G% R8 v# d
而cont & metal 1  是用來當電阻2端的接點
- i8 j- v. U9 i( K2 w接線用, 這樣看董ㄌ, 再去看講義,應該就能懂其他電阻的 lay 法ㄌ
8#
發表於 2009-6-1 14:10:23 | 只看該作者
應該Design rule都會有寫: {1 I& r% D* h$ x8 r
然後你畫電阻的話要注意1 v& U5 ]  H! |" f! P4 q( V
他LVS是從R_DMY所畫到的範圍來判定電阻值( z. a, b) n" m$ p2 ?
電容的話你除了計算面電容還要考慮線電容
  t6 M2 ?) h6 f% Z/ ]* \當然最後看你command file裡面誤差設定多少 如果是0的話很難畫到完全精準
9#
 樓主| 發表於 2010-5-24 01:55:27 | 只看該作者
感謝大家的回應,我直接用叫的了  u5 C2 d+ J! ]1 t/ A- y# n
竟然忘了電容可以用叫的了
10#
發表於 2010-5-24 07:17:45 | 只看該作者
回復 9# e2000 : H9 J  C" }$ k$ k8 X/ Y

2 e$ O  f; @" Y3 c2 r0 V, L4 O! a# a# U1 I  [3 K4 i9 [- x
    這樣你就學不到東西了....
11#
發表於 2015-10-9 10:06:30 | 只看該作者
要看design rule才知道要怎麼畫吧
12#
發表於 2021-4-28 20:44:09 | 只看該作者
需要更多這方面知識  感謝提供
13#
發表於 2021-8-23 17:12:57 | 只看該作者
感謝大大無私的分享!!!!!
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