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[問題求助] 請問layout電阻電容畫法

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1#
發表於 2009-5-9 03:01:25 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
因為太新手無法看置頂的電阻電容畫法所以來求助,最近畫layout電阻試過了CIC所寫的三種電阻畫法,但是LVS就是找不到& b6 A4 ?( C5 e4 Q- p' F% e' m
他就是poly,DIFF,NWELL三種,但是我照著話就是LVS不出來,有沒有高手能把電阻的畫法一步一步的解開呢?書上講義都是把已經畫好的電阻放上去然後用箭頭指著說這是poly,這是Nwell,但是有些重疊的部份根本不知道那是什麼東西之間的重疊,不然就是外圍用虛線包住一個蛇形狀的東西並露出兩個頭,但是就是沒有寫那兩個頭裡面是什麼組成的,外表看起來就像是NWELL包住蛇形POLY,但是照著跑根本就跑不出來,因為根本不知道蛇形poly上面有加上什麼東西,要不然就是標示著電阻標示層畫法需和command file配合,淡是到底要怎樣才能弄出電阻標示層還有如何配合command file?請高手幫小弟解題,感激不盡。
. {, ^4 a0 z  \至於電容更是看不清楚了,一塊正方形然後一堆箭頭指向裡面說這是什麼什麼,但是根本不知道那是怎麼組合成的,也不知道哪塊要大哪塊要小...
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2#
發表於 2009-5-12 09:16:24 | 只看該作者
你要看製程廠的 rule file 他有寫 每家不同
/ r5 D9 z% o4 }7 [5 s而畫的規格 W L 要看rd設計   $ E0 O  r& g: X4 r$ D( m* k
像大電阻就是由一堆小電阻串連而成  怕失真
3#
發表於 2009-5-12 09:31:10 | 只看該作者
像POLY 電阻 - t$ y- s" B2 A/ u! Q& V* _1 F3 ]  G
最基本的就是 電流 從 CONTACT 進去 POLY  另一端CONTACT 出來 要包其他層 要看製程和RD
' s( _' \- ]3 [' D' [; }1 n$ z; L; R$ d
它跟電路學的 電阻公式一樣  越長L 電阻越大  越寬A電阻會被整除
$ S. H" f- i+ U8 i3 b, u' k: m" J  c7 b$ k" M' {
電阻率的科學符號為 ρ 。* {4 {1 i6 N5 j

$ s3 M3 v% w7 ~6 a" m已知物體的電阻,可由電阻率ρ、長度 l 與截面面積 A 計算:5 t4 j6 j% w; s5 ~( A

8 U* W5 a( ?2 f! d6 Z R =  ρ  L/A& \" [& ?% u$ ]
; V9 v! J$ L4 t( W2 M- X, d1 v7 _/ H
電阻 R 單位為歐姆
1 m" l- m% R7 B. r; D3 s: C! _. [2 G長度 l 單位為米
8 L" Y7 h1 p. u8 D截面面積 A 單位為平方米 . i* y7 F8 d6 `$ \
電阻率 ρ 單位為歐姆·米
4#
發表於 2009-5-13 10:05:39 | 只看該作者
可以看command file裡面的敘述 會有跟你講要蓋那些layer(在最上面 or 用找低)
! x, v0 U1 M9 T! X1 r或是看design rule 也有
$ ?4 V0 v( }$ Z' b  o$ I  Q  H* c% P& w' j
我猜可能是少蓋了RPO  和 電阻的dummy層吧(RPDMY....等)
% v; o  t) R. A7 w0 E要自己讀一下唷
$ Y6 Y9 E# a1 y; h
% F+ N( C4 a" H! R- P, l希望能幫到你
5#
發表於 2009-5-19 17:37:20 | 只看該作者
LVS認不到,不一定是Layout錯誤* C0 D: c. S* j' P
也有可能是command file寫錯6 l3 i4 T. b4 I% r
看看command file裡element res[?]是如何定義
; w% w! T) V, v2 W2 ~, y7 e再回頭檢視Layout,這樣會比較快唷!
6#
發表於 2009-5-25 15:50:47 | 只看該作者
我猜也是少蓋dummy層
+ N- d: P6 t  Y% c查看一下command file
7#
發表於 2009-5-27 09:14:58 | 只看該作者
ex. n+ poly res W=1um  L=10um 9 L4 P4 x* j: t# {! x
1.首先 劃一個 w=1um L=12um poly 矩形 再加上 n+ imp 覆蓋 整各 poly4 z) ]- f/ `; I+ C* J. F
   即 poly  在 整個  n+ imp
" y, n5 }) i, J, |( R+ b2.再2端多出來ㄉ地方 加上 cont 和 metal 1 keep cont 間隔 10um
+ m1 c' u8 t* x$ G3.加上 RP_DMY 在cont 間 包附整個poly 即 RP_DMY w=1 um L=10um
" s% u  k" _$ N+ I7 k, e; x4.跑DRC LVS --- >完成
9 k; Q; g7 H8 G* \4 e" S% I通常會有 一個 layer 層用來 辨識 電阻 看你所用的 command file
2 u# z; a1 _. A9 f: Z有加 RP_DMY 的 poly 才會被當成電阻
+ B8 I" @$ c3 n  J, \而cont & metal 1  是用來當電阻2端的接點) m( z3 y% E' s) \8 T! G
接線用, 這樣看董ㄌ, 再去看講義,應該就能懂其他電阻的 lay 法ㄌ
8#
發表於 2009-6-1 14:10:23 | 只看該作者
應該Design rule都會有寫
% O5 S) L9 K  @2 u然後你畫電阻的話要注意
& ]8 t; K: h- K9 S7 t, P他LVS是從R_DMY所畫到的範圍來判定電阻值
6 r5 F  ]8 s; y+ v* M" h; r電容的話你除了計算面電容還要考慮線電容3 N( n1 m* q7 p+ z3 h
當然最後看你command file裡面誤差設定多少 如果是0的話很難畫到完全精準
9#
 樓主| 發表於 2010-5-24 01:55:27 | 只看該作者
感謝大家的回應,我直接用叫的了7 @9 ^; H+ q6 n# ~
竟然忘了電容可以用叫的了
10#
發表於 2010-5-24 07:17:45 | 只看該作者
回復 9# e2000 . g- n) ]% L: N1 P; N% h
: v" c2 m& R% k4 i6 j2 {( I4 c& _
: f) X+ C7 [0 V% g2 y5 b
    這樣你就學不到東西了....
11#
發表於 2015-10-9 10:06:30 | 只看該作者
要看design rule才知道要怎麼畫吧
12#
發表於 2021-4-28 20:44:09 | 只看該作者
需要更多這方面知識  感謝提供
13#
發表於 2021-8-23 17:12:57 | 只看該作者
感謝大大無私的分享!!!!!
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