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[問題求助] 請問layout電阻電容畫法

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1#
發表於 2009-5-9 03:01:25 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
因為太新手無法看置頂的電阻電容畫法所以來求助,最近畫layout電阻試過了CIC所寫的三種電阻畫法,但是LVS就是找不到2 Q; V$ A/ k$ P/ S+ h
他就是poly,DIFF,NWELL三種,但是我照著話就是LVS不出來,有沒有高手能把電阻的畫法一步一步的解開呢?書上講義都是把已經畫好的電阻放上去然後用箭頭指著說這是poly,這是Nwell,但是有些重疊的部份根本不知道那是什麼東西之間的重疊,不然就是外圍用虛線包住一個蛇形狀的東西並露出兩個頭,但是就是沒有寫那兩個頭裡面是什麼組成的,外表看起來就像是NWELL包住蛇形POLY,但是照著跑根本就跑不出來,因為根本不知道蛇形poly上面有加上什麼東西,要不然就是標示著電阻標示層畫法需和command file配合,淡是到底要怎樣才能弄出電阻標示層還有如何配合command file?請高手幫小弟解題,感激不盡。3 x! I( O( ~( V( a: Y0 f, B( U
至於電容更是看不清楚了,一塊正方形然後一堆箭頭指向裡面說這是什麼什麼,但是根本不知道那是怎麼組合成的,也不知道哪塊要大哪塊要小...
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2#
發表於 2009-5-12 09:16:24 | 只看該作者
你要看製程廠的 rule file 他有寫 每家不同) S, r: @8 ?  [8 _: k2 L
而畫的規格 W L 要看rd設計   # j2 y. w" W7 A2 l' p% C
像大電阻就是由一堆小電阻串連而成  怕失真
3#
發表於 2009-5-12 09:31:10 | 只看該作者
像POLY 電阻
% F! w2 V  C; [4 u* \! K最基本的就是 電流 從 CONTACT 進去 POLY  另一端CONTACT 出來 要包其他層 要看製程和RD - c3 v" Y4 v! ~/ ]/ Q) B. e

# n  C! |$ k( G: u* a它跟電路學的 電阻公式一樣  越長L 電阻越大  越寬A電阻會被整除
  K2 t! P- B; P3 |0 Y4 k9 C  a( _4 _, B1 m
電阻率的科學符號為 ρ 。
3 I3 l9 U' P$ a9 z4 J$ Q3 M
. H& c8 }! T$ u6 b& g% F+ ], a已知物體的電阻,可由電阻率ρ、長度 l 與截面面積 A 計算:* H; }2 D8 x, ^' k
7 Z& a  w7 O* G% w* S
R =  ρ  L/A* A2 `* t% g6 }; J% E' G

6 ~. n: X: n/ O$ {電阻 R 單位為歐姆 * z7 a" Z5 l! L1 N7 t2 A
長度 l 單位為米
* p. D% S7 P% H$ U3 H9 P截面面積 A 單位為平方米 # I& u. c4 f0 E) p; b
電阻率 ρ 單位為歐姆·米
4#
發表於 2009-5-13 10:05:39 | 只看該作者
可以看command file裡面的敘述 會有跟你講要蓋那些layer(在最上面 or 用找低)2 M) B) |( o1 g
或是看design rule 也有
3 z/ [  Y9 I+ V; i5 Z3 B3 N/ h! U& w# s1 H: n
我猜可能是少蓋了RPO  和 電阻的dummy層吧(RPDMY....等)* K) C3 \5 L2 {9 h8 f
要自己讀一下唷6 H5 n# B8 {) g; h/ {: A& X

' J% B0 ^& o9 }2 n希望能幫到你
5#
發表於 2009-5-19 17:37:20 | 只看該作者
LVS認不到,不一定是Layout錯誤
! Z* W6 n0 |; Y1 X/ u也有可能是command file寫錯: }! [' k3 \' s! u! w
看看command file裡element res[?]是如何定義+ X1 C% `, @# \9 x6 B! ^
再回頭檢視Layout,這樣會比較快唷!
6#
發表於 2009-5-25 15:50:47 | 只看該作者
我猜也是少蓋dummy層
& ^1 o! f( F! k8 a查看一下command file
7#
發表於 2009-5-27 09:14:58 | 只看該作者
ex. n+ poly res W=1um  L=10um 3 `4 A0 w- e8 j7 [* E
1.首先 劃一個 w=1um L=12um poly 矩形 再加上 n+ imp 覆蓋 整各 poly
7 f' Z, M0 t9 J$ [; V5 N   即 poly  在 整個  n+ imp4 |$ |( V4 V, l
2.再2端多出來ㄉ地方 加上 cont 和 metal 1 keep cont 間隔 10um
4 R; y9 @4 A0 S9 Y5 t3.加上 RP_DMY 在cont 間 包附整個poly 即 RP_DMY w=1 um L=10um( I1 \1 j  h% H8 ^+ i4 ~
4.跑DRC LVS --- >完成+ ~8 D; `% v& b, [5 I. I7 H, b6 k
通常會有 一個 layer 層用來 辨識 電阻 看你所用的 command file: y2 X. v2 h- u& t
有加 RP_DMY 的 poly 才會被當成電阻( d- s( c$ L1 h& a
而cont & metal 1  是用來當電阻2端的接點
( q- _" [% w. {8 i9 W接線用, 這樣看董ㄌ, 再去看講義,應該就能懂其他電阻的 lay 法ㄌ
8#
發表於 2009-6-1 14:10:23 | 只看該作者
應該Design rule都會有寫8 f4 y; S" Z+ R. Q) x, G! v
然後你畫電阻的話要注意
0 M1 {" s6 c2 M  N) q他LVS是從R_DMY所畫到的範圍來判定電阻值1 X( |& z. X; ~- s# r) [! F
電容的話你除了計算面電容還要考慮線電容
% [  v0 ]% P- Z當然最後看你command file裡面誤差設定多少 如果是0的話很難畫到完全精準
9#
 樓主| 發表於 2010-5-24 01:55:27 | 只看該作者
感謝大家的回應,我直接用叫的了4 K% e6 i7 W* o& r5 s1 g0 x
竟然忘了電容可以用叫的了
10#
發表於 2010-5-24 07:17:45 | 只看該作者
回復 9# e2000 5 c0 t0 x( v$ Q$ D- N! X

: [' ], N" k# v! q
! f5 y7 g' V/ i% G; i$ B    這樣你就學不到東西了....
11#
發表於 2015-10-9 10:06:30 | 只看該作者
要看design rule才知道要怎麼畫吧
12#
發表於 2021-4-28 20:44:09 | 只看該作者
需要更多這方面知識  感謝提供
13#
發表於 2021-8-23 17:12:57 | 只看該作者
感謝大大無私的分享!!!!!
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