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[問題求助] 請問layout電阻電容畫法

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1#
發表於 2009-5-9 03:01:25 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
因為太新手無法看置頂的電阻電容畫法所以來求助,最近畫layout電阻試過了CIC所寫的三種電阻畫法,但是LVS就是找不到0 `9 a$ r% A3 a3 c/ D" }; u
他就是poly,DIFF,NWELL三種,但是我照著話就是LVS不出來,有沒有高手能把電阻的畫法一步一步的解開呢?書上講義都是把已經畫好的電阻放上去然後用箭頭指著說這是poly,這是Nwell,但是有些重疊的部份根本不知道那是什麼東西之間的重疊,不然就是外圍用虛線包住一個蛇形狀的東西並露出兩個頭,但是就是沒有寫那兩個頭裡面是什麼組成的,外表看起來就像是NWELL包住蛇形POLY,但是照著跑根本就跑不出來,因為根本不知道蛇形poly上面有加上什麼東西,要不然就是標示著電阻標示層畫法需和command file配合,淡是到底要怎樣才能弄出電阻標示層還有如何配合command file?請高手幫小弟解題,感激不盡。3 z3 A" ^2 h8 Y0 z  N3 s8 G
至於電容更是看不清楚了,一塊正方形然後一堆箭頭指向裡面說這是什麼什麼,但是根本不知道那是怎麼組合成的,也不知道哪塊要大哪塊要小...
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2#
發表於 2009-5-12 09:16:24 | 只看該作者
你要看製程廠的 rule file 他有寫 每家不同
! C5 P; D  R/ A! ~而畫的規格 W L 要看rd設計   9 N- K& X2 h! U* G/ n" C' c
像大電阻就是由一堆小電阻串連而成  怕失真
3#
發表於 2009-5-12 09:31:10 | 只看該作者
像POLY 電阻 : D3 N8 {+ l" s' x. d- L* _" s; i
最基本的就是 電流 從 CONTACT 進去 POLY  另一端CONTACT 出來 要包其他層 要看製程和RD # q) h, ~1 X; d: H0 Y
$ y0 h* O9 J2 }" K( i
它跟電路學的 電阻公式一樣  越長L 電阻越大  越寬A電阻會被整除$ C( d& d% i7 ]2 w+ N' y
6 u* k: a* }+ l6 f/ b" h; L
電阻率的科學符號為 ρ 。6 F/ L* ^7 `/ s

0 a% m" w" p$ o$ D) ?) `6 z3 N已知物體的電阻,可由電阻率ρ、長度 l 與截面面積 A 計算:: M7 q0 z' G8 Q, u+ G& v
( W# f& y, M0 o+ E
R =  ρ  L/A$ t/ l- y, p/ A: f
/ t* A5 k. C( w' m
電阻 R 單位為歐姆
$ @! l! i7 {& F( W" z長度 l 單位為米 ) p  D8 E& |7 x9 W
截面面積 A 單位為平方米
, n% u- H" M* ]2 m. {電阻率 ρ 單位為歐姆·米
4#
發表於 2009-5-13 10:05:39 | 只看該作者
可以看command file裡面的敘述 會有跟你講要蓋那些layer(在最上面 or 用找低)
5 z2 c- m4 ]9 H, i或是看design rule 也有
$ |: E7 U9 Z* U- Z' v+ i
* d. W% g, t' ?" m* ?& T我猜可能是少蓋了RPO  和 電阻的dummy層吧(RPDMY....等)
9 k: H# c6 `" i, q" N9 s4 z要自己讀一下唷$ p6 I# g0 y5 j! i" ?9 H; p

! J/ A$ ?: }/ v# R希望能幫到你
5#
發表於 2009-5-19 17:37:20 | 只看該作者
LVS認不到,不一定是Layout錯誤/ {- [8 t1 h4 l; |* P8 l
也有可能是command file寫錯
* `( N9 Y& w8 z  I看看command file裡element res[?]是如何定義, G1 g7 h" Z* N
再回頭檢視Layout,這樣會比較快唷!
6#
發表於 2009-5-25 15:50:47 | 只看該作者
我猜也是少蓋dummy層
* \$ `  P0 }# N' z查看一下command file
7#
發表於 2009-5-27 09:14:58 | 只看該作者
ex. n+ poly res W=1um  L=10um
1 t, l; ^: b6 l1.首先 劃一個 w=1um L=12um poly 矩形 再加上 n+ imp 覆蓋 整各 poly
0 l) M1 k3 a! @7 R  m) }! b5 b6 A/ K, l$ l   即 poly  在 整個  n+ imp) d& X# D# Y  U4 ]1 j
2.再2端多出來ㄉ地方 加上 cont 和 metal 1 keep cont 間隔 10um# x1 l' W6 P; K+ X! d1 F
3.加上 RP_DMY 在cont 間 包附整個poly 即 RP_DMY w=1 um L=10um
3 @& y/ t7 O. r: |4.跑DRC LVS --- >完成
; q" A* r& x4 e! Z  [通常會有 一個 layer 層用來 辨識 電阻 看你所用的 command file
0 H3 `! V+ d& g4 {4 \) r有加 RP_DMY 的 poly 才會被當成電阻
7 k, s% `% |) e; n/ J0 u  ^而cont & metal 1  是用來當電阻2端的接點0 B- V, P6 X1 G+ W3 {4 E/ O: }4 m4 t- Q
接線用, 這樣看董ㄌ, 再去看講義,應該就能懂其他電阻的 lay 法ㄌ
8#
發表於 2009-6-1 14:10:23 | 只看該作者
應該Design rule都會有寫9 c5 c  g6 I3 a# v+ O& f. o5 Y! E
然後你畫電阻的話要注意
+ S- I7 l1 ~0 l, J1 d2 k他LVS是從R_DMY所畫到的範圍來判定電阻值
& E* \( d; z- A, k+ M電容的話你除了計算面電容還要考慮線電容, o' V0 [( E+ A
當然最後看你command file裡面誤差設定多少 如果是0的話很難畫到完全精準
9#
 樓主| 發表於 2010-5-24 01:55:27 | 只看該作者
感謝大家的回應,我直接用叫的了
8 n* C5 B: v, K竟然忘了電容可以用叫的了
10#
發表於 2010-5-24 07:17:45 | 只看該作者
回復 9# e2000
7 `: e0 Z$ k/ L- d% s- \& g6 O9 S6 ~+ U0 h2 j

7 e3 U. L; y  i$ l    這樣你就學不到東西了....
11#
發表於 2015-10-9 10:06:30 | 只看該作者
要看design rule才知道要怎麼畫吧
12#
發表於 2021-4-28 20:44:09 | 只看該作者
需要更多這方面知識  感謝提供
13#
發表於 2021-8-23 17:12:57 | 只看該作者
感謝大大無私的分享!!!!!
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