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[問題求助] 請問layout電阻電容畫法

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1#
發表於 2009-5-9 03:01:25 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
因為太新手無法看置頂的電阻電容畫法所以來求助,最近畫layout電阻試過了CIC所寫的三種電阻畫法,但是LVS就是找不到$ f% }% |$ g0 f: B3 p
他就是poly,DIFF,NWELL三種,但是我照著話就是LVS不出來,有沒有高手能把電阻的畫法一步一步的解開呢?書上講義都是把已經畫好的電阻放上去然後用箭頭指著說這是poly,這是Nwell,但是有些重疊的部份根本不知道那是什麼東西之間的重疊,不然就是外圍用虛線包住一個蛇形狀的東西並露出兩個頭,但是就是沒有寫那兩個頭裡面是什麼組成的,外表看起來就像是NWELL包住蛇形POLY,但是照著跑根本就跑不出來,因為根本不知道蛇形poly上面有加上什麼東西,要不然就是標示著電阻標示層畫法需和command file配合,淡是到底要怎樣才能弄出電阻標示層還有如何配合command file?請高手幫小弟解題,感激不盡。4 K% f# D/ b/ E+ x3 N6 \
至於電容更是看不清楚了,一塊正方形然後一堆箭頭指向裡面說這是什麼什麼,但是根本不知道那是怎麼組合成的,也不知道哪塊要大哪塊要小...
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2#
發表於 2009-5-12 09:16:24 | 只看該作者
你要看製程廠的 rule file 他有寫 每家不同' H% \5 j( x$ U. m! j
而畫的規格 W L 要看rd設計   
7 P3 B: @+ e! P; ]  k/ M! @像大電阻就是由一堆小電阻串連而成  怕失真
3#
發表於 2009-5-12 09:31:10 | 只看該作者
像POLY 電阻 0 f& e/ n( p; z6 J% ~% P/ D* t* g# d
最基本的就是 電流 從 CONTACT 進去 POLY  另一端CONTACT 出來 要包其他層 要看製程和RD - v# [6 a  c; u. D6 y0 p
' h: ?& ]" Z/ L- ?
它跟電路學的 電阻公式一樣  越長L 電阻越大  越寬A電阻會被整除6 u1 C, ~3 Z7 p

, V0 H  r) F! w+ Y2 g5 o4 C; R8 V/ a電阻率的科學符號為 ρ 。
5 a* C; e1 Y9 g+ r7 o! y+ _$ o+ G- }/ }" P$ \
已知物體的電阻,可由電阻率ρ、長度 l 與截面面積 A 計算:
7 h. F0 R$ O4 ^5 k! r; w& h6 T" q# [) @+ q8 R2 X4 Z
R =  ρ  L/A1 B& ^9 A) U1 j' N

, t. v1 K' K( v' m電阻 R 單位為歐姆 " }8 G$ R/ X. \
長度 l 單位為米
) e( ?1 [* R0 q7 `: A截面面積 A 單位為平方米 & t, L! G9 B+ p' Y' Z
電阻率 ρ 單位為歐姆·米
4#
發表於 2009-5-13 10:05:39 | 只看該作者
可以看command file裡面的敘述 會有跟你講要蓋那些layer(在最上面 or 用找低)2 V; L6 l) M+ S9 |6 b
或是看design rule 也有
: ^2 s: |, W' W( c' _- j( M! a
4 K* o" _8 [  g我猜可能是少蓋了RPO  和 電阻的dummy層吧(RPDMY....等)
4 n, q5 h: L+ ~! D& @/ i要自己讀一下唷- |+ I8 K0 c' A( P
# e' Z% U: E/ e* l  R; F
希望能幫到你
5#
發表於 2009-5-19 17:37:20 | 只看該作者
LVS認不到,不一定是Layout錯誤; o/ n4 n6 `2 C2 W& ~8 A3 Z
也有可能是command file寫錯3 S" h, ?8 p* U2 Z- f6 B; l2 b3 H1 g
看看command file裡element res[?]是如何定義" W0 s$ @4 V5 Y; l1 ?% W1 _
再回頭檢視Layout,這樣會比較快唷!
6#
發表於 2009-5-25 15:50:47 | 只看該作者
我猜也是少蓋dummy層4 W+ H; E" u8 t9 ]( Q
查看一下command file
7#
發表於 2009-5-27 09:14:58 | 只看該作者
ex. n+ poly res W=1um  L=10um
+ J5 m+ G/ F% r, A5 I1.首先 劃一個 w=1um L=12um poly 矩形 再加上 n+ imp 覆蓋 整各 poly  d! a; w+ [; Y( H
   即 poly  在 整個  n+ imp
+ J/ n4 l2 ~, R* g: x# O- P2.再2端多出來ㄉ地方 加上 cont 和 metal 1 keep cont 間隔 10um
! O; U! \0 v+ u* ~$ c$ A* d4 v' m, Z3.加上 RP_DMY 在cont 間 包附整個poly 即 RP_DMY w=1 um L=10um6 \4 t7 j1 ~1 U0 y+ n$ `' y
4.跑DRC LVS --- >完成2 u* `8 x& @+ q9 X" `6 J: D
通常會有 一個 layer 層用來 辨識 電阻 看你所用的 command file
) {# m4 X6 b4 J1 F有加 RP_DMY 的 poly 才會被當成電阻
6 x9 `; g% Z6 e而cont & metal 1  是用來當電阻2端的接點
$ V9 \3 X: F! [接線用, 這樣看董ㄌ, 再去看講義,應該就能懂其他電阻的 lay 法ㄌ
8#
發表於 2009-6-1 14:10:23 | 只看該作者
應該Design rule都會有寫
3 L( {- v( ?- T然後你畫電阻的話要注意
2 z6 q/ _8 C0 x4 T/ G0 B' @2 l/ Z他LVS是從R_DMY所畫到的範圍來判定電阻值
0 H. V5 o; a* I' q0 U電容的話你除了計算面電容還要考慮線電容  K( ?4 m  a! v- Z  w8 Y2 L  f
當然最後看你command file裡面誤差設定多少 如果是0的話很難畫到完全精準
9#
 樓主| 發表於 2010-5-24 01:55:27 | 只看該作者
感謝大家的回應,我直接用叫的了
' |2 [6 a/ L6 d( ?& l: [竟然忘了電容可以用叫的了
10#
發表於 2010-5-24 07:17:45 | 只看該作者
回復 9# e2000 . y; ?8 r; I% F

6 G) V2 e. ~  m% F9 o& W- @0 |7 o: H0 h7 q6 j
    這樣你就學不到東西了....
11#
發表於 2015-10-9 10:06:30 | 只看該作者
要看design rule才知道要怎麼畫吧
12#
發表於 2021-4-28 20:44:09 | 只看該作者
需要更多這方面知識  感謝提供
13#
發表於 2021-8-23 17:12:57 | 只看該作者
感謝大大無私的分享!!!!!
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