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eASIC Chip 價格僅為現有FPGA ( Xilinx/Altera) 一半, eASIC Chip無須Mask 光罩費用

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1#
發表於 2009-1-10 16:39:59 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
eASIC公司的新一代結構化 ASIC中的技術既可以幫助FPGA COST DOWN,也可以使原有ASIC需要一筆費用的NRE 節省。 eASIC Chip 價格僅為現有FPGA ( Xilinx/Altera) 一半, eASIC Chip無須Mask 光罩費用
9 F/ K  f8 p! Z9 p, z, wNextreme系列無NRE 90nm結構化ASIC器件是eASIC的一組創新型產品,結構化ASIC是一種可配置邏輯陣列,具有類似ASIC的性能、功耗和較低的單位成本,以及類似FPGA的靈活性、較短的周轉時間和無NRE的特點,可實現新一代低單位成本、高性能ASIC。從樣機階段到中高批量生產,Nextreme所採用的技術可以避免產生任何相關的固定製造成本,使新設計不存在風險。
" O$ _2 N6 ~; y: s6 ZNextreme的優點:
0 c3 k1 C2 _, s" D: v
# |, _; I% W  K+ p: j2 f: z1.無NRE與ASIC類似的單位成本   2.周轉速度快2 L7 ?' x! D7 f' e: @
3.無最低數量限制                         4.與ASIC類似的性能
, F7 ?$ X( Y! }6 L6 B' g5.與ASIC類似的密度                    6.與ASIC類似的功耗7 D' m9 v9 S1 m

$ U8 v! b, U6 ^ 8 A# l" o" t) w9 H* u1 X
6 Q9 ?9 Y+ ^* n

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2#
 樓主| 發表於 2009-1-10 17:11:13 | 只看該作者
如須eASIC 更多資料查詢,請參考以下或與亞矽科技886-2-8752-5858 Peter聯絡6 X3 d- D  m5 ^0 V; I
eASIC 部落格: FPGA and ASIC cost down solution
' @5 L5 Y% M& M" ~) E. o部落格 http://tw.myblog.yahoo.com/easic007/- }  `. p# Q6 L* K" h5 v& D
http://www.easic.com
+ U; y. Q9 f6 g& K7 J& ^' nhttp://www.easic.com/cn/' \  k5 D' J" @& A: ^! @# H& G0 ~
3#
 樓主| 發表於 2009-1-14 18:33:55 | 只看該作者

如何去比較 FPGA的容量與eASIC 的eCELL ?

保守估計,一個eCell大約相當於一個FPGA的Logic cell 或者是Logic element,這也是Nextreme產品最基本的邏輯結構。一個ecell主要包含兩個3輸入查找表(LUTs),一對2輸入NAND gate,一個2輸入multiplexer,一個DFF,三個inverting buffers和一個three-state buffer。
4#
 樓主| 發表於 2009-1-23 09:04:40 | 只看該作者
eASIC  Low power ! Low power !Low power !1 E1 e& F7 U+ e8 a/ z' N( y$ \- a
           Low  cost! Low Cost ! Low Cost !            
# Z4 V4 G" a9 ]: Q, G- E

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5#
 樓主| 發表於 2009-2-12 10:46:23 | 只看該作者

SOC (system-on-chip) Diamond Standard processor family--for eASIC Chip IP Free

SOC (system-on-chip) Diamond Standard processor family--for eASIC Chip IP Free $ m: x& W  r% x1 r
Diamond Standard Processor Cores " K$ j$ l4 J6 t/ P
  7 s  r' x+ x) ~+ b% u
Tensilica’s Diamond Standard Processor core family consists of 7 ready-to-use cores are now available “Free of Charge” to eASIC customers. These cores range from area-efficient, low-power controllers to the industry’s highest performance licensable DSP and popular audio processor. The Diamond Standard Processor core family covers a very broad range of performance/power options. The Diamond Standard processor core family is based on Tensilica’s highly efficient Xtensa configurable and extensible processor architecture, proven in hundreds of SOC (system-on-chip) designs.
9 O# y1 z: j5 X. f Reference website  http://www.easic.com/index.php?p=nextreme_tensilica
# ~, K" i) x, Q1 UControllers 106Micro The industry’s smallest, lowest power 32-bit RISC controller  + `+ E9 m% x( n: W+ d9 ~6 A# H
108Mini A low-power RISC controller with built-in DSP capabilities
( Z' \. ]9 O) x) A3 D  k4 R* ~3 _212GP A flexible mid-range RISC controller with flexible memory choices $ b0 e4 P' x/ ]" N8 U! T
CPUs 232L A mid-range CPU with Memory Management Unit (MMU) for Linux OS support
4 j: G6 |8 d8 T7 R# i570T A high-end CPU core with twice the performance of an ARM 11 (based on EEMBC benchmarks) 2 l; e6 X; _6 m* u$ G( n
DSPs 330HiFi A low-power, 24-bit audio processor supported with popular audio and speech codecs 5 k: r2 J2 f$ B- u
545CK The highest performance, most efficient licensable DSP core
6#
發表於 2009-3-5 11:09:07 | 只看該作者
原來台灣的代理商是你們哦!+ p2 c! N+ n- o6 G. a9 ?
eASIC我也注意了好久說...
7#
發表於 2009-3-5 11:22:14 | 只看該作者
對了, 本論壇並不反對上來打廣告, 但是希望打廣告之餘也提供些新知來造福一些其他的讀者
. b& A% U. P, \- n; B; R
2 C. }: N: u4 k$ O1 Q  s  f例如你可以討論一下eASIC的LUT架構共比較跟現有FPGA的差異之類的, - ~0 T6 u: L# _6 u. Y8 B
使用Laser來修改metal的技術5 W5 d: z& O. R
或其他更多的訊息
+ `, z! Z6 n6 S" p0 Q# h" o7 B" @' Z
十分感謝
8#
 樓主| 發表於 2009-3-11 07:05:42 | 只看該作者

eASIC eCore & LUT 架構


/ h* Z; Y, F  X  @6 a8 WeASIC早在2006年已經推出90nm的結構化ASIC產品Nextreme。與其他結構化ASIC不同之處在於,只要用單一 * a" Q& `/ Q, S+ q, Z' \& u- h
過孔層就可實現各種設計電路的定制。對所有的設計而言,從矽片到每層金屬層都是通用的,唯一不同的是一 " I( Z  k1 p' n7 ^
層過孔Via6。 ?由於這一過孔層可直接用激光束打造(請參考eASC 網站詳細說明http://www.easic.com/cn/index.php?p=technology)
* j5 V. y7 }; c9 B' Q& [9 p; b- [$ n實現無掩模定製樣片,處理時間快了10倍。因而無需 NRE費用,樣片時間縮短到4週。; T9 [# f) S2 z/ K3 j8 R- \
在短短1年半時間內,eASIC就完成了120多個項目設計。令人驚訝的是,在90nm Nextreme ASIC產品快速成功的基礎上,4 u: u. C' c2 E' u# J9 h7 v& T
eASIC跳過了65nm直接奔向45nm,2008年8月4日發布了其45nm產品Nextreme-2,站在了業界的前列。
/ ?5 _8 v( v! c' S5 e6 G% d; y在45nm結構化ASIC產品Nextreme-2系列中,eASIC基本保持了第二代產品中的全金屬佈線,單一過孔編
: g8 ]0 m$ L/ u. }% D) e6 \4 z程定制的體系,只是將這一定製過孔層從第6層調整到了第4層。但在架構上、基本邏輯單元eCell的顆粒結 7 u; L6 r; @  v: Q& L; x8 g
構上和周邊的資源配置上做了重大改進。 $ ^8 E! H+ O  a5 W# y

( L6 d6 ]* D9 G) n$ d; M% P- q2 j- SeASIC改良了查找表(LUT)的結構以進一步提供速度、降低功耗。摒棄了原有基於SRAM的查找表LUT結
7 s: Z/ k- M" b1 m8 Y. v構,改用可編程過孔Via接地或者接Vcc來替代SRAM的輸出。此外,還省去了LUT第一級的開關晶體管,
9 h/ l3 F. P3 B9 K6 b如圖所示。因此省掉了大量的晶體管。大大降低了靜態洩漏,提高了開關速度,使效率達到了最高。在同樣的 9 Z2 u" O1 |' ]$ \3 H
工藝水平中,洩漏可以減少12%,速度提高17%,面積減少40%。與前一代90nm產品相比,靜態洩漏減
# c# F& ]1 U( P少了50%,動態功耗降低70%,延遲縮短了45%。此外,通過過孔編程,切斷芯片內部閒置的單元和存儲器 & Y" u' H/ x/ Q& u/ Q/ V5 W0 l
的供電,還採取時鐘選通控制睡眠模式、動態功率管理。 Nextreme-2與最新工藝的FPGA相比,由於結合了三重氧 # E$ U+ M1 k  B9 D  a' |, K8 y
化層晶體管、45nm低功耗工藝和eASIC專利的功率管理結構, Nextreme-2的功耗可以降低80%以上。 6 a( Y5 w9 C0 s; x/ E& u& N
Nextreme-2系列還嵌入了硬IP Core,包含多達56條MGIO (多G比特輸入輸出口)。每條IO都能工作在 ) F% A) K4 {6 p" _
6.5Gbps,總計提供364Gbps帶寬。在高性能網絡應用中,如交換機、路由器、流量管理、城域網傳輸設備 # W9 g+ m: U, j6 Y+ j9 _
和移動回程設備,由於具備MGIO (多G比特輸入輸出口),Nextreme-2將成為FPGAs和ASICs之外最 5 V2 D' _4 f5 A! r0 }5 w. v. x
佳的選擇。

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9#
發表於 2009-3-11 09:53:46 | 只看該作者
大陸用語,看不懂, ICKELL有點隨便喔,這樣子不太有興趣看下去。
10#
 樓主| 發表於 2009-3-11 13:03:57 | 只看該作者
Maskless Lithography – NRE-free Alternative for Deep-submicron ASICs & q7 i  t: _' E/ @% H
    eASIC’s innovative use of LUT-based logic programming combined with single via layer customizable routing makes its technology an ideal candidate for maskless lithography using Direct-Write eBeam customization. Because all of the interconnect customization is performed on a single via layer (Via 6), routing customization can be performed efficiently by eBeam, eliminating the need for costly lithography masks.
" j$ X; z6 i  Y+ a  o  g, Z: x9 [) D/ r) d8 C1 Y
    Using eBeam with eASIC technology: Customer Advantages
  b5 J% A' X; H: r3 E6 K" o  F* m' y3 M/ V
Eliminate mask costs – NO NRE
: ?( j: e& m/ l5 r+ FAllow multiple projects on the same wafer
, u' R3 h; \6 A      o    No minimum-volume required : H$ P; g3 `# {+ j' e* X
Eliminate days of mask creation time # k4 u  q* F! `: G8 T* |* y
Cut time and cost – Via–only customization proceeds at 10x the speed
# E  B7 l( @8 r4 Z+ o' i( gRely on proven maskless technology
$ w; `9 G$ g" q      o    Available from multiple vendors: ST, Toshiba, UMC, and more
11#
發表於 2009-4-29 09:01:18 | 只看該作者
原來eASIC的代理商是亞矽!
6 S# [3 v, s! \
6 g+ Q; M; T2 ?( d9 }9 V& J5 l希望您們會有可程式IC的銷售經驗,殺出一條血路~~
/ T# g  s- _0 r. a8 p0 g4 J7 m: p5 ^2 Y: V9 m. c
產品不錯! 通路商還是非常重要的!
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