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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 在Layout時最花時間的工作是....
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樓主: jauylmz
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在Layout時最花時間的工作是....

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samgu
21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩，因為一個好的 floor plan 除了能讓訊號線走的順之外，也可以節省面積% r! T5 w: S6 y' ~6 z
2.接下來我覺得比較重要的是 power and ground line 的跑線，因為要走的順才是最重要的，而且若POWER途中一直換線其實也會降低它的電流0 g' F: [' }' ~
3.接下來我覺得都還好，因為 DRC LVS block 刻好就會 RUN 了 ，另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話！面積會變大∼甚至拉線會亂七八糟ㄉ∼
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yhchang
23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠( M9 P- v/ n, G1 ?- r. I8 E
你勉強把東西 塞進去之後  好不容易做完! t; C/ P% {% ~
結果電路圖又變了  你就完了
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yhchang
24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說# T. C* V% a$ _2 y; \& J+ b
一直改圖對LAYOUT來說是最花時間的9 [) d- H( j, U0 ~5 w' u
或者是 沒有看清楚 RD寫的NOTE! ^3 u6 ^( i, p6 r+ d
導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的
% M! z/ }2 k( a, I
/ D' U+ ]  E( q8 E有時候我們公司RD也不想讓LAYOUT一直改9 y# `' N0 [( _, N) h
只是因為有時專案太趕7 j- z/ W' h2 W1 N$ p
所以只好跟LAYOUT同時平行做
0 n8 L% S( U! T7 k$ I% a這樣就容易電路常常會大翻盤
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qwertmn
25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~
( U" Y9 V% w9 @; U3 I: @光是排列就會影響後續走線( }7 @  t) ?; x5 S$ ?" W
所以要特別注意~~~
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ynru12
26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的# h- {, `" y2 s) |" l
最辛苦的就是改圖~原本己經畫好的，但是rd突然說要改圖" u/ C  W2 N5 h) w4 I
然後整個的大小不變，但是改的地方，又比原來的大一些
( K3 x6 x0 T6 h( n1 P! ^這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好，所以floorplan是很重要。
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jauylmz
28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非
# C2 S7 b3 K5 B2 \
! ]4 F1 D( h$ A9 q1 ]8 g3 s/ ~我花最多時間的是在思考，
4 D! C- A9 Y( K2 X8 {一個5天該完成的案子，我可能會花去2~3天思考。
( k8 ?5 d* [& m3 ?7 L事前想的仔細，
& H' M! |; W/ @' A5 ~6 _: g開始動手layout一直到驗證完成都會很快而且順利。
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fei
31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难，最能体现实力！。。。。。。。。。。。。。。。
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sj1130
33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間，可能是因為剛接觸Layout沒多久，經驗不足顯得更無力！
+ N1 I6 a+ g% A: b; Y3 K4 P) y整合這部份，如果是自己獨立一人完成，雖然時間耗費較多，但是就跟寫程式一樣，如何去安排自己的line能走得順) s  ?0 F- D7 j/ Q; n+ Q$ Q/ N
我想這才是最重要的！重點一句：還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎
, u" ?/ @6 y; g$ D3 XLAYOUT我覺得每項都很花時間
2 m# ^2 S: N4 A不管是佈局還是LVS/DRC
( T- u9 r7 b5 @; N* L每項都得小心翼翼
5 b  v7 l4 _  R* x6 W3 `& C做快不見得好6 D$ h  _2 t% t6 m- U7 o
做對才是重要
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app
35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~
6 W  P' `' d1 D0 j因要如何將每個block充分擺到適當的位子~
, o! _% Y( f! s6 D$ O" q這是一種學問~+ d4 u' T: d& }7 j8 h1 O+ \
因擺的好的話~% v$ T1 p# P1 Y- C, x  k5 |+ f
其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   
$ h3 b6 n; e! l6.  整合 Chip Integration
' S0 S1 c! u. r4 i3 O 7.  溝通 communication$ D% d, C0 Z" l' g! D
這三個最麻煩
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brooo
37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧, y$ p, c2 K5 B# R2 ^" k
) y) Z6 x. `. [
在layout初期就要花很多時間先想好如何排列
- z. @9 w' q+ \. e6 E' D8 ~7 N3 o! n- N
想好後，反而才會省下大量的時間
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AaronChu
38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...
/ H! \7 x$ O; {3 c  \$ T要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   
8 R+ ~4 x1 C; q" Y3 Z  a7 x/ y. V4 w
( [. o; O0 ~* M% E其他就會很快   相對LVS 問題也比較好除錯2 @2 k( `) O2 h2 @  @: w  q
4 [$ D( z8 B* M
HR.概念有  應該DRC LVS比較不會有問題吧
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kevinpu
40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,
. i9 P' \1 c$ B  y$ t# P再整合時也會是另一個問題
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