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[問題求助] �定周期,可变的DUTY,如何实现?

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1#
發表於 2008-4-28 22:38:35 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
附图是一个OSC电路,可知T=C*(VH-VL)/I1+C*(VH-VL)/I2;4 {4 `0 L0 U+ e1 `7 v
0 Z& ]9 e, d; U1 f6 _
可以通过调整C,VH/VL,I调整频率,如果要获得�定周期,可变的DUTY,如何实现呢?
! m/ x% J+ J5 o2 Y) _
1 p2 N9 |/ Y5 l2 y1 f/ ^请各位大大指教,谢谢!# Y1 t( c% A1 O2 P3 e
) Q5 Y/ z. L/ R; `2 P

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2#
 樓主| 發表於 2008-5-3 11:04:31 | 只看該作者
各位大大,有没有好的方法,请指教,谢谢!
3#
發表於 2008-5-5 23:16:44 | 只看該作者
我以前有試過一種在vco後面加duty cycle correction電路,那是為了校正vco的duty cycle而衍化出來的電路5 a. T+ i  p# M+ C6 J1 U/ q0 M
那是一種利用負回授的方式來實現的電路/ H4 e0 a) q% i
不過,這種電路可能不太適合你的需求
/ h" w/ k5 w# i* B/ l# _" @" |4 t8 [, N0 ?2 Q
而因為你需要固定週期內去變duty cycle的話
6 d1 v( ^' x7 x, M+ B# R那惟有在sr-latch後面再加一些數位電路應可達到改變duty cycle的功能
5 z5 f- n: v+ X" C6 @: b基本上我想到的方式是利用delay cell再加一些數位邏輯電路應可實現
4 d/ q8 A! M) M7 q4 r) k: n  @若想加長duty cycle,那就用OR Gate + delay cell電路(加長)應可達到需求
5 v1 S0 N; C& |4 i6 a若想縮短duty cycle,那就用AND Gate + delay cell電路(縮短)應可達到需求
  h2 Y4 v7 r" V* W& a1 M$ v如此一來,便可利用數位控制的方式,藉由控制delay cell timing即可作出想要的duty cycle
4#
發表於 2008-5-6 15:09:02 | 只看該作者
題外話 & D1 \3 _3 _7 S
VCO duty cycle corrector 是很好玩的電路
. F+ _9 ]% b" u4 g# N我之前有發明一個 拼湊一些paper的概念所組成的電路 也是用負回授的方法來產生50/50的clock, q) |3 }' W& r+ r/ e2 a
finster大能分享一下如何實現的嗎 也許我可以觀摩一下/ E! K; V6 b' m: x% R" d
我另外再開個討論版好了
5#
發表於 2008-5-6 18:17:37 | 只看該作者

回復 1# 的帖子

也許可拿你電路產生的定頻clock去充放電另外一個可變的CAP或充放電固定的CAP
, I* @* D; I; d: y2 u9 |,改變比較器的轉態電壓~~~試試吧
6#
發表於 2008-5-7 15:53:27 | 只看該作者
這是我想到的方法4 x  P0 E7 l# P8 ?
利用delay cell和簡單的數位電路應該就可以改變duty cycle
- l$ F6 J% X/ n/ T( u1 P$ u因為提問者的前提是clock不能被改變,所以,就只能從輸出的clock著手動手腳,如果改變本身charge/discharge current,或者Vh/Vl電壓,或者電容C值均會改變原來的振盪頻率2 g  [) ^9 N" r1 f& Y# h
不過,這種方法有些缺點,因為delay cell的精準度很難控制,所以,未必能夠很精準的控制duty cycle,當然,如果要很精準的控制delay time,相對的電路就要設計的複雜些
4 n' R# @3 i% ]再者,如果clock愈慢,表示其delay cell的delay time要設計的愈寛,那用反相器加電容的delay cell未必適合

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7#
發表於 2008-5-8 11:29:18 | 只看該作者
用定頻的clock去控制充+放電時間,所產生出來的clock應該是同樣頻率,5 o: t4 K9 B! P+ q$ s
改變電容值或轉態電壓,便可以控制duty,用delay cell做,很難cover較寬
0 R* I5 D9 l% o+ P+ B' {的頻率,並非上策
8#
 樓主| 發表於 2008-5-8 21:13:11 | 只看該作者
finster大大是利用BBM(break before make)的方法去做的,谢谢!
1 O  v. y% m1 u- u& p$ ~6 V4 \+ I; p
  ~! b& [# ?4 J' V3 L$ P9 v( R! Z如果DUTY不连续变化,那么调整CAP可以改变DUTY(固定周期)
1 P% d; J" u* F' z+ y9 P+ i3 _T=C1*(VH-VL)/I+C2*(VH-VL)/I,,充放电用不同的电容大小,只要保证C1+C2不变,就可以保证频率不变了(理论上的),0 R7 E- N  }  b
DUTY连续的变化,上述方法就不好实现了................
$ K( }( s* N8 l9 H% u3 D* d$ w9 M1 O! o, M$ x8 f/ A& ~0 v
mbission大大能再具体的讲一下吗 多谢!
9#
發表於 2008-5-9 09:36:05 | 只看該作者
用你上面的電路產生出來的定頻的clock,去控制另外一組RC充放電電路1 t4 f8 E4 n, h: q. I
,改變充放電電流比例或切換轉態電壓,應該可以得到你要的波形~~~
10#
發表於 2008-5-10 23:07:10 | 只看該作者
其實上面這個OSC RC 充放電線路,就是555 timer IC的線路主要設計,只不過少了voltage control input(可用來調duty cycle)
. J- I& m( v; S- U" e8 O2 ]稍微改了一下,看可不可以.(VR 用來調duty cycle)& T6 B0 E3 W0 o! i7 q

  s" P* H1 ]8 Y

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11#
 樓主| 發表於 2008-5-11 16:03:27 | 只看該作者
谢谢kevin!; v) Y+ K" t  T+ n

/ I4 r  w% A4 ?$ \3 _但是如果VR变化了,那么频率也会一起变化的
12#
發表於 2008-5-12 10:16:18 | 只看該作者
我是假設R4 跟VR很大,所流過的current很小,則VH-VL會保持不變(只跟R2有關),則頻率應可固定.
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