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1.就製程而言: 依製程的平坦化程度做區分
! V3 d1 i1 k, p7 `3 h: Q 一般在rule裡會有定義是否允許疊在一起; }; q, n& s2 f" ?, ?; q$ A; X
0.35以上的製程一般是建議VIA打成交錯的0 Z+ A8 y6 s/ [. E7 H( Q/ {$ S
0.25 ~ 0.13 是建設直接將VIA 疊在一起! C+ P. p U' S, @6 k# i
0.13 以下~ 因為沒使用過,要請教有用過的人6 j; d" V' b* m/ }- q8 r
0 |" H( I$ p) h0 J3 \
<<請直接請教對製程比較了解的專家>>4 t, o( M; [, B8 {! L" c
1 }# i% z, d2 V4 {; L
就電流的方向而言: 直直的走不需改變電流方向會比較好
+ m( o/ g5 y7 |0 x3 i+ C 建議是直接將VIA疊在一起
3 j2 p& Y+ _4 `( D; o2 C( N3 `) h
z5 k5 j2 F& I& j9 T$ g8 ]' u 2. VIA 能多打就要多打: 可以降低繞線的電阻值減少delay |
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