一些Layout的問題

okfunny

关于 double guardring,我们的画法是 ntype ring 靠近噪声源
8 m; F1 z* q; Q* H就是说 如果包的是噪声源的话,ntype ring 在里面,如果是为了防止别的噪声干扰的话,ntype ring包在外面

wendyamy8570

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* |0 Q1 f' a6 q: A非常感謝大大的分享
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semico_ljj

原帖由 finster 於 2007-9-6 10:31 PM 發表
我是在一篇paper中看到的,不過這篇paper不知被我放在那裡了
另外,你所引用的教課書的公式應是Razavi那本"Design of Analog CMOS Integrated Circuits"中第13章的吧
! Q! U, y& b# U- `- Y' q8 N# u' q8 |書上是先決定BJT的顆數比,然後再求出相對應的電阻 ...

8 ^5 F) h+ S" A5 j$ A7 H7 y好像实际确实如此！谢谢！ ……………………………………

laker１０１

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6 ~6 O8 d! q- u' R% c: y9 i非常感謝大大的分享
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  ^2 k( Z; R& \常感謝大大的分享
6 D$ R9 |' s  N% N3 _2 m4 ?. Z/ [* z非常感謝大大的分享
% O$ M# ^- t& P非常感謝大大的分享

lethalkiss1

1    普通的logic电路影响不大，  不过一些高频信号， 一些delay电路等的还是尽量避免
  v7 x- f& {: b0 f$ v& @& ~" U
% ~+ l! I& p! x, g2    guard ring 最有效果的是p + guard ring，  但是一定一定一定要接到干净的gnd！！！， 这样才能吸收掉noise。  2种都画的话，比只要p+ 好一点点。

3  这个是为了匹配这样设计的，一般都是设计成1：8    ，1：24 。

gyamwoo

最近在做ｐｌｌ的電路。類比數位都會用到。
: L' U( k3 K: p8 n各位都好利害啊，每個回文都有參考價值呢∼∼

kstcandy

剛好要瞭解這方面的資訊，正好做來參考...

7 P0 \0 g% X9 F謝謝分享...

091234567

非常感謝大大分享~
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lnxmj

2：pring 接地收集空穴，nring接高电位收集电子，二者纵向结深越深越好；多子ring是为了让sub电位不被拉高或拉低，少子ring收集电子或空穴

段睿閩@FB

謝謝各位前輩的經驗分享

alfie.chuang

1
1 `& ~+ @- F0 g0 \8 Z怕千擾
可以事先詢問rd care的地方，避免跨過即可
% {2 `) A  W* J8 G0 r2
依pnmos來決定第一圈及第二圈ring
; u' U: g- b5 m! L* l3 j4 j- a2 ^3
/ H# a' H, Q2 M7 r* Y; {  K+ i. _1 u我也是畫9官格

188

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( E! |$ D! P0 d0 Z, V# m非常感謝大大的分享
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