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[問題求助] TestBench For VHDL

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1#
發表於 2008-2-9 00:59:49 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
我寫了一個6 X 64的記憶體,現在想要寫個TestBench去測試,但是總不可能用手key in吧,
( S2 h. v& h8 [& K+ y
& E3 [, J9 S+ A2 m太本土的作法,想請問有經驗的人,如何自動產生大量測試數據給我的TestBench呢?8 ]6 N4 M3 s. _( P) w
9 C$ D+ e8 a" Q' K  F5 H
請指點一下,謝謝!
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5#
發表於 2009-7-13 14:03:10 | 只看該作者
還不錯的source code2 m7 w' p3 ]# e- M% X; }  E
我來研究看看 最近剛好派的上用場
4#
發表於 2008-11-27 16:55:05 | 只看該作者
路過的路人甲5 T4 n9 [9 V/ _' p# x
看到不錯的帖子 突然感到興趣  d2 C2 z6 e" X9 O
我也來學習學習
3#
發表於 2008-2-14 23:21:30 | 只看該作者
拜師學藝,交點學費+ T- q2 a) p  ~
這也是一種交流的方式
2#
發表於 2008-2-13 14:19:36 | 只看該作者
256x16 RAM model & RAM testbench
. w# H2 Z+ [( Z6 D/ Y. ?: N- j1 L* I+ N* a' d( y

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