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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 想請問有關DNW的問題
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[問題求助] 想請問有關DNW的問題

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214197
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1#
發表於 2021-5-11 11:08:49 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
畫DNW NMOS 都會出現這個問題
+ b8 v. E( H) ~; u0 L& F* E: Z+ a4 d1 s/ ~& P. ^; }) c0 v7 M
到底浮接NWELL的問題是指的是什麼？！) p, s* N! B7 _( p' |
, v/ s, \* Q8 l) R6 Q1 x6 F
有沒有熱心人可以幫忙回答這個問題的嗎？！! f% ^( N- [/ ^4 v* S5 \# B" J
如果要解決如何解決呢？！
  \1 y( @/ Q) `6 U5 L5 k
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214197
4#
 樓主| 發表於 2021-5-11 21:59:25 | 只看該作者
本帖最後由 214197 於 2021-5-11 10:27 PM 編輯 ; p# K% l" Q0 y* `0 f0 C- b8 j
skeepy 發表於 2021-5-11 06:05 PM
, s0 [) q) c8 e9 j( T把DNW  PMOS & NMOS 劃在一起看看Rule還在不在?
) N1 n& S4 p, b1 @
問題已解決; @2 L+ W7 F$ f) `0 {/ X! L& [- s: Y
已經知道哪邊問題了, R# K; y7 s3 y; \* e% C& y

3 V2 _$ M+ K8 R
5 S( w) q4 ?; U9 H8 [感謝你的回覆，不過我正有打算打他們畫在一起看看
: }8 R3 l$ t" D& g% @) |4 t1 T$ O" ^5 o
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skeepy
3#
發表於 2021-5-11 18:05:11 | 只看該作者
把DNW  PMOS & NMOS 劃在一起看看Rule還在不在?- J& @# f, }- r; F4 H6 |+ \& x
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214197
2#
 樓主| 發表於 2021-5-11 17:14:24 | 只看該作者
好像可以當成忽略解決4 T3 o# r2 k+ `% }" h
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