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[問題求助] Layout about Transmission Gate

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1#
發表於 2008-7-31 12:15:23 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我是初學者,最近在畫一個開關的layout1 [% c- p. \- ~6 w4 B0 J0 \
如下圖( l" o9 a9 }$ @

" m5 a2 l: A' j$ O7 j( ^這是一個transmission gate,2 x3 w2 W5 {3 Q+ Y; U
不過pmos跟nmos的drain跟source都是接在一起,8 E' s6 c6 Q/ P2 M
而gate端是輸入CLK訊號& ^! P& D. C$ \+ s
而pmos的body端是接到vdd,nmos的body端是接到gnd1 G" d. _) c3 u7 T# ?. }) m
不過以前通常source跟body端都會接在一起
) X* ~1 y  z# v9 n3 Tlayout時body端可能就做在vdd跟gnd上面" {  {9 h6 \* c8 D" n
那現在source跟body是分開的0 r% g* b8 ^( a9 G! G% d
我body部分要做在哪邊才對呢?
" o& G+ C# r, u+ a  k4 Z) g7 x7 w
希望有了解的人能提供意見! M9 k! z  A7 i, q  E; t
感謝

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2#
發表於 2008-7-31 14:24:08 | 只看該作者
N-Well製程  pmos 的 body 就是 用 n+ 接 VDD, nmos 的 body 就是用 p+接 GND.6 G5 m  v1 l  X: N1 c7 F
  b7 ]; T/ g" c  q0 A: n+ N* ^
transmission gate PNmos  S/D 兩端相接,  gate端是輸入CLK訊號
* S, Y' P# K9 ?0 H
  P; X( c8 L* h9 d6 x4 _& n' V, n7 w這樣就OK啦
3#
發表於 2008-8-6 10:10:31 | 只看該作者
N_WELL P_SUB 製程" {5 F9 m5 ^* |
PMOS ㄉ body 在 NWELL 中 ) D) m2 \! z5 d6 P0 N; S! t& O
n+ diff9 [( S, t1 g$ A1 n' s

0 j& f; s0 U9 `0 j1 S( q: U' ]NMOS ㄉ body 在 P_sub 中
( s7 ^! u* }2 ]p+ diff ) p* C* A  Q0 _1 C1 i' v
由於整各晶圓都是 P_sub 只要在
" l2 z+ l1 y/ I3 X+ V& `8 X非 N_WELL 中 ㄉ p+ diff 都是9 \! K7 m$ \) h. t4 ^( w% r
通常 design rule 要求要在20um$ x7 Q! q: J2 y. n( E
內.有機會加強製程方面
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