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[問題求助] Virtuoso CDL Import設定問題

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1#
發表於 2010-8-4 16:24:45 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
在CDL Import裡設定的reference library及device-mapping file
7 D$ `9 r: Q& q2 J7 b" ^% _2 i% G9 t請問reference library指的是??) L% ^4 I8 H( J
以及可以請教如何撰寫device mapping file嗎??
8 j! X) L. Y" b+ `
8 a- w# L3 ?0 k' W4 g5 C4 z9 l謝謝各位大大囉
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2#
發表於 2011-4-29 14:42:45 | 只看該作者
reference library指的是你用的nmos/pmos/inv....etc. library
3#
發表於 2012-4-12 17:02:34 | 只看該作者
device mapping file
. j, P7 u% Q  H+ p7 f( S先vi model.map file+ ^% Y7 j& S. @% W1 x
M PCH  .   .
5 n9 R& V; `2 Q! H( R( ]4 XM NCH  .   .
1 ^1 g! H4 j4 T# y# q( Y; m第一個 .  是自建layout library, 第二個  . 是 TF file定義的MOS 名稱," i6 @0 P% Z7 a1 K8 x  p
也就是說沒有自建layout 如下:
* y, x+ s! W$ }+ A* \& X# RM PCH  .   PMOS3 W# n0 N! u2 ~4 P: f/ C
M NCH  .   NMOS5 R8 g# Q7 u" U# e0 m& N5 G  v* H
如有自建layout library8 E+ ]; E/ s" ]6 {8 z, a- B
M PCH  lib_name   PMOS
4 R& X. {% n6 n. _M NCH  lib_name   NMOS
4#
發表於 2012-6-5 09:02:02 | 只看該作者
補充:
% h3 u  @1 P+ L+ q: O- h* {7 ^1. Reference Library: the reference libraries or Process Design Kits (PDK) where the symbol views of master cells are present. 既你想要用的symbol是來至哪個 library.
2 k$ A2 o! L  J3 O2.  Syntax for Specifying Device Maps in a Device-Map File:
9 O2 a/ O' e2 K8 s& b4 C     devMap := <primitive_device_name> <mapped_device_name>: i$ K# Y$ {/ O/ M. _) m
     [ propMatch := list_of_prop_to_match ]
! S9 G* i: M3 X6 g     [ termMap := list_of_terminals_to_map ]
2 R7 R9 p( z" Z! ^, `( @% j     [ propMap := list_of_properties_to_map ]5 i! L! p1 x7 ?2 d/ m) t3 e! \
     [ addProp := list_of_additional_properties_to_map ]
- A# z9 S6 q8 a- ^( G$ h      Example:) q  X+ T6 L# }; u8 X' K- G' Z- K
      devMap := resistor res
% P+ }: I- T( S      propMatch := r 20000* E7 m4 ]4 I+ v8 t% q; n
      termMap := PLUS PLUS MINUS MINUS
9 A# ?" f2 D5 Q/ o% k% E* I% E      propMap := subType type r resVal w width l length% X' n1 C) A" V. Y' {
      addProp := model res
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