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為什麼MOS上的SOURCE要接到BULK

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1#
發表於 2008-3-30 18:28:39 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
BULK與SOURCE端相接的原因除了避免LATCH-UP,另一個就是2 [- i4 S1 A+ h7 ^' v% J
避免BODY EFFECT 也就是基底效應,如果你有讀過VLSI的書不難
0 ?3 E; P: e; `- [% r. ]" b8 t了解SOURCE跟DRAIN的導通必須透過"空乏區",空乏區的產生必9 g" J* m& d+ j
須透過從GATE端輸入的電壓,當輸入的電壓大於臨界電壓時空乏區
/ F3 y- [, h0 ]/ l, f  p7 B+ a! x才會產生,臨界電壓與SOURCE端的電壓有密切的關係,如果沒記
) S+ i7 Z: A4 d1 D4 k錯GATE電壓+SOURCE電壓等於臨界電壓,如果SOURCE端電壓5 G) t8 N( W: g) ~5 U8 Q
不等於0,將會造成打開空乏區的電壓必定需要增大,相對這種情況' I6 N/ G1 s0 `
下的MOS就不易被導通,而且增加了電壓上的損耗。
1 |% _9 [& i& X6 I1 o  w( [3 r& L9 Y! Y3 S  @1 a; [4 a) k4 v, X( i0 c+ I
如果有寫錯還請各位指正,謝謝。
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2#
發表於 2008-3-30 19:15:40 | 只看該作者
以 PMOS 而言, Body 可接到 S 或 VDD. ! z- U5 a6 S; R; s2 y
都是為了保持 Body 對 Channel 的逆偏。
3#
發表於 2008-3-30 19:31:01 | 只看該作者

回復 1# 的帖子

應該是Vgs>Vt也就是說Vg-Vs>Vt........................................
4#
發表於 2008-4-1 00:18:14 | 只看該作者
Seems it depends on application, Vt vary with Vsb. Mostly if we want to have min. Vt, source is connected to bulk.
5#
發表於 2008-4-1 07:29:14 | 只看該作者
讀了一遍  覺得文中所稱的  空乏區  應該是 反轉區吧  (Inversion Layer)0 A! @1 d8 W2 M
我的認知是覺得  Body effect  就是 VBS=0   NMOS就是 source與bulk 要接到 GND
, R/ @( o: A# x; gPMOS 就是 source與bulk要接到 VDD# @2 Q" E# Y6 c3 P5 I! o  U
但是電路上還是會有 VBS不等於0的情況) I& M) H+ p; x; h9 L0 s5 U+ h
這通常發生在  MOS串接的情況   不管是 Cascode還是 CMOS邏輯 串聯的那一塊4 R$ e& J8 Y4 j
都無可避免的有 基底效應出現,  所以一般來說 我們做 CMOS互補邏輯  最多就是用到 4-Input
- `' A# B- h0 `因為太多輸入時   串聯的MOS間會有  Chrge sharing的問題, 其次就是疊越高的MOS Body effect會越嚴重
" U8 E9 ]: U* f0 k# b最後一個Issue是   該邏輯拉到 1或0 其中一邊的速度會變成非常慢.
# j# G" S) s9 G9 w5 w) ?Cascode最多就是疊兩個   疊太多會傷到  OP ICMR 或 Output swing.
9 W5 W* u5 f! I; ]$ r/ W. @# W
* c4 O1 B8 ]; F( d8 r, S3 b$ T[ 本帖最後由 yhchang 於 2008-4-1 07:30 AM 編輯 ]
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