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為什麼MOS上的SOURCE要接到BULK

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1#
發表於 2008-3-30 18:28:39 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
BULK與SOURCE端相接的原因除了避免LATCH-UP,另一個就是: W5 Y) f7 h+ R8 w
避免BODY EFFECT 也就是基底效應,如果你有讀過VLSI的書不難
& _' W3 v% J9 r, {$ Y* F4 P了解SOURCE跟DRAIN的導通必須透過"空乏區",空乏區的產生必1 e' f, q# z" U3 @8 g
須透過從GATE端輸入的電壓,當輸入的電壓大於臨界電壓時空乏區; G/ l3 @# s5 }- B6 I
才會產生,臨界電壓與SOURCE端的電壓有密切的關係,如果沒記
( Z( A4 D2 i0 H1 s" [3 }5 I, R7 t7 O錯GATE電壓+SOURCE電壓等於臨界電壓,如果SOURCE端電壓6 U2 Q& F/ l( X. z  E3 M
不等於0,將會造成打開空乏區的電壓必定需要增大,相對這種情況; R5 f9 }3 T% E7 |
下的MOS就不易被導通,而且增加了電壓上的損耗。
8 {3 s0 l7 ]: ?
4 V  b5 w9 V% ]) o: x% A2 O+ m, N5 L如果有寫錯還請各位指正,謝謝。
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2#
發表於 2008-3-30 19:15:40 | 只看該作者
以 PMOS 而言, Body 可接到 S 或 VDD.
. _3 \, O# k3 {% d; C+ |0 _5 `3 G都是為了保持 Body 對 Channel 的逆偏。
3#
發表於 2008-3-30 19:31:01 | 只看該作者

回復 1# 的帖子

應該是Vgs>Vt也就是說Vg-Vs>Vt........................................
4#
發表於 2008-4-1 00:18:14 | 只看該作者
Seems it depends on application, Vt vary with Vsb. Mostly if we want to have min. Vt, source is connected to bulk.
5#
發表於 2008-4-1 07:29:14 | 只看該作者
讀了一遍  覺得文中所稱的  空乏區  應該是 反轉區吧  (Inversion Layer)
! h7 n9 |* {9 [* I  {我的認知是覺得  Body effect  就是 VBS=0   NMOS就是 source與bulk 要接到 GND* L/ N+ {8 B+ Z6 i
PMOS 就是 source與bulk要接到 VDD
5 O& `- y$ P2 s9 e8 P2 z# z但是電路上還是會有 VBS不等於0的情況8 s* X1 M2 r" g. H5 r
這通常發生在  MOS串接的情況   不管是 Cascode還是 CMOS邏輯 串聯的那一塊# _7 J: O2 d' K; [8 g
都無可避免的有 基底效應出現,  所以一般來說 我們做 CMOS互補邏輯  最多就是用到 4-Input # o) F. M7 }; y8 j- n3 M6 n# o
因為太多輸入時   串聯的MOS間會有  Chrge sharing的問題, 其次就是疊越高的MOS Body effect會越嚴重+ T3 ]8 ?. V$ m) ]
最後一個Issue是   該邏輯拉到 1或0 其中一邊的速度會變成非常慢.8 B) N% |3 e( g) D+ G
Cascode最多就是疊兩個   疊太多會傷到  OP ICMR 或 Output swing.
; S$ ?: Q) D- C2 A+ X2 Y5 J+ W
3 L/ C. Z2 E5 u1 d2 Z! X[ 本帖最後由 yhchang 於 2008-4-1 07:30 AM 編輯 ]
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