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[問題求助] 請問layout電阻電容畫法

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1#
發表於 2009-5-9 03:01:25 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
因為太新手無法看置頂的電阻電容畫法所以來求助,最近畫layout電阻試過了CIC所寫的三種電阻畫法,但是LVS就是找不到
7 E- j# l! L: F+ K8 f7 P% ^- t4 w- D他就是poly,DIFF,NWELL三種,但是我照著話就是LVS不出來,有沒有高手能把電阻的畫法一步一步的解開呢?書上講義都是把已經畫好的電阻放上去然後用箭頭指著說這是poly,這是Nwell,但是有些重疊的部份根本不知道那是什麼東西之間的重疊,不然就是外圍用虛線包住一個蛇形狀的東西並露出兩個頭,但是就是沒有寫那兩個頭裡面是什麼組成的,外表看起來就像是NWELL包住蛇形POLY,但是照著跑根本就跑不出來,因為根本不知道蛇形poly上面有加上什麼東西,要不然就是標示著電阻標示層畫法需和command file配合,淡是到底要怎樣才能弄出電阻標示層還有如何配合command file?請高手幫小弟解題,感激不盡。0 G) U( M! b; j* j# E' u
至於電容更是看不清楚了,一塊正方形然後一堆箭頭指向裡面說這是什麼什麼,但是根本不知道那是怎麼組合成的,也不知道哪塊要大哪塊要小...
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2#
發表於 2009-5-12 09:16:24 | 只看該作者
你要看製程廠的 rule file 他有寫 每家不同6 N/ v8 H4 n' |* p
而畫的規格 W L 要看rd設計   
) |1 J3 U5 d4 h像大電阻就是由一堆小電阻串連而成  怕失真
3#
發表於 2009-5-12 09:31:10 | 只看該作者
像POLY 電阻 , G4 R0 H, C0 f* s$ n3 H& ?
最基本的就是 電流 從 CONTACT 進去 POLY  另一端CONTACT 出來 要包其他層 要看製程和RD % ^! _( p/ p, ^! Q6 Y% ~! w
) _* E2 K6 T. {8 v, H; U
它跟電路學的 電阻公式一樣  越長L 電阻越大  越寬A電阻會被整除
. B8 j" G) p! @$ c" U  q+ ?  E, Y4 N+ h7 @
電阻率的科學符號為 ρ 。
& p2 r( v, j) d( k6 Q. g
0 n1 y! b7 b( G已知物體的電阻,可由電阻率ρ、長度 l 與截面面積 A 計算:
  C" U* a+ N: B/ w% }& K
! k6 o5 h: ~6 b/ A R =  ρ  L/A; H" R. \9 O0 [' m2 B

2 b* y) ?: d& v' t6 M電阻 R 單位為歐姆
) W1 z9 s1 u% w. D! s" E* T長度 l 單位為米 7 I9 `9 o0 ?6 t: }, `
截面面積 A 單位為平方米 8 P+ U+ P! t. l  M
電阻率 ρ 單位為歐姆·米
4#
發表於 2009-5-13 10:05:39 | 只看該作者
可以看command file裡面的敘述 會有跟你講要蓋那些layer(在最上面 or 用找低)% P" X' W: V/ }6 ~
或是看design rule 也有
! I1 i. a6 M: K. i0 x1 g' G# Q7 ]4 r4 I, E+ M* y7 _
我猜可能是少蓋了RPO  和 電阻的dummy層吧(RPDMY....等)! V2 h& L; _8 K' w9 ]  w+ l
要自己讀一下唷* t9 t3 r& a. E- Q  e

/ U4 k: P7 M& X希望能幫到你
5#
發表於 2009-5-19 17:37:20 | 只看該作者
LVS認不到,不一定是Layout錯誤$ j' _5 C& k; p/ X0 h* X  I) X
也有可能是command file寫錯5 w  ]8 t* e5 u6 f8 ]7 V6 P% z- d
看看command file裡element res[?]是如何定義$ ^9 V; W6 D- r1 `
再回頭檢視Layout,這樣會比較快唷!
6#
發表於 2009-5-25 15:50:47 | 只看該作者
我猜也是少蓋dummy層2 c5 ^/ f8 a. d9 {7 l6 u( S5 q: @
查看一下command file
7#
發表於 2009-5-27 09:14:58 | 只看該作者
ex. n+ poly res W=1um  L=10um 3 o. A- e6 }, p! e, K2 t2 y
1.首先 劃一個 w=1um L=12um poly 矩形 再加上 n+ imp 覆蓋 整各 poly
/ b" c) r2 H  F   即 poly  在 整個  n+ imp  _5 [+ v. Q6 M$ l0 w& A
2.再2端多出來ㄉ地方 加上 cont 和 metal 1 keep cont 間隔 10um
6 I4 B. u5 h3 d  P: h  M7 M3.加上 RP_DMY 在cont 間 包附整個poly 即 RP_DMY w=1 um L=10um! @" }: Z! r. p; o
4.跑DRC LVS --- >完成' {4 u6 r  ~' i- K" {8 x. W
通常會有 一個 layer 層用來 辨識 電阻 看你所用的 command file+ \- _$ O, i6 F8 ^1 [! g# P
有加 RP_DMY 的 poly 才會被當成電阻
" k6 i9 v0 Y( d& Q9 `+ s而cont & metal 1  是用來當電阻2端的接點4 B3 ?# |; W# R+ P# E
接線用, 這樣看董ㄌ, 再去看講義,應該就能懂其他電阻的 lay 法ㄌ
8#
發表於 2009-6-1 14:10:23 | 只看該作者
應該Design rule都會有寫
- q" j8 k  S  r2 B然後你畫電阻的話要注意0 C9 x2 |* O  X
他LVS是從R_DMY所畫到的範圍來判定電阻值
: L! G# }- B4 w" T; Q電容的話你除了計算面電容還要考慮線電容
: D% R6 a! f0 L' m( c當然最後看你command file裡面誤差設定多少 如果是0的話很難畫到完全精準
9#
 樓主| 發表於 2010-5-24 01:55:27 | 只看該作者
感謝大家的回應,我直接用叫的了/ o- G. ~- z9 M$ Q+ K6 s/ S7 X8 R- S
竟然忘了電容可以用叫的了
10#
發表於 2010-5-24 07:17:45 | 只看該作者
回復 9# e2000
+ d0 P6 J5 w! v! s$ b9 r( C( n4 Z5 z8 L9 M" z8 W+ L7 i8 Q

1 ]/ [: N' _9 o& k6 {4 O9 U3 k    這樣你就學不到東西了....
11#
發表於 2015-10-9 10:06:30 | 只看該作者
要看design rule才知道要怎麼畫吧
12#
發表於 2021-4-28 20:44:09 | 只看該作者
需要更多這方面知識  感謝提供
13#
發表於 2021-8-23 17:12:57 | 只看該作者
感謝大大無私的分享!!!!!
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