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[問題求助] 請問layout電阻電容畫法

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1#
發表於 2009-5-9 03:01:25 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
因為太新手無法看置頂的電阻電容畫法所以來求助,最近畫layout電阻試過了CIC所寫的三種電阻畫法,但是LVS就是找不到
* e: z" g1 D+ ^$ j  v. `5 A他就是poly,DIFF,NWELL三種,但是我照著話就是LVS不出來,有沒有高手能把電阻的畫法一步一步的解開呢?書上講義都是把已經畫好的電阻放上去然後用箭頭指著說這是poly,這是Nwell,但是有些重疊的部份根本不知道那是什麼東西之間的重疊,不然就是外圍用虛線包住一個蛇形狀的東西並露出兩個頭,但是就是沒有寫那兩個頭裡面是什麼組成的,外表看起來就像是NWELL包住蛇形POLY,但是照著跑根本就跑不出來,因為根本不知道蛇形poly上面有加上什麼東西,要不然就是標示著電阻標示層畫法需和command file配合,淡是到底要怎樣才能弄出電阻標示層還有如何配合command file?請高手幫小弟解題,感激不盡。
  n/ N6 R7 A; x/ w; C/ \8 Z至於電容更是看不清楚了,一塊正方形然後一堆箭頭指向裡面說這是什麼什麼,但是根本不知道那是怎麼組合成的,也不知道哪塊要大哪塊要小...
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2#
發表於 2009-5-12 09:16:24 | 只看該作者
你要看製程廠的 rule file 他有寫 每家不同3 G* w# q, j! {) u
而畫的規格 W L 要看rd設計   ; E9 ~) i7 R1 N8 {( L8 |
像大電阻就是由一堆小電阻串連而成  怕失真
3#
發表於 2009-5-12 09:31:10 | 只看該作者
像POLY 電阻
- q6 M0 {0 ?3 z( ?, r4 R2 o最基本的就是 電流 從 CONTACT 進去 POLY  另一端CONTACT 出來 要包其他層 要看製程和RD
4 X  A* l) ~: S  J& j# X5 ?% C- ?* Z4 Y
它跟電路學的 電阻公式一樣  越長L 電阻越大  越寬A電阻會被整除
- f  l0 V1 h. R8 K4 O$ Y. b
! m- l0 G  J' l& R- N5 X電阻率的科學符號為 ρ 。0 m8 ]" J8 l9 ]9 V
0 }2 h" ?5 N, G3 i  b; l) H. Y
已知物體的電阻,可由電阻率ρ、長度 l 與截面面積 A 計算:
7 z4 @+ a" s5 \" [0 s
( ?/ n2 q( d+ {/ P R =  ρ  L/A3 |6 M/ t0 {  d# u+ O( |

" N6 G- l8 o2 M7 t, g# x3 h電阻 R 單位為歐姆 7 W6 i- B3 M! [2 v3 k
長度 l 單位為米
0 F1 y( j: w3 Y: J, g/ K! d截面面積 A 單位為平方米
( [: ?* c" T/ g電阻率 ρ 單位為歐姆·米
4#
發表於 2009-5-13 10:05:39 | 只看該作者
可以看command file裡面的敘述 會有跟你講要蓋那些layer(在最上面 or 用找低), m0 Y+ G* ^& m1 }/ N& s
或是看design rule 也有, r; s. [8 m) }' n) i+ n
9 V6 F0 E" z. E* k
我猜可能是少蓋了RPO  和 電阻的dummy層吧(RPDMY....等)1 [# _. P' c' f6 F
要自己讀一下唷
& p+ E3 E0 Q: \+ j0 Z% E4 w2 q6 Y  P, h% w) e
希望能幫到你
5#
發表於 2009-5-19 17:37:20 | 只看該作者
LVS認不到,不一定是Layout錯誤* P) K3 j# [$ J/ z* t
也有可能是command file寫錯
, ~$ p# X# j! N看看command file裡element res[?]是如何定義- I# |8 D. R; g0 g# J
再回頭檢視Layout,這樣會比較快唷!
6#
發表於 2009-5-25 15:50:47 | 只看該作者
我猜也是少蓋dummy層
# s; A7 @8 M: i4 i, B6 p' v& J8 b查看一下command file
7#
發表於 2009-5-27 09:14:58 | 只看該作者
ex. n+ poly res W=1um  L=10um
9 K) y* l" K% d1.首先 劃一個 w=1um L=12um poly 矩形 再加上 n+ imp 覆蓋 整各 poly
3 W" j7 J& K! v7 f6 u   即 poly  在 整個  n+ imp9 @. \% N/ b9 k  G  x5 v
2.再2端多出來ㄉ地方 加上 cont 和 metal 1 keep cont 間隔 10um
: }7 A  u( u" k; p3.加上 RP_DMY 在cont 間 包附整個poly 即 RP_DMY w=1 um L=10um1 q8 n. L% f0 z5 x$ C2 J8 M
4.跑DRC LVS --- >完成
% b! O) e$ p" e2 M) C" o' _通常會有 一個 layer 層用來 辨識 電阻 看你所用的 command file
, T( s  q: c9 B- b+ K1 x  Z有加 RP_DMY 的 poly 才會被當成電阻
' d. P5 N, u* ~  Y) B而cont & metal 1  是用來當電阻2端的接點# {, Z1 H$ ~# ?  W
接線用, 這樣看董ㄌ, 再去看講義,應該就能懂其他電阻的 lay 法ㄌ
8#
發表於 2009-6-1 14:10:23 | 只看該作者
應該Design rule都會有寫
. k" I% s: L0 Y0 \" ]; O$ Y然後你畫電阻的話要注意
0 S& n! d) E- {3 w他LVS是從R_DMY所畫到的範圍來判定電阻值! ?% i& }: C' r% f9 s
電容的話你除了計算面電容還要考慮線電容
% R6 Q' \+ i! u& V, t當然最後看你command file裡面誤差設定多少 如果是0的話很難畫到完全精準
9#
 樓主| 發表於 2010-5-24 01:55:27 | 只看該作者
感謝大家的回應,我直接用叫的了, {4 q4 e$ b" G& c
竟然忘了電容可以用叫的了
10#
發表於 2010-5-24 07:17:45 | 只看該作者
回復 9# e2000 4 F; [: [. Y% N# m

( I1 O* S$ \4 K) }
, `* l; {5 H  ?" G/ R: h5 l$ y    這樣你就學不到東西了....
11#
發表於 2015-10-9 10:06:30 | 只看該作者
要看design rule才知道要怎麼畫吧
12#
發表於 2021-4-28 20:44:09 | 只看該作者
需要更多這方面知識  感謝提供
13#
發表於 2021-8-23 17:12:57 | 只看該作者
感謝大大無私的分享!!!!!
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