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[問題求助] 請問layout電阻電容畫法

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1#
發表於 2009-5-9 03:01:25 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
因為太新手無法看置頂的電阻電容畫法所以來求助,最近畫layout電阻試過了CIC所寫的三種電阻畫法,但是LVS就是找不到# ?4 B! B; z9 A- e$ Y" i5 s
他就是poly,DIFF,NWELL三種,但是我照著話就是LVS不出來,有沒有高手能把電阻的畫法一步一步的解開呢?書上講義都是把已經畫好的電阻放上去然後用箭頭指著說這是poly,這是Nwell,但是有些重疊的部份根本不知道那是什麼東西之間的重疊,不然就是外圍用虛線包住一個蛇形狀的東西並露出兩個頭,但是就是沒有寫那兩個頭裡面是什麼組成的,外表看起來就像是NWELL包住蛇形POLY,但是照著跑根本就跑不出來,因為根本不知道蛇形poly上面有加上什麼東西,要不然就是標示著電阻標示層畫法需和command file配合,淡是到底要怎樣才能弄出電阻標示層還有如何配合command file?請高手幫小弟解題,感激不盡。
3 C" L* d( m: f7 a! ?9 l6 `) E% D至於電容更是看不清楚了,一塊正方形然後一堆箭頭指向裡面說這是什麼什麼,但是根本不知道那是怎麼組合成的,也不知道哪塊要大哪塊要小...
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2#
發表於 2009-5-12 09:16:24 | 只看該作者
你要看製程廠的 rule file 他有寫 每家不同
4 B1 r" F5 U* W' k而畫的規格 W L 要看rd設計   & B# F" q8 V# j9 `" G* N2 N
像大電阻就是由一堆小電阻串連而成  怕失真
3#
發表於 2009-5-12 09:31:10 | 只看該作者
像POLY 電阻 # [) ^* [+ Y9 n2 f
最基本的就是 電流 從 CONTACT 進去 POLY  另一端CONTACT 出來 要包其他層 要看製程和RD & @% h6 J  Y' c! r
/ a) b4 H7 V) `6 `0 a
它跟電路學的 電阻公式一樣  越長L 電阻越大  越寬A電阻會被整除8 |# X- b, h- D( F8 g2 j, z: A3 G

. i/ X# [7 B# g7 a# F+ U6 s電阻率的科學符號為 ρ 。
: ?! b  k8 }9 F, _
# V( x' ?4 g/ g已知物體的電阻,可由電阻率ρ、長度 l 與截面面積 A 計算:$ G" w3 |# e' Q( Q3 [

/ x* e: E) R5 ], V" a, k! O R =  ρ  L/A
/ t8 q. ]) A6 g  l, f
, ^! A/ o0 g! ?: f/ i$ o' ~* A$ d電阻 R 單位為歐姆 0 ?. f1 J" r/ E& P3 `, Y
長度 l 單位為米
6 \1 p7 u$ z1 {截面面積 A 單位為平方米
6 j; x- c8 Q7 Z: W電阻率 ρ 單位為歐姆·米
4#
發表於 2009-5-13 10:05:39 | 只看該作者
可以看command file裡面的敘述 會有跟你講要蓋那些layer(在最上面 or 用找低)
' k/ M  g' J# I5 h( K+ u或是看design rule 也有
- i. O4 t5 y+ F, K: S* Y% f% F7 o: N6 ~& G
我猜可能是少蓋了RPO  和 電阻的dummy層吧(RPDMY....等)
& g, C6 o: K/ U9 k要自己讀一下唷) `/ J: ?2 `) b% `5 q
, ~2 A+ q4 S# T! v, q! u
希望能幫到你
5#
發表於 2009-5-19 17:37:20 | 只看該作者
LVS認不到,不一定是Layout錯誤
9 M$ j( d% D8 F2 @( }也有可能是command file寫錯/ l  Q/ G  @, d* v4 [$ ]
看看command file裡element res[?]是如何定義  q. [  }+ _/ Z- Y4 g4 |3 O
再回頭檢視Layout,這樣會比較快唷!
6#
發表於 2009-5-25 15:50:47 | 只看該作者
我猜也是少蓋dummy層1 i5 k# A1 F* m7 |
查看一下command file
7#
發表於 2009-5-27 09:14:58 | 只看該作者
ex. n+ poly res W=1um  L=10um   h# l4 z; R4 W) x
1.首先 劃一個 w=1um L=12um poly 矩形 再加上 n+ imp 覆蓋 整各 poly( e$ y2 D) }) B2 e  a0 N
   即 poly  在 整個  n+ imp
- K0 H: \% _4 o7 O" }+ P2.再2端多出來ㄉ地方 加上 cont 和 metal 1 keep cont 間隔 10um
9 a) Q# W& q+ v3.加上 RP_DMY 在cont 間 包附整個poly 即 RP_DMY w=1 um L=10um
) s; ~* p  V! K" P1 P, m1 @4.跑DRC LVS --- >完成
$ J2 y! w/ t1 G6 F2 ]6 S通常會有 一個 layer 層用來 辨識 電阻 看你所用的 command file
/ {- X6 _5 S2 y+ g% O有加 RP_DMY 的 poly 才會被當成電阻
0 p7 K9 G. H& b9 s7 |# m而cont & metal 1  是用來當電阻2端的接點) t( m* C% ?) r3 I) H- ]0 f3 ~
接線用, 這樣看董ㄌ, 再去看講義,應該就能懂其他電阻的 lay 法ㄌ
8#
發表於 2009-6-1 14:10:23 | 只看該作者
應該Design rule都會有寫
% g  Q$ _0 a/ ?然後你畫電阻的話要注意" J) ~9 m, v# ^7 m& Q& V* T1 ?
他LVS是從R_DMY所畫到的範圍來判定電阻值
) I0 `7 s/ V2 t8 V# Y; e4 Z3 L1 D電容的話你除了計算面電容還要考慮線電容
9 ]7 W) [: S# p6 r' D當然最後看你command file裡面誤差設定多少 如果是0的話很難畫到完全精準
9#
 樓主| 發表於 2010-5-24 01:55:27 | 只看該作者
感謝大家的回應,我直接用叫的了
( R. W9 V# Z7 \+ ~* k$ g竟然忘了電容可以用叫的了
10#
發表於 2010-5-24 07:17:45 | 只看該作者
回復 9# e2000 & G4 s3 F) k% n, D& i& ?4 C# N6 |

; S7 \$ I# E* Q3 q& h2 ]. Y
: W1 o9 `5 [& b3 a  T    這樣你就學不到東西了....
11#
發表於 2015-10-9 10:06:30 | 只看該作者
要看design rule才知道要怎麼畫吧
12#
發表於 2021-4-28 20:44:09 | 只看該作者
需要更多這方面知識  感謝提供
13#
發表於 2021-8-23 17:12:57 | 只看該作者
感謝大大無私的分享!!!!!
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