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[問題求助] 請問layout電阻電容畫法

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1#
發表於 2009-5-9 03:01:25 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
因為太新手無法看置頂的電阻電容畫法所以來求助,最近畫layout電阻試過了CIC所寫的三種電阻畫法,但是LVS就是找不到
# t. t1 J; a/ V+ a) P9 j他就是poly,DIFF,NWELL三種,但是我照著話就是LVS不出來,有沒有高手能把電阻的畫法一步一步的解開呢?書上講義都是把已經畫好的電阻放上去然後用箭頭指著說這是poly,這是Nwell,但是有些重疊的部份根本不知道那是什麼東西之間的重疊,不然就是外圍用虛線包住一個蛇形狀的東西並露出兩個頭,但是就是沒有寫那兩個頭裡面是什麼組成的,外表看起來就像是NWELL包住蛇形POLY,但是照著跑根本就跑不出來,因為根本不知道蛇形poly上面有加上什麼東西,要不然就是標示著電阻標示層畫法需和command file配合,淡是到底要怎樣才能弄出電阻標示層還有如何配合command file?請高手幫小弟解題,感激不盡。
7 f6 c3 V0 y2 U, g3 m至於電容更是看不清楚了,一塊正方形然後一堆箭頭指向裡面說這是什麼什麼,但是根本不知道那是怎麼組合成的,也不知道哪塊要大哪塊要小...
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2#
發表於 2009-5-12 09:16:24 | 只看該作者
你要看製程廠的 rule file 他有寫 每家不同$ ?. h2 X0 b& h! e$ X7 n4 X
而畫的規格 W L 要看rd設計   ' t$ y$ K7 c. n# p; r
像大電阻就是由一堆小電阻串連而成  怕失真
3#
發表於 2009-5-12 09:31:10 | 只看該作者
像POLY 電阻 8 j1 _( R6 ^3 T$ S6 ^
最基本的就是 電流 從 CONTACT 進去 POLY  另一端CONTACT 出來 要包其他層 要看製程和RD ' F* j3 p# u* y
( w7 n2 U2 k8 r. X
它跟電路學的 電阻公式一樣  越長L 電阻越大  越寬A電阻會被整除# @! z7 ?; |2 D9 C& B

, |# K+ N+ q- B% h; T) [6 `電阻率的科學符號為 ρ 。. ]0 A' x, L& W0 M% J7 d

- X9 o9 f) s7 m6 H: }已知物體的電阻,可由電阻率ρ、長度 l 與截面面積 A 計算:
. `% U" X6 ~$ s  h  l6 z  s1 j$ u/ q1 X% Z
R =  ρ  L/A
$ g: {- t7 K/ K6 u3 x; t3 i8 k- H+ c! i
電阻 R 單位為歐姆
% a( v7 m6 k) \1 ]6 Y' q4 \長度 l 單位為米
1 S3 Y8 t0 J* ]. T( _  Z: O截面面積 A 單位為平方米 ! x& Y# S( y  \7 L9 k
電阻率 ρ 單位為歐姆·米
4#
發表於 2009-5-13 10:05:39 | 只看該作者
可以看command file裡面的敘述 會有跟你講要蓋那些layer(在最上面 or 用找低)3 K, M$ R6 D: K
或是看design rule 也有3 D2 H7 K) c6 L1 A# c9 t" ~

' v' |! x. t( Q# g我猜可能是少蓋了RPO  和 電阻的dummy層吧(RPDMY....等)
4 l/ I% Y# g$ \* W( h& _要自己讀一下唷
0 E( R5 R# f% P4 e' h, I0 Z% ?
/ U8 ?$ }; y! \1 ~* ], I! z希望能幫到你
5#
發表於 2009-5-19 17:37:20 | 只看該作者
LVS認不到,不一定是Layout錯誤
7 T# j, F, C% \# X也有可能是command file寫錯
  V) O3 \$ J, a! N1 H$ {/ [看看command file裡element res[?]是如何定義% c- w3 ^1 |, ?
再回頭檢視Layout,這樣會比較快唷!
6#
發表於 2009-5-25 15:50:47 | 只看該作者
我猜也是少蓋dummy層6 m1 ~. E/ `- D3 |/ {
查看一下command file
7#
發表於 2009-5-27 09:14:58 | 只看該作者
ex. n+ poly res W=1um  L=10um
. Z  j! w( S! J6 q+ [1.首先 劃一個 w=1um L=12um poly 矩形 再加上 n+ imp 覆蓋 整各 poly
  k3 d) H$ V: ?0 e$ H/ V, m   即 poly  在 整個  n+ imp; o( H5 k% n: Z
2.再2端多出來ㄉ地方 加上 cont 和 metal 1 keep cont 間隔 10um: `8 U' S/ ]( F
3.加上 RP_DMY 在cont 間 包附整個poly 即 RP_DMY w=1 um L=10um
+ B, R5 D, D; y0 }, p' r4.跑DRC LVS --- >完成
# e+ g# }8 U. e8 W# T3 u' n通常會有 一個 layer 層用來 辨識 電阻 看你所用的 command file5 d" b. l! F1 ^, u
有加 RP_DMY 的 poly 才會被當成電阻2 u  [5 P7 v: h* ~3 D8 ^
而cont & metal 1  是用來當電阻2端的接點
  S8 J6 P. L/ X! a. k接線用, 這樣看董ㄌ, 再去看講義,應該就能懂其他電阻的 lay 法ㄌ
8#
發表於 2009-6-1 14:10:23 | 只看該作者
應該Design rule都會有寫
5 N' z7 e. M+ s( b然後你畫電阻的話要注意
4 O9 m1 {3 |: a" p8 P他LVS是從R_DMY所畫到的範圍來判定電阻值
0 M' N, w0 Q0 W+ x% N: D5 F3 w電容的話你除了計算面電容還要考慮線電容8 [4 M  z" B; Z- e( R1 n
當然最後看你command file裡面誤差設定多少 如果是0的話很難畫到完全精準
9#
 樓主| 發表於 2010-5-24 01:55:27 | 只看該作者
感謝大家的回應,我直接用叫的了1 ?! B+ b' Z9 u6 q/ u" w
竟然忘了電容可以用叫的了
10#
發表於 2010-5-24 07:17:45 | 只看該作者
回復 9# e2000
; t, j# M. _3 q
8 l* m4 m+ h+ s; n  k
1 \8 q5 |4 z) Q6 m9 E    這樣你就學不到東西了....
11#
發表於 2015-10-9 10:06:30 | 只看該作者
要看design rule才知道要怎麼畫吧
12#
發表於 2021-4-28 20:44:09 | 只看該作者
需要更多這方面知識  感謝提供
13#
發表於 2021-8-23 17:12:57 | 只看該作者
感謝大大無私的分享!!!!!
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