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[問題求助] 請問layout電阻電容畫法

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1#
發表於 2009-5-9 03:01:25 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
因為太新手無法看置頂的電阻電容畫法所以來求助,最近畫layout電阻試過了CIC所寫的三種電阻畫法,但是LVS就是找不到
$ F7 w1 C# K& N+ [7 y$ h8 c# s- a他就是poly,DIFF,NWELL三種,但是我照著話就是LVS不出來,有沒有高手能把電阻的畫法一步一步的解開呢?書上講義都是把已經畫好的電阻放上去然後用箭頭指著說這是poly,這是Nwell,但是有些重疊的部份根本不知道那是什麼東西之間的重疊,不然就是外圍用虛線包住一個蛇形狀的東西並露出兩個頭,但是就是沒有寫那兩個頭裡面是什麼組成的,外表看起來就像是NWELL包住蛇形POLY,但是照著跑根本就跑不出來,因為根本不知道蛇形poly上面有加上什麼東西,要不然就是標示著電阻標示層畫法需和command file配合,淡是到底要怎樣才能弄出電阻標示層還有如何配合command file?請高手幫小弟解題,感激不盡。# |0 ]2 r) U* k- ^
至於電容更是看不清楚了,一塊正方形然後一堆箭頭指向裡面說這是什麼什麼,但是根本不知道那是怎麼組合成的,也不知道哪塊要大哪塊要小...
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2#
發表於 2009-5-12 09:16:24 | 只看該作者
你要看製程廠的 rule file 他有寫 每家不同
  R2 Y6 a; N* i7 }* k而畫的規格 W L 要看rd設計   / i7 m) {1 `8 {# x, g, f8 X6 a
像大電阻就是由一堆小電阻串連而成  怕失真
3#
發表於 2009-5-12 09:31:10 | 只看該作者
像POLY 電阻
1 {" E% i" U( X' P! Q" Y最基本的就是 電流 從 CONTACT 進去 POLY  另一端CONTACT 出來 要包其他層 要看製程和RD - C( `5 |7 |0 _' N, k3 q- H

" r& |/ S! [$ W它跟電路學的 電阻公式一樣  越長L 電阻越大  越寬A電阻會被整除
' i( y! V2 h  {* P* q3 }! Z2 M( k( x& y2 E: N
電阻率的科學符號為 ρ 。
% K; `1 X: [5 A% n) @7 ]/ q8 O$ _( A% \
已知物體的電阻,可由電阻率ρ、長度 l 與截面面積 A 計算:
& f3 p+ f) F+ L, M" V' F; @2 D# z9 l3 f/ {3 |( ^/ M8 x
R =  ρ  L/A8 l6 @' x0 I" l: V; D
1 s! V: z+ Y" ~- E% a
電阻 R 單位為歐姆
" Q" U. d1 O) ?長度 l 單位為米
5 g4 ^; r' K2 y5 V截面面積 A 單位為平方米
3 {* k. N8 Y1 a: C/ _電阻率 ρ 單位為歐姆·米
4#
發表於 2009-5-13 10:05:39 | 只看該作者
可以看command file裡面的敘述 會有跟你講要蓋那些layer(在最上面 or 用找低)
$ k2 [$ T) m% I+ T" q, L或是看design rule 也有
, {& h4 g% c% P0 W% z! ^8 s4 v7 A8 q, e
我猜可能是少蓋了RPO  和 電阻的dummy層吧(RPDMY....等)! v  Z3 m3 a# I. b+ d# @! H! s; i4 Z
要自己讀一下唷
" I: V6 C, l- d5 Y
8 [+ V) F; W3 Y希望能幫到你
5#
發表於 2009-5-19 17:37:20 | 只看該作者
LVS認不到,不一定是Layout錯誤  d1 j3 I% ?' J6 N# \5 L
也有可能是command file寫錯2 ~  \% P) ~. d* r8 E6 ^  ~* U
看看command file裡element res[?]是如何定義
5 D# L" y  c7 _+ K; r再回頭檢視Layout,這樣會比較快唷!
6#
發表於 2009-5-25 15:50:47 | 只看該作者
我猜也是少蓋dummy層
4 q3 i0 q- v, T- W" X查看一下command file
7#
發表於 2009-5-27 09:14:58 | 只看該作者
ex. n+ poly res W=1um  L=10um , e( z0 M, x6 g* z2 ^  X9 b" |9 e
1.首先 劃一個 w=1um L=12um poly 矩形 再加上 n+ imp 覆蓋 整各 poly$ R- i5 j8 x  h1 K
   即 poly  在 整個  n+ imp
0 C* D  O6 @& q3 ?- D2.再2端多出來ㄉ地方 加上 cont 和 metal 1 keep cont 間隔 10um
7 ~2 n( ^! N+ P' ~& J- |3.加上 RP_DMY 在cont 間 包附整個poly 即 RP_DMY w=1 um L=10um
- G$ ?8 i8 `5 `4.跑DRC LVS --- >完成6 ^  U' W7 |; B6 s5 d1 G/ t& f" a+ h
通常會有 一個 layer 層用來 辨識 電阻 看你所用的 command file* _9 [. ~" g6 R, @. s! H' ^
有加 RP_DMY 的 poly 才會被當成電阻* M  T# x% U9 w7 E; b) m5 |
而cont & metal 1  是用來當電阻2端的接點
1 d. D) l7 o* [: b9 D* z接線用, 這樣看董ㄌ, 再去看講義,應該就能懂其他電阻的 lay 法ㄌ
8#
發表於 2009-6-1 14:10:23 | 只看該作者
應該Design rule都會有寫* K3 Q: o, `" K5 p7 I
然後你畫電阻的話要注意* Z& [$ M% r1 Q, g! a
他LVS是從R_DMY所畫到的範圍來判定電阻值1 N- o/ A: B/ E6 f# |
電容的話你除了計算面電容還要考慮線電容
# ~& P, Z# B$ A當然最後看你command file裡面誤差設定多少 如果是0的話很難畫到完全精準
9#
 樓主| 發表於 2010-5-24 01:55:27 | 只看該作者
感謝大家的回應,我直接用叫的了
1 k" o+ i4 [4 A$ b  ^- c竟然忘了電容可以用叫的了
10#
發表於 2010-5-24 07:17:45 | 只看該作者
回復 9# e2000 ' b  [$ m  f. U: @( Z6 z$ x
7 R1 ^: N  X$ G* C3 h0 G
! D* X! G' p! t0 r2 G
    這樣你就學不到東西了....
11#
發表於 2015-10-9 10:06:30 | 只看該作者
要看design rule才知道要怎麼畫吧
12#
發表於 2021-4-28 20:44:09 | 只看該作者
需要更多這方面知識  感謝提供
13#
發表於 2021-8-23 17:12:57 | 只看該作者
感謝大大無私的分享!!!!!
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