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[問題求助] 請問layout電阻電容畫法

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1#
發表於 2009-5-9 03:01:25 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
因為太新手無法看置頂的電阻電容畫法所以來求助,最近畫layout電阻試過了CIC所寫的三種電阻畫法,但是LVS就是找不到
8 [+ C3 i8 U( a; V0 H他就是poly,DIFF,NWELL三種,但是我照著話就是LVS不出來,有沒有高手能把電阻的畫法一步一步的解開呢?書上講義都是把已經畫好的電阻放上去然後用箭頭指著說這是poly,這是Nwell,但是有些重疊的部份根本不知道那是什麼東西之間的重疊,不然就是外圍用虛線包住一個蛇形狀的東西並露出兩個頭,但是就是沒有寫那兩個頭裡面是什麼組成的,外表看起來就像是NWELL包住蛇形POLY,但是照著跑根本就跑不出來,因為根本不知道蛇形poly上面有加上什麼東西,要不然就是標示著電阻標示層畫法需和command file配合,淡是到底要怎樣才能弄出電阻標示層還有如何配合command file?請高手幫小弟解題,感激不盡。
% D: B5 g4 _! U/ O' L; U至於電容更是看不清楚了,一塊正方形然後一堆箭頭指向裡面說這是什麼什麼,但是根本不知道那是怎麼組合成的,也不知道哪塊要大哪塊要小...
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2#
發表於 2009-5-12 09:16:24 | 只看該作者
你要看製程廠的 rule file 他有寫 每家不同
2 T5 N4 G7 C0 g0 a; z; B5 x而畫的規格 W L 要看rd設計   
& S' G% ^$ c& U* J1 t/ H0 s像大電阻就是由一堆小電阻串連而成  怕失真
3#
發表於 2009-5-12 09:31:10 | 只看該作者
像POLY 電阻 / {; Z* b1 }/ f$ P# l" c9 i2 a& o0 Y
最基本的就是 電流 從 CONTACT 進去 POLY  另一端CONTACT 出來 要包其他層 要看製程和RD
8 h; m0 C, X4 Y; G  A3 U/ n- q5 y0 d7 G2 _# Z0 p2 U2 i! H
它跟電路學的 電阻公式一樣  越長L 電阻越大  越寬A電阻會被整除
1 x( Y* ^, _. @/ }7 L, E1 {6 g; I7 a2 ]
電阻率的科學符號為 ρ 。8 u. Y% P* N1 a' ?7 ]' G' B
1 D4 I- u( ]. q
已知物體的電阻,可由電阻率ρ、長度 l 與截面面積 A 計算:
0 z. a* ?7 U) M. D- O; m& U
, c5 R% B8 m& w' m, G R =  ρ  L/A7 h% e1 u$ S- h% d4 k
( i( i) W/ s' j% L
電阻 R 單位為歐姆 1 M# o5 b& q6 q
長度 l 單位為米 - ]: r% ~( J+ _
截面面積 A 單位為平方米 & q% ?, `" l7 v$ t/ Z! B
電阻率 ρ 單位為歐姆·米
4#
發表於 2009-5-13 10:05:39 | 只看該作者
可以看command file裡面的敘述 會有跟你講要蓋那些layer(在最上面 or 用找低)
4 z; s9 V' [) |4 A或是看design rule 也有( X& l. _: M# y5 K  ]  l# x

1 R9 y! {% ]9 U" C我猜可能是少蓋了RPO  和 電阻的dummy層吧(RPDMY....等)
' q. Y1 n% s, L要自己讀一下唷
& a# L, i1 ^3 H# P0 \* {/ d/ u- G1 Z
希望能幫到你
5#
發表於 2009-5-19 17:37:20 | 只看該作者
LVS認不到,不一定是Layout錯誤
  Q4 V( f6 E3 V3 U$ A6 p# p也有可能是command file寫錯' _  b; Y% l5 g/ Z3 p! E( \. u
看看command file裡element res[?]是如何定義9 e9 V# p5 _/ B8 r! M6 @
再回頭檢視Layout,這樣會比較快唷!
6#
發表於 2009-5-25 15:50:47 | 只看該作者
我猜也是少蓋dummy層% q# M" o7 S  b
查看一下command file
7#
發表於 2009-5-27 09:14:58 | 只看該作者
ex. n+ poly res W=1um  L=10um 4 [- F( f0 f/ ~1 J, u+ Y
1.首先 劃一個 w=1um L=12um poly 矩形 再加上 n+ imp 覆蓋 整各 poly/ H, d$ z8 G+ M
   即 poly  在 整個  n+ imp  S! Q4 o1 C$ d' A4 @
2.再2端多出來ㄉ地方 加上 cont 和 metal 1 keep cont 間隔 10um' k0 s" H( m4 O0 j& n7 t
3.加上 RP_DMY 在cont 間 包附整個poly 即 RP_DMY w=1 um L=10um
' Z  X; }2 B7 i: E4 g: S7 T4.跑DRC LVS --- >完成! m2 J/ J4 P; H4 L$ J
通常會有 一個 layer 層用來 辨識 電阻 看你所用的 command file
# V; H1 o, Z3 `2 }. K有加 RP_DMY 的 poly 才會被當成電阻
0 m7 U, v; X' l- J/ v而cont & metal 1  是用來當電阻2端的接點
6 u: e2 W; G  [接線用, 這樣看董ㄌ, 再去看講義,應該就能懂其他電阻的 lay 法ㄌ
8#
發表於 2009-6-1 14:10:23 | 只看該作者
應該Design rule都會有寫
8 l1 W+ t# v* L" O  {1 B+ q然後你畫電阻的話要注意& P+ D. V  t8 e5 m8 o
他LVS是從R_DMY所畫到的範圍來判定電阻值
& i* L( o# g3 C) i% u  Q* V電容的話你除了計算面電容還要考慮線電容
5 e# q$ M! M! ^" ~1 |當然最後看你command file裡面誤差設定多少 如果是0的話很難畫到完全精準
9#
 樓主| 發表於 2010-5-24 01:55:27 | 只看該作者
感謝大家的回應,我直接用叫的了/ r2 a0 h( o8 ^9 c! @) o" t
竟然忘了電容可以用叫的了
10#
發表於 2010-5-24 07:17:45 | 只看該作者
回復 9# e2000 ! a1 R5 d0 h9 N

9 F: [% ]% u( ^/ l3 X) }  g* [9 [6 ]3 X  b/ m5 M1 c8 J
    這樣你就學不到東西了....
11#
發表於 2015-10-9 10:06:30 | 只看該作者
要看design rule才知道要怎麼畫吧
12#
發表於 2021-4-28 20:44:09 | 只看該作者
需要更多這方面知識  感謝提供
13#
發表於 2021-8-23 17:12:57 | 只看該作者
感謝大大無私的分享!!!!!
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