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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 在Layout時最花時間的工作是....
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樓主: jauylmz
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在Layout時最花時間的工作是....

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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   
* Y3 z6 W9 D! d; F7 J$ l* o
' _6 U) c6 r6 @; B其他就會很快   相對LVS 問題也比較好除錯& a- I% i  c+ ^/ ]) T& a" \( N
9 V8 ?8 |( E" Z: u3 `
HR.概念有  應該DRC LVS比較不會有問題吧
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AaronChu
38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...7 l# E( A0 M7 j. `( K
要不然最後會發生難以挽回的錯誤啊>.<
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brooo
37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧
5 @$ I$ `# r" I, @! o% F9 B
$ c2 l" i- v3 B" _! A在layout初期就要花很多時間先想好如何排列" }* V: |. Y5 f% ^6 r% d
! L- {; D, ^  y0 `8 i5 N3 M
想好後，反而才會省下大量的時間
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   9 ]5 G" ?$ S3 x' g% q; h& }' a3 b# S& F9 z
6.  整合 Chip Integration
; u/ `& y1 Y$ W* i9 x8 X 7.  溝通 communication7 L7 g" Q, Z; k0 [* o  F
這三個最麻煩
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app
35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~$ ^/ S0 e8 ?9 [
因要如何將每個block充分擺到適當的位子~
) ?# e8 ?- N0 i% p2 |! I這是一種學問~1 \! ~: c& x7 t2 b/ c
因擺的好的話~
# H" j/ L' J. L; u其他的閃線或拉power一切都還滿ok的
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎# Y8 w6 T8 B5 y) E- J: d+ z
LAYOUT我覺得每項都很花時間: x7 Q2 f, ~2 O& m
不管是佈局還是LVS/DRC; A9 \, V: b4 _/ w8 [
每項都得小心翼翼
. f( Q0 W% L2 X8 b7 c- l, _做快不見得好
& l2 j2 Y1 e. E做對才是重要
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sj1130
33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間，可能是因為剛接觸Layout沒多久，經驗不足顯得更無力！
+ L4 n+ S3 Q9 T8 H1 p, w9 t整合這部份，如果是自己獨立一人完成，雖然時間耗費較多，但是就跟寫程式一樣，如何去安排自己的line能走得順
$ x/ u3 t2 S( [4 |& v我想這才是最重要的！重點一句：還是經驗比較實際吧
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难，最能体现实力！。。。。。。。。。。。。。。。
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fei
31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非
6 r6 y; z4 p% a) ^, U: H4 ~7 i, H
我花最多時間的是在思考，
+ J) q- }5 W0 e$ f/ [9 `一個5天該完成的案子，我可能會花去2~3天思考。) {5 g& w5 `+ g. d
事前想的仔細，
6 u0 M" W& c/ K# |4 G- j開始動手layout一直到驗證完成都會很快而且順利。
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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jauylmz
28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好，所以floorplan是很重要。
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ynru12
26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的  J4 T" Z8 N* ]: H/ p
最辛苦的就是改圖~原本己經畫好的，但是rd突然說要改圖7 i& ]* H+ R) N
然後整個的大小不變，但是改的地方，又比原來的大一些5 A8 G/ p8 L$ f0 q$ P
這是最麻煩最痛苦的
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qwertmn
25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~
1 \: N$ J! y- m; u0 }& X/ }; G光是排列就會影響後續走線/ p) C1 @" y' W1 g: u1 k! M
所以要特別注意~~~
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yhchang
24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說7 x) j. h0 Q( m8 ~9 n
一直改圖對LAYOUT來說是最花時間的
: W  G4 I2 G" [( q1 S或者是 沒有看清楚 RD寫的NOTE  l; @, R' R- D" K8 }
導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的  g, Y8 C8 t6 j5 u9 C
1 O4 E" L( _* N4 ?+ M+ _
有時候我們公司RD也不想讓LAYOUT一直改
' L# O  X5 K6 s. W/ @只是因為有時專案太趕" k" e! J* H) P4 c3 e' B, O
所以只好跟LAYOUT同時平行做
" T* R4 G( P% S. N) ?' R7 N, u+ {這樣就容易電路常常會大翻盤
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yhchang
23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠
$ g5 y9 t* r5 z3 x8 m% s* H% q  V你勉強把東西 塞進去之後  好不容易做完# j2 ]/ P3 t$ M) v8 B3 P$ ?
結果電路圖又變了  你就完了
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話！面積會變大∼甚至拉線會亂七八糟ㄉ∼
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samgu
21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩，因為一個好的 floor plan 除了能讓訊號線走的順之外，也可以節省面積
, Z1 L/ J5 J6 X: ^6 j  U, I; y2.接下來我覺得比較重要的是 power and ground line 的跑線，因為要走的順才是最重要的，而且若POWER途中一直換線其實也會降低它的電流- C* M- E) M# u
3.接下來我覺得都還好，因為 DRC LVS block 刻好就會 RUN 了 ，另外create block本來就需要花一點時間
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20#
發表於 2007-12-24 15:01:13 | 只看該作者
我覺得最怕的是先前的準備與溝通都達到共識,layout已經好了,最後designer說要重劃那真的是啞口無言!!
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