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[問題求助] PLL 的實現方法?

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1#
發表於 2007-6-8 19:19:44 | 顯示全部樓層
問一下下...  i3 P- V4 [: Y9 [5 ~1 M

8 t, e' H* U+ @0 @+ B( [你有HSYNC可用嗎? MODE 有固定嗎 ?% [. F; w  `6 ]" I7 N5 @! }4 K
有的話至少已經上 KHz* e3 _, l4 \  Q- g, d2 |
而且就倍數來說一定也會跟VSYNC同步吧
2#
發表於 2007-6-10 21:50:08 | 顯示全部樓層
... 這樣說吧* s1 L9 F6 |6 i8 g# H0 [% A
如果有 PIXEL CLK 就用它除頻
, q6 w* y6 q5 L& q/ F如果有 HSYNC 就用它倍個幾次
% e3 I  T% j+ J
- j6 {' ^1 z3 m+ E$ e9 d! x! ^+ D因為 PIXEL(DOT), HSYNC, VSYNC 之間有一定的倍數關係
! a* |$ G6 v$ J, z' a3 W6 R$ H, m) G. S7 S9 A( j, n
   640x480@60Hz => 25.175MHz (39.7ns)
3 x( B; i4 r# H# S# W   DOTx800=HSYNC, 39.7ns x 800 = 31.469us
  b1 N8 i4 T5 ?& {( ]; x% g3 c( N5 K0 t   HSYNCx525=VSYNC, 31.469us x 525 = 16.52ms (60Hz)9 B! Z5 a) u6 O( I
所以這樣的CLK一定會和VSYNC同步 (詳見VESA Monitor Timing SPEC), O7 q* A: L) c- `# K
  _9 K& [: z& L5 h# ?
接下來如果要VSYNC時不出CLK.. 那就用個AND閘吧 (看你用哪個MODE, SYNC有High或Low)
* a! D) l( }2 z4 m: J) k. _9 K- ^  h- ]" B: f8 N' ~, b" @
還是我想的清況和你不同呢?
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