verilog 觸發的問題

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請問....
5 b6 k( _3 U' k) d6 X0 n- {    always (*)
+ f" T  p: B! C, `     begin
9 q* ~1 p0 k- ?6 h' [$ u9 _) z      if(!rstn) r1 = r2 + r3 ;
' ]! v/ p8 A/ E" s      else      r1 = r5 << 4;
     end
    請問*是表示r2.r3.r5的意思嗎,如果是像這樣子的寫法是否能夠合成
   
     小弟才疏學淺...謝謝各位大大