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[市場探討] Synopsys針對台積電設計參考流程8.0版及45奈米製程技術

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1#
發表於 2008-2-25 19:24:18 | 顯示全部樓層
T 公司每年 DAC 都會提出一個新版的 Reference Flow: P7 O  G7 g6 e- L
一般都是每年6~7月
$ v- f9 }4 j: O) G2 x* s6 ?/ O0 b. M
. p2 F5 N9 [8 l+ I; O; H各大 EDA 廠商 都會根據台積給的題目作答1 F+ K9 j7 K- j1 ]3 V* ]! }
所以技術世代上並無太大差別# |& C; l! Q' ~  i5 `! b9 Z2 Z8 N- d
但是在看 Press Release 的時候就要仔細了
  I7 }% W% _0 P1 d看台積原本提出幾項,而該廠文中提到幾項,有幾項一句帶過# \4 ^. f7 @& K% ^( `5 [( D- T
就知道那些是沒有支援的
$ F- _0 @* u" h4 ]) \2 z" {例如45nm rule,大家都說支援,真正跑的時候有一家沒跑完,有一家結果一堆XX,而有跑完的一家自己檢查DRC查不出來只能靠使用者提供座標後修,當然這些都會漸漸在以後版本改善,只是外行人別把這些公司看的太神了& `, x: J# H* R: x" f# Q
+ m* ^+ j0 o; G! b6 e6 o
另外GUC用的這個DFT,除了歷史悠久以外沒什麼優點
- o/ U  l; z; y1 _$ ~XOR compression 和 Illinois scan chain 這麼標準的東西也能拿出來講& A" v% J9 L: e! T+ y2 V: j
頂多說是因為DC用很久了用這個不用學新的9 h  Y2 s0 G" O4 ~7 `# {
學過EDA的都很想知道DC這種古董不知為何能存再這麼久..大概一般人太懶吧

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jiming + 3 內行人多來參與討論吶!!
yhchang + 3 Good answer!

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