Chip123 科技應用創新平台
標題:
賽靈思全新完備FPGA解決方案簡化記憶體界面設計
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作者:
jiming
時間:
2007-6-7 03:50 PM
標題:
賽靈思全新完備FPGA解決方案簡化記憶體界面設計
內建功能、易於使用的軟體、免費參考設計以及開發套件
$ J5 e6 R5 H# W4 O
讓設計業者能快速建置高設計利潤的
FPGA
記憶體界面
Z* `- c- U4 q* ~9 W8 N) [) O
R9 A6 h) m& m9 d7 M
/ p7 p, o5 W, j3 ]2 W
全球可編程邏輯解決方案領導廠商
Xilinx(
美商賽靈思
)
公司
(NASDAQ:XLNX)
今日宣布宣佈其針對
DDR2 SDRAM
界面的低成本
Spartan-3A FPGA
開發套件、鎖定多重高效能記憶體界面
(I/F)
的
Virtex-5 FPGA
開發平台
(ML-561)
，以及
1.7
版的記憶體界面產生器
(MIG)
軟體，均已經上市。這些完備的解決方案讓
FPGA
用戶在各種資訊傳輸速率及匯流排頻寬條件下，快速建置、驗證客製化的記憶體界面設計，加速上市時程。
. N+ ^; E) w; y; c7 B* W
/ r# C" L' u6 }; P* e2 ]9 {
包含元件特性、資訊擷取電路圖、以及記憶體控制器等解決方案，皆通過美光科技
(Micron Technology)
等業界領導廠商的記憶體元件硬體驗證。
; I. G9 |5 }6 O7 E2 ]
, [* S$ u U5 G2 X5 V; |- B+ y
美光公司記憶體事業群應用工程部門總監
Jim Cooke
表示：「美光和賽靈思均致力為最低成本到最高效能的應用，提供與驗證完整的記憶體解決方案。我們擁有多年合作經驗，足以確保美光的記憶體元件能與賽靈思的
FPGA
搭配得天衣無縫。我們最新的
DDR2 SDRAM
搭配
Spartan-3 generation
與
Virtex-5 FPGA
，可提供客戶彈性化選擇，並協助其達成低成本與高效能的系統要求。」
: x, g5 Q' ~# V: w' c7 ^7 b$ _5 A# _* B
. {* S7 @+ O, V/ {' e6 i6 v
賽靈思的記憶體界面解決方案，是採用經過生產驗證的
90
奈米
Spartan-3A
與
65
奈米
Virtex-5 FPGA
所開發的，相較於市面上任何一款
FPGA
解決方案，其可支援高達兩倍的頻寬。運用
I/O
最佳化的
Spartan-3A
系列元件可迅速建置低成本記憶體界面；而內建
75 ps
校正電路、可在
FPGA
任一面連結記憶體的彈性
I/O
、以及採用創新封裝技術來最小化訊號串音雜訊的
Virtex-5 FPGA
，則能在廣泛的記憶體界面中提供可靠運作、以及最高的頻寬。
5 O0 ^% @4 @; x6 Y" W
\+ r% C% ~9 d( g% b/ L
Linley Group
資深分析師
Jag Bolaria
指出：「從低成本消費性產品到高階通訊系統，記憶體界面與
FPGA
已深入各種產業，提供
200 Mbp
到超過
600 Mbp
的效能要求，以及高於
144
位元的匯流排頻寬。賽靈思廣泛的
FPGA
支援與記憶體界面解決方案，讓設計業者縮短系統開發時間。」
/ V/ h0 H6 e M- e
?+ V6 h, U- V
保證立即可用的低成本
Spartan-3A FPGA
開發套件
' F: O. z, l$ `6 `+ j& ]% ~
Spartan-3A FPGA
的
DDR2 SDRAM
界面開發套件，讓設計業者能在不到一個小時內，立即取得
DDR2 SDRAM
界面並開始運作。開發套件包含完成一個低成本設計及其他設計所需的所有元件：
內建
Spartan-3A(
型號
XC3S700A-FG484) FPGA
與
32Mx16 DDR2 SDRAM
元件的
Spartan-3A starter kit
機板。
預先驗證的參考設計，可顯示
267 Mbps DDR2 SDRAM
搭配最低速級
Spartan-3A FPGA (Spartan-3A FPGA
系列可支援
333 Mbp
；
400 Mbp
的特性描述正進行中
)
的運作情形。
使用
Xilinx ChipScope Pro in-circuit
邏輯分析器來的說明檔案，可讓設計業者驗證資料傳輸與監控訊號。
常用的平行、序列式界面與連結器。
內含
ISE™
設計軟體與
ChipScope Pro
分析器的評估光碟。
USB FPGA
下載纜線。
英文、日文、韓文以及簡、繁體中文版本的快速啟用指南。
具備多重記憶體界面支援的高效能
Virtex-5 FPGA
開發公板
0 Z6 H" U6 B' o: k2 b2 }% z
Virtex-5 FPGA
開發平台
(ML561)
具備多重高效能記憶體界面與經硬體驗證的參考設計，以及詳細
ChipScope Pro
說明檔案，可協助最高頻寬記憶體界面的建置與驗證作業：
667 Mbps DDR2 SDRAM
已註冊且具備
144
位元界面的
DIMM
400 Mbps DDR SDRAM
300 MHz QDR II SRAM 72
位元界面
333 MHz RLDRAM II 36
位元界面
具備最佳設計彈性與易用性的記憶體界面產生器
(MIG)
$ t* B6 X' ]) C" ?" f4 h' @
MIG
是一種免費且人性化的可參數化軟體工具，可為
Xilinx FPGA
、
DDR2/DDR SDRAM
、
QDR II SRAM
、以及
RLDRAM II
等界面，在未加密的
RTL
中，創造記憶體界面設計。
MIG
支援多重記憶體架構、元件以及封裝組合，提供系統設計業者高彈性，來輕易客製化他們的設計。
MIG
目前整合在
Xilinx CORE Generator
軟體中，其可透過一個圖形界面提供
RTL
源碼與限制檔案，以提供最佳的用戶彈性。由模組化型式產出設計，並提供獨立實體層、使用者界面、以及控制器區塊，讓用戶可擁有簡化的驗證能力。
: Y5 x# `' u: w9 y
& N* b& k9 g; x& L
售價與供貨時程
# ^$ Z) B8 I3 q6 Y0 ^
低成本
Spartan-3A
的
DDR2 SDRAM
界面開發套件目前已經上市，定價為
235
美元，相關資訊請參考
www.xilinx.com/s3addr2
網頁。
RTL
源碼參考設計以及
1.7
版的記憶體界面產生器
(MIG)
可於
www.xilinx.com/memory
網頁免費下載。
Virtex-5 FPGA ML561
平台目前已經上市，定價為
5,995
美元，相關資訊請參考
www.xilinx.com/ml561
網頁。
作者:
tommywgt
時間:
2007-6-10 06:03 PM
MIG啊...我笑了
9 j# c- U. Y! N7 k7 p. B
不過對一般的user而言, 也許是個好東東也說不定...
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