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標題: 請問一下有關於寫do file的問題 [打印本頁]
作者: handwin    時間: 2007-4-19 05:28 PM
標題: 請問一下有關於寫do file的問題
各位先進大家好,在進行編譯前我想先連結Xilinx的元件庫路徑如下 C:\Xilinx\verilog\src\simprims 然後再進行編譯
3 _+ Z+ f3 S3 d7 O, V所以我該在下列註解列內  怎麼寫才能自動連結到該元件庫
" f+ q  L! P% J' p& {quit -sim3 A, z: N) V6 o- B9 K+ B
cd D:/QUEUERAM
7 N- Q" ^1 @+ M4 M8 L, Q- _/ k& K--do run.do
1 [) h0 {' k, @! m* `/ V1 Z( h6 ?; s: [" o+ p
vlib work4 x7 @1 w# B/ v# |1 g6 t& N
vmap work work
- ~3 V6 }4 ]& S7 S
7 B# S: V. ~, g4 o' }* O6 z//*****************
# X2 y% b5 b  _7 qC:/Xilinx/verilog/src/simprims* r' _9 R8 O7 X: b2 q- p) P

/ _6 S4 r" J& C! M/ _3 \/ x******************//5 e/ I0 ~/ C# s- X) ?# W
vlog QUEUERAM.v% Y) `; @2 G* \0 l; ?3 m' l
vlog Queue_By_RAM_timesim.v
- R5 {( B/ h( N. \6 ]vlog testbench_QUEUERAM.v, c4 W3 i" Z/ L, T6 }- g
( G$ P( ]" U% n7 t* b0 q. U
vsim work.t  work.glbl" d, Z, n6 K# v
% @8 R$ O6 E4 _( C2 [+ u
--add wave *2 p# b  Q2 E) w9 ]- t( M

4 _+ F, _+ _1 F2 drun -all
7 R5 `7 ^. T' x+ H* e2 Z& \3 T" q1 d, U5 j" O9 f( v7 O+ g
6 @1 ^& V  j! r+ ^  o
( y5 l. k. a7 |6 ?, M- x6 {

6 ?5 C  u) q6 @$ _0 y0 _麻煩大家了,謝謝
作者: mclaren_18    時間: 2007-5-1 01:57 PM
標題: 如何得到RDB?
如何得到RDB?   我是新手 今天爬文看到有人POST找資料的東西) f+ U; A9 e9 }- V+ u
但是要有RDB購買??9 f) i9 i. q" i
請問要如何如何得到RDB?
作者: tommywgt    時間: 2007-5-8 04:34 PM
原帖由 mclaren_18 於 2007-5-1 01:57 PM 發表 0 F" c, i) K2 U6 ]2 A/ S
如何得到RDB?   我是新手 今天爬文看到有人POST找資料的東西
+ D/ j3 X2 o0 w# q' i5 b9 K  P" b但是要有RDB購買??
7 ]* i" q, Z5 M0 Z; r9 m( l請問要如何如何得到RDB?

) g" y+ o  L( s. K. f. L  B+ o" p0 E* W" j! \
請參考http://www.chip123.com/phpBB/vie ... &extra=page%3D1
作者: tommywgt    時間: 2007-5-8 04:37 PM
回到主題...我想一定有人會回這個問題的, 只是不知道為什麼沒人回, 難道大家還是不太喜歡分享嗎?/ M) |8 y2 J' ]( ^5 H& Y

7 P2 g, |. H: k9 B- Q老實說我也不知道正的答案, 我想在ModelSim內應該有指令可以直接連結lib, & [+ C9 R% S! I, E
我比較笨...我的做法是把code放到lib的目錄內就一定可以用而且不用設定...別罵我...我已經說我比較笨了...
作者: handwin    時間: 2007-5-11 05:31 PM
標題: 回復 #4 tommywgt 的帖子
哈! 別這麼說,至少版大也提供個方法,   不過還是希望能知道dofile的詳細寫法     run起來挺屌的
作者: zanthia    時間: 2007-5-11 10:54 PM
類似下面的方法:: C6 ^& {/ O9 n' H2 n( l; z7 u- T
vmap unisims_ver C:/Xilinx/mti_se/unisims_ver/+ r- s5 [$ e5 P. Q2 W, ~$ N
vsim -Lf unisims_ver -t ps +notimingchecks work.tb( k; k1 e% |9 k8 y% j) N4 t
將 unisims_ver 改成 simprims 就可以了!9 ?. f+ t) z) t5 J9 D$ o/ |2 w1 x

5 w- |$ |4 N1 O& T- [, D1 |. c[ 本帖最後由 zanthia 於 2007-5-11 10:56 PM 編輯 ]



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