Chip123 科技應用創新平台

標題: 請問使用VerilogXL撰寫程式應注意哪些細節? [打印本頁]

作者: kennetharies    時間: 2008-12-22 12:27 AM
標題: 請問使用VerilogXL撰寫程式應注意哪些細節?
各位板上前輩你們好
0 a7 E2 u" I. ^3 f% \, @! a2 B$ x" M4 o/ Z$ p8 z1 o
小弟最近使用Verilog XL來撰寫程式~2 t; P' G! t! [0 V: }1 @  w
因在工作站(UNIX系統)上對於一些指令不太熟悉6 {: Z& U  ^1 x' T
故小弟先使用Quartus II 先寫出Verilog大概的描述' w$ E' r9 `! x' d2 W, J8 K
寫完後再傳上工作站模擬9 Z+ j% y; \. Y
小弟寫的code在Quartus II上compile沒error
  B7 ^; d+ Y( O7 e/ P( p到工作站上compile也沒有問題
# C/ ^# K; K: W) o  z但在合成的階段使用Design Compiler(Design_Vision)讀code.v時
. u$ `1 ?3 ~  ], d- }4 J( e1 p1 Z卻出現一些Error,故小弟來此詢問各位前輩
' c6 ~! r4 D0 J3 i在撰寫描述語言之前,應該先如何規劃
& n# B" Y2 c7 n  s. ^確保自己寫出的code在合成的階段較不會出錯呢?' X+ k2 G5 E9 Z

/ I) G* z. E0 b1 C# p小弟目前寫的程式是一個4-bit 二補數乘法器' S% ]) A# u9 O6 Y2 ]! n
最後要使用Astro來做Physical Design3 `$ @1 ?$ q) }! _: l, b5 ^' k' c4 G6 s
我想先寫個雛形架構,未來再拓展到更高位元' |% S6 q& u* W& ]) H
還需要做pipeline,只是在寫4-bit時就發現很多在Quartus II可以compile( N1 v2 p- o  h; x' U  m
跑模擬波形都可以出來
3 D" j: P5 T* x2 X/ g' `8 v: w但一傳到工作站卻一大堆問題要解決
, \- g7 u% t0 Y! P; y! [
1 i: `# A7 I2 K& z% U) Z4 j煩請各位高手、前輩給小弟一些指點
: @) |, K% L% r) ]' ]3 x& X謝謝Orz




歡迎光臨 Chip123 科技應用創新平台 (http://chip123.com/) Powered by Discuz! X3.2