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標題: 如呵加快HSPICE模擬 5BIT 的 計數器 的 上升及下降數度 [打印本頁]

作者: chris5555jw    時間: 2008-12-9 08:40 PM
標題: 如呵加快HSPICE模擬 5BIT 的 計數器 的 上升及下降數度
以下為我的計數器程式 用HSPICE模擬的 但是模擬出來後 發現5BIT的計數器的波形的上升及下降時間有點慢
+ S6 n: L% P& x' o4 m因此影響到我後面電路的功能 所以想請問各位大大 能否增快計數器波形的上升及下降速度( Y- K) B. ^/ b$ r: b  s5 ^3 ^
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m5 2 5 vdd vdd pch5 w=3u l=1u
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x14 tqd  clr tqe counter-1bit2 M2 a* m- |5 K5 M$ L
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作者: hvpower    時間: 2008-12-11 10:11 AM
這個不是HPSICE的問題  是你的邏輯門的傳輸延時和相應問題 ,你把你電路里面的MOS管子款髖長比增加 應該可以減小一部分




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