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標題: 何謂latch Up?如何避免? [打印本頁]

作者: man52013142002 時間: 2008-10-1 08:16 PM
標題: 何謂latch Up?如何避免?
何謂latch Up?如何避免?

我知道是一個閂鎖效應..但不知道面試主管問到..

該怎正確的回答..

作者: kokokiki 時間: 2008-10-2 10:36 AM
降低sub的阻值,layout上可多打sub-contact,在製程可採用epi製程.

作者: ninesky 時間: 2008-10-2 01:43 PM
由於PNP或NPN的BJT相互影響而產生強大的寄生電流
致使破壞到IC本身的內部元件

要避免的方法通常就是加上Double GuardRing
或是在P/N-mos之間要留有足夠的空間

作者: 小包 時間: 2008-10-19 01:07 AM
其實你仔細去看latch up的等效電路圖，不是有兩個bjt和兩顆電阻嗎，而那兩顆電阻的兩頭分別接到bjt的B和E，而Vbe正是影響bjt開關的關鍵，你有學過bjt吧，此時的bjt的b和e代表的是mos的source和body，Vbe也就是mos的source到body的壓差，而電路圖上的那兩顆電阻，代表的是source到body的寄生電阻。所以要預防latch up，就需去降低Vbe，這樣子那顆寄生的電阻也會值也會小，相對的寄生的bjt也就較不易turn on，latch up就不會發生啦~但是這是已知的狀況所以能夠預防，其他還有很多狀況都會發生latch up，但原因有待追就，所以guard ring要圍好~

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