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標題:
buck设计中如何实现LDO模式?
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作者:
szpz
時間:
2008-9-7 08:09 PM
標題:
buck设计中如何实现LDO模式?
对于一个降压dc-dc,正常工作模式为
WM,但当输入电源电压从较高值逐渐减小到接近甚至低于输出电压值时,占空比需要达到100%,也就是进入LDO模式,以最大化其驱动能力。请问如何实现这一点?请前辈不吝赐教。
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2 I J2 X$ a. \1 s
9 Q" k7 j' u" e& D. u" e
# f$ Z9 o6 V3 u+ K3 M4 a* u
以下是 LDO 的相關討論:
- I$ y3 `- _- Z5 S3 v, ^
Low Drop-Out Voltage Regulators
3 X' g4 p4 S6 s* g
Rincon-Mora 《Analog IC Design with LDOs》
$ U) `& T: u6 t4 W: v
PMOS Low_Dropout Voltage Regulator Introduction
4 X3 q! Y L1 C; V5 r
LCD Driver 設計術語簡介[Chip123月刊資料]
% E7 w8 R( F+ f+ V! h/ J# m
The evolution of voltage regulators with focus on LDO[NS講義]
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Design of High-Performance Voltage Regulators
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本帖最後由 sjhor 於 2009-5-15 06:52 PM 編輯
]
作者:
szpz
時間:
2008-9-7 08:11 PM
其实实现方式应该就是switch全开,也就是100%,只是我不明白如何检测,检测到什么信号后将进入这种模式?请多指教
作者:
alab307
時間:
2008-9-9 10:32 PM
1. 如果你設計的Buck是可以開100% duty的話
. s; y8 c5 O4 p, W
根本不用檢測, 因為switch自動會全開
$ x" s6 n" y- T4 ?& A
2. 這樣子輸入電壓會經過電感才到輸出, No Good
( |1 {) G( T1 k, a
3. 可以用看FB, FB一直不夠的話就切到LDO mode
) R& A5 d& k) l" A" v, ^ l
4. 此討論比較適合"電源管理討論區"
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