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標題:
為什麼MOS上的SOURCE要接到BULK
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作者:
crystal_blue
時間:
2008-3-30 06:28 PM
標題:
為什麼MOS上的SOURCE要接到BULK
BULK與SOURCE端相接的原因除了避免LATCH-UP,另一個就是
( ^( } b1 i, l4 V7 K7 L
避免BODY EFFECT 也就是基底效應,如果你有讀過VLSI的書不難
n% f* n: Q {4 I; y$ [; d6 T6 `
了解SOURCE跟DRAIN的導通必須透過"空乏區",空乏區的產生必
# l1 N0 k0 Z) D& [( n' a$ @ a
須透過從GATE端輸入的電壓,當輸入的電壓大於臨界電壓時空乏區
' i0 A% ~, I {) ]' n6 J x4 o
才會產生,臨界電壓與SOURCE端的電壓有密切的關係,如果沒記
$ T7 T" O( V9 ^6 P2 r
錯GATE電壓+SOURCE電壓等於臨界電壓,如果SOURCE端電壓
) G. r( \ X9 D- _- U& `1 M$ l
不等於0,將會造成打開空乏區的電壓必定需要增大,相對這種情況
7 F+ g1 A, k& a, X+ C
下的MOS就不易被導通,而且增加了電壓上的損耗。
+ y, F2 v L& a2 k8 m# R
& H3 j7 A; n u2 j$ y* z' A
如果有寫錯還請各位指正,謝謝。
作者:
shaq
時間:
2008-3-30 07:15 PM
以 PMOS 而言, Body 可接到 S 或 VDD.
7 s- H* q: [2 k3 p9 t" ]
都是為了保持 Body 對 Channel 的逆偏。
作者:
m851055
時間:
2008-3-30 07:31 PM
標題:
回復 1# 的帖子
應該是Vgs>Vt也就是說Vg-Vs>Vt........................................
作者:
ritafung
時間:
2008-4-1 12:18 AM
Seems it depends on application, Vt vary with Vsb. Mostly if we want to have min. Vt, source is connected to bulk.
作者:
yhchang
時間:
2008-4-1 07:29 AM
讀了一遍 覺得文中所稱的 空乏區 應該是 反轉區吧 (Inversion Layer)
' E! p1 l4 `; I: I* V+ d& q
我的認知是覺得 Body effect 就是 VBS=0 NMOS就是 source與bulk 要接到 GND
( j/ C( N2 l1 K+ S4 w0 C
PMOS 就是 source與bulk要接到 VDD
\ D* b% a0 i+ J2 R
但是電路上還是會有 VBS不等於0的情況
* V: m2 O% S- x6 H. L
這通常發生在 MOS串接的情況 不管是 Cascode還是 CMOS邏輯 串聯的那一塊
* {7 P5 R* W |, _* D7 i2 ~, B
都無可避免的有 基底效應出現, 所以一般來說 我們做 CMOS互補邏輯 最多就是用到 4-Input
/ b; ~) ^1 h" p7 C( m, |1 Q
因為太多輸入時 串聯的MOS間會有 Chrge sharing的問題, 其次就是疊越高的MOS Body effect會越嚴重
, J2 j$ a$ L3 d
最後一個Issue是 該邏輯拉到 1或0 其中一邊的速度會變成非常慢.
/ ]/ a9 Q# q7 b* E2 b
Cascode最多就是疊兩個 疊太多會傷到 OP ICMR 或 Output swing.
% v* k- U: T( e/ N% y" k
0 \7 J8 y) [+ H8 o: l
[
本帖最後由 yhchang 於 2008-4-1 07:30 AM 編輯
]
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