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標題:
關於偏壓電路
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作者:
adamsnet
時間:
2011-1-4 10:14 AM
標題:
關於偏壓電路
小弟想請問是有關於op bias的電路
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) J2 K* d1 i' v% \( t0 \
各位前輩有什麼訣竅嘛?
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! ], m' y5 J3 z
畢竟很多偏壓電路 一開始不知道想採用哪一種
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! X3 V! x) b* {4 W" I
能請各位推薦書(最好是有說設計的步驟)或是一些起手的想法
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小弟我不想只照著學長的例子直接拿來用
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因為感覺那不會成為自己的東西!!
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感謝~
作者:
jackrabbit
時間:
2011-1-6 04:51 PM
您這問題, 還真讓人不知該從何答起
( a6 d9 N$ E. [3 R* _) o
建議先看一些analog design的教科書吧!!
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Allen那本講OP講得挺仔細的, Razavi則是必K, 有餘力再看Paul Grey, Martin, Baker, Sansen的教科書
3 D9 R1 C$ q; r
多看幾本, 看每個人不同的解釋方法, 能幫助融會貫通!
7 n0 X5 W" m5 C
簡單說bias電路是用來設定電路的操作點(operating point)~
作者:
vjc5
時間:
2011-1-7 10:27 PM
一般OP BIAS必須有抗電源擾動, 與不受溫度變化
( ?* _6 {. R7 k, _
教科書有很多這樣的電路.
作者:
finster
時間:
2011-1-8 07:35 AM
目前最常見的是constant gm以及wide swing bias這兩種方式
7 ]+ \! T) \( L5 R/ y9 [1 U
然後再搭配start-up的電路
4 Y; m Z4 i% g0 l1 U
另外,偏壓電路一般是提供偏壓或者電流,如果是電流,那會比較在意psrr和溫度
7 P2 Q3 q7 \/ t" j
若是電壓,那需留意搭配偏壓電路的其他電路的size與matching,如OP Amp,如果OP Amp的size和偏壓電路的mirror元件size沒有等比例調整的話,那偏壓電路或者OP Amp即使設計的在好也是枉然,因為在一些power supply, temperature, and process變動下,整個performance就會漂掉,而這也是極為重要之處
作者:
adamsnet
時間:
2011-1-11 09:19 AM
感謝大家!!!
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基本上樓上各位前輩說的各種特性我都知道
$ ^* n3 ~+ C0 B$ G% m$ J
只是要如何把它切確的轉化成電路
! o, L, v8 ]) ~ ~1 w
我的意思是
: L; A! Y& W2 R7 m8 H/ z
假設今天我op共有7個mos疊接(3個p 4個nmos)
0 e: U+ K9 T5 F* t" Y- B5 Z
那bias電路應該也有6個不同的電壓準位出來對吧?
! S' O7 Z2 C0 N6 w
(對應到同level的mos的gate端 扣掉input的mos)
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那bias電路中應該有三個pmmos
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一定都是pmos最上面那個的gate拉到下面一個pmos的drain嗎
( k; R" Q, {9 ?/ k8 B, G) S# V1 L
還是會拉到最下面pmos的drain(等於橫跨過中間那個)?~
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像是此種架構性的問題~
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非常感謝各位前輩喔!
作者:
shangyi
時間:
2011-1-11 09:49 AM
你應該先搞清楚 "pmos最上面那個的gate拉到下面一個pmos的drain" 跟 "拉到最下面pmos的drain"
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的差異跟目的是什麼?
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還有你的OP疊接這麼多MOS的目的是什麼? 需要六個偏壓點?
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op操作電壓範圍是多少? 此op有什麼特殊應用?
) E1 r2 D& i9 Z; s- W5 T* j1 m, n
上面的東西可以在上面的人所推薦的書上找到.
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bias 電路是廣泛使用的電路. 你想要創造新的架構 ...又有很好的特性...很難
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一開始採用書上基本的就好 若不符合你的應用.. 再去思考怎麼改善現有的架構
作者:
game750219
時間:
2011-1-11 11:17 AM
建議你去看CMOS Circuit Design - Layout and Simulation R. Baker 這本書的23章
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裡面有幾個基本偏壓電路
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也許對你有幫助
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