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標題:
是否畫不同類型的電路就會有不同的積體電路佈局考量?
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作者:
yhchang
時間:
2008-1-19 09:16 PM
標題:
是否畫不同類型的電路就會有不同的積體電路佈局考量?
最近我有一個朋友去面試
( t4 j% ?7 D- V" x4 x
他跟主管說 他在公司都畫 Bandgap/Charge pump相關的類比電路Layout
9 j$ t3 w, {5 ~& n' G! x
8 l7 T, C7 L+ T; D
結果被該主管批評 那只是 DC to DC converter的 Layout
7 o# t v) B/ m8 D2 A, N& r2 ~
並非是類比電路的Layout
: B$ |) i* X4 \% y' u
. Q( I6 p8 M, T. n) k3 E
因此小弟會有個疑問, 難道各個不同種類的電路
8 w, s- F: s6 D2 M
Layout的考量就會大不相同嗎?
/ b- P( Q6 B5 \; k7 _5 D* C
% ^: r' V, S: a( C: D- p
不是只要能畫出 可以解決 Device mismatch 以及較能抵抗 Process variation的
* r4 K g* s$ I4 ~! V$ Y3 q
Layout就可以了嗎?
作者:
m851055
時間:
2008-1-20 11:46 AM
Bandgap/Charge pump 確實不是analog layout................
作者:
yhchang
時間:
2008-1-20 11:51 AM
標題:
回復 2# 的帖子
那請教一下
, z# ^1 H. X/ j* s
畫哪些種類電路的Layout
/ [3 O l' c& Y9 I3 S7 C1 [8 u
才算是畫 Analog 電路 Layout 呢?
作者:
fjc36
時間:
2008-1-21 10:59 AM
analog in analogy out 包括放大.
7 j4 C0 e# ?; O3 p1 H9 X" b; v- s' z8 F
DC穩壓也是, 即使輸出恆定, 但只要不是0或1吧.
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